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新思科技面向臺積電推出全面EDA和IP解決方案

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2023-11-01 10:47:37822

思科技攜手合作伙伴開發針對臺公司N4P工藝的射頻設計參考流程

(RF)設計和接口IP五項大獎。新思科技與公司長期穩固合作,持續提供經過驗證的解決方案,包括由Synopsys.ai全棧式AI驅動型EDA解決方案支持的認證設計流程,幫助共同客戶加快創新型人工智能
2023-11-14 10:31:461202

思科技加入“Arm全面設計”生態系統并提供IP和芯片設計服務

思科技加入“Arm全面設計”(Arm Total Design)生態系統并提供IP和芯片設計服務,通過Synopsys.ai全棧式AI驅動型EDA全面解決方案和硬件輔助驗證產品組合降低定制SoC
2023-11-17 09:24:091619

:1.4nm 研發已經全面展開

來源:EETOP,謝謝 編輯:感知芯視界 萬仞 在近日舉辦的IEEE 國際電子器件會議(IEDM)的小組研討會上透露,其1.4nm 級工藝制程研發已經全面展開。同時,還再次強調,2nm
2023-12-19 09:31:061097

思科技與英特爾深化合作,以新思科IP和經Intel 18A工藝認證的EDA流程加速先進芯片設計

?芯片制造商與EDA解決方案和廣泛的IP組合緊密合作, 能夠提升產品性能并加快上市時間 摘要: 新思科技數字和模擬EDA流程經過認證和優化,針對Intel 18A工藝實現功耗、性能和面積目標
2024-03-05 10:16:591017

Marvell將與合作2nm 以構建模塊和基礎IP

Marvell將與合作2nm 以構建模塊和基礎IP 張忠謀于1987年成立的臺灣積體電路制造股份有限公司,簡稱:,英文簡稱:TSMC。早在2022年底就已經宣布3納米制程工藝
2024-03-11 16:32:591619

思科技正式推出業界首個1.6T以太網IP整體解決方案

思科技1.6T以太網IP整體解決方案現已上市并被多家客戶用,與現有實現方案相比,其互連功耗最多可降低50%
2024-03-19 10:23:061144

思科推出業界首個1.6T以太網IP整體解決方案

思科技(Synopsys)日前重磅推出了業界首個1.6T以太網IP整體解決方案,這一創新性的方案在數據密集型人工智能(AI)工作負載的處理上,顯著提升了帶寬和吞吐量,為行業樹立了新的技術標桿。
2024-03-19 10:24:59908

思科面向公司先進工藝加速下一代芯片創新

?新思科技攜手公司共同開發人工智能驅動的芯片設計流程以優化并提高生產力,推動光子集成電路領域的發展,并針對臺公司的2納米工藝開發廣泛的IP組合 ? 摘要: 由Synopsys.ai? EDA
2024-05-11 11:03:49695

思科技與公司深度合作,推動芯片設計創新

 新思科EDA事業部戰略與產品管理副總裁Sanjay Bali表示:“新思科技在可投產的EDA流程和支持3Dblox標準的3DIC Compiler光子集成方面的先進成果,結合我們廣泛的IP產品組合,使得我們與公司能夠助力開發者基于公司先進工藝加速下一代芯片設計創新。
2024-05-11 16:25:421016

思科技與公司深化EDAIP合作

思科技近日與公司宣布,在先進工藝節點設計領域開展了廣泛的EDAIP合作。雙方的合作成果已經成功應用于一系列人工智能、高性能計算和移動設計領域,取得了顯著成效。
2024-05-13 11:04:48931

思科推出業界首款PCIe 7.0 IP解決方案

思科技(Synopsys)近日宣布,推出業界首款完整的PCIe 7.0 IP解決方案,包括控制器、IDE安全模塊、PHY和驗證IP。該解決方案可以助力芯片制造商滿足計算密集型AI工作負載在傳輸海量
2024-06-25 09:46:531210

思科推出業界首款PCIe 7.0 IP解決方案

PCIe 7.0 IP解決方案,加速萬億參數領域的芯片設計 新思科推出業界首款完整的PCIe 7.0 IP解決
2024-06-29 15:13:321360

思科技攜手英特爾推出可量產Multi-Die芯片設計解決方案

思科技(Synopsys)近日宣布推出面向英特爾代工EMIB先進封裝技術的可量產多裸晶芯片設計參考流程,該流程采用了Synopsys.ai EDA全面解決方案和新思科IP。該經過優化的參考流程
2024-07-16 09:42:161291

思科技PCIe 7.0驗證IP(VIP)的特性

在近期的博文《新思科技率先推出PCIe 7.0 IP解決方案,加速HPC和AI等萬億參數領域的芯片設計》中,新思科技宣布推出綜合全面的PCIe Express Gen 7(PCIe 7.0)驗證IP(VIP)解決方案,以支持高性能計算設計中人工智能(AI)應用所需的高速度和低延遲。
2024-07-24 10:11:232230

思科技7月份行業事件

思科技宣布推出面向英特爾代工EMIB先進封裝技術的可量產多裸晶芯片設計參考流程,該流程采用了Synopsys.ai EDA全面解決方案和新思科IP。此外,新思科技3DSO.ai與新思科技3DIC
2024-08-12 09:50:301133

CoWoS產能將提升4倍

先進封裝解決方案的激增需求,正全力加速擴充其CoWoS(Chip-on-Wafer-on-Substrate)封裝產能。
2024-09-06 17:20:101356

思科技發布全球領先的40G UCIe IP,助力多芯片系統設計全面提速

思科技40G UCIe IP 全面解決方案為高性能人工智能數據中心芯片中的芯片到芯片連接提供全球領先的帶寬 摘要: 業界首個完整的 40G UCIe IP 全面解決方案,包括控制器、物理層和驗證
2024-09-10 13:45:37771

羅姆宣布全面委托代工GaN產品

近日,日本功率器件大廠羅姆半導體(ROHM)宣布了一項重要決策,將在GaN功率半導體領域加強與的合作。據悉,羅姆將全面委托代工生產GaN功率半導體器件,以水平分工的方式提升競爭力,對抗海外競爭對手。
2024-10-10 17:17:251189

思科推出超以太網與UALink IP解決方案

近日,全球領先的電子設計自動化(EDA)和半導體IP供應商新思科技(Synopsys, Inc.)宣布了一項重大技術創新——推出業界首款超以太網IP和UALink IP解決方案。這一創新旨在滿足
2024-12-25 11:12:451140

西門子與合作推動半導體設計與集成創新 包括N3P N3C A14技術

西門子和在現有 N3P 設計解決方案的基礎上,進一步推進針對臺 N3C 技術的工具認證。雙方同時就電新的 A14 技術的設計支持展開合作,為下一代設計奠定基礎。
2025-05-07 11:37:061415

思科技攜手公司開啟埃米級設計時代

思科技近日宣布持續深化與公司的合作,為公司的先進工藝和先進封裝技術提供可靠的EDAIP解決方案,加速AI芯片設計和多芯片設計創新。
2025-05-27 17:00:551040

思科技攜手是德科技推出AI驅動的射頻設計遷移流程

公司的模擬設計遷移(ADM)方法學為基礎,集成了新思科技AI驅動的射頻遷移解決方案與是德科技的射頻解決方案,可簡化無源器件和設計組件的重新設計工作,使其符合公司更先進的射頻工藝規則。
2025-06-27 17:36:151350

晟聯科受邀出席技術研討會,高速接口IP組合及解決方案助推海量數據暢行

6月25日,中國技術研討會在上海國際會議中心盛大召開。晟聯科作為IP聯盟成員受邀亮相Partner Pavilion 7號展臺,圍繞技術路線,重磅展示了覆蓋先進及成熟工藝節點的高速
2025-07-01 10:26:01474

思科技旗下Ansys仿真和分析解決方案產品組合已通過公司認證

思科技近日宣布,其旗下的Ansys仿真和分析解決方案產品組合已通過公司認證,支持對面向公司最先進制造工藝(包括公司N3C、N3P、N2P和A16)的芯片設計進行準確的最終驗證檢查。兩家
2025-10-21 10:11:05434

思科技斬獲2025年公司開放創新平臺年度合作伙伴大獎

涵蓋AI輔助設計解決方案EDA流程、射頻設計遷移、Multi-Die設計測試、接口IP以及硅光電子技術等多個領域,充分彰顯了雙方合作在塑造半導體設計未來過程中所發揮的關鍵作用。
2025-10-24 16:31:581125

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