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標(biāo)簽 > 芯粒
Chiplet的中文翻譯為芯粒或小芯片。基于Chiplet的設(shè)計(jì)方案,從設(shè)計(jì)時(shí)就按照不同的計(jì)算單元或功能單元對其進(jìn)行分解,系統(tǒng)中的不同組件在獨(dú)立的裸片上設(shè)計(jì)和實(shí)現(xiàn)。芯粒(chiplet)市場是先進(jìn)封裝領(lǐng)域備受關(guān)注的話題之一。而且業(yè)界多認(rèn)為技術(shù)問題會(huì)及時(shí)得到解決,例如芯粒裸片到裸片接口。
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近年來,芯粒設(shè)計(jì)與異質(zhì)集成封裝技術(shù)受到了行業(yè)內(nèi)的廣泛關(guān)注,F(xiàn)PGA(如賽靈思與臺(tái)積電合作的Virtex系列)、微處理器(如AMD的EPYC系列、英特爾的...
Cadence工具如何解決芯粒設(shè)計(jì)中的信號(hào)完整性挑戰(zhàn)
在芯粒設(shè)計(jì)中,維持良好的信號(hào)完整性是最關(guān)鍵的考量因素之一。隨著芯片制造商不斷突破性能與微型化的極限,確保組件間信號(hào)的純凈性與可靠性面臨著前所未有的巨大挑...
2025-12-26 標(biāo)簽:Cadence信號(hào)完整性芯粒 451 0
系統(tǒng)開發(fā)者在芯粒設(shè)計(jì)與集成過程中的考量因素
最新人工智能(AI)驅(qū)動(dòng)系統(tǒng)對算力和輸入輸出(IO)的需求,已遠(yuǎn)超工藝節(jié)點(diǎn)升級(jí)所能承載的范疇。若一味追求更大尺寸的芯片(逼近掩模版尺寸極限),會(huì)導(dǎo)致良率...
UCIe協(xié)議的工作原理和數(shù)據(jù)傳輸機(jī)制
過去幾十年,摩爾定律一直是半導(dǎo)體行業(yè)發(fā)展的核心驅(qū)動(dòng)力,芯片上晶體管數(shù)量每18-24個(gè)月翻倍,性能隨之大幅提升。但近年來這一定律明顯放緩,芯片制程向7nm...
一種集成FPGA和DSP芯粒的異構(gòu)系統(tǒng)級(jí)封裝
將多個(gè)異構(gòu)芯粒集成在一起進(jìn)行封裝是一種具有廣闊前景且成本效益高的策略,它能夠構(gòu)建出既靈活又可擴(kuò)展的系統(tǒng),并且能有效加速多樣化的工作負(fù)載。
面向高性能計(jì)算機(jī)、人工智能、無人系統(tǒng)對電子芯片高性能、高集成度的需求,以 2.5D、3D 集成技術(shù)為代表的先進(jìn)封裝集成技術(shù),不僅打破了當(dāng)前集成芯片良率降...
隨著信息技術(shù)的飛速發(fā)展,集成芯片和芯粒技術(shù)正在引領(lǐng)半導(dǎo)體領(lǐng)域的創(chuàng)新。集成芯片技術(shù)通過縮小元器件尺寸和提高集成度,實(shí)現(xiàn)了電子產(chǎn)品的微型化和高效能化。與此同...
2024-10-30 標(biāo)簽:半導(dǎo)體系統(tǒng)級(jí)封裝集成芯片 7.7k 0
如何利用精密編帶包裝載帶提高芯粒和 WLCSP 裝配產(chǎn)量
作者:Jeff Shepard 投稿人:DigiKey 北美編輯 EIA-481 和國際電工委員會(huì) (IEC) 60286-3 等行業(yè)標(biāo)準(zhǔn)規(guī)定,在一段 ...
數(shù)據(jù)中心CPU芯粒化及互聯(lián)方案分析-PART2
隨著核心數(shù)量的增長和多die模式的流行,過去幾年中,各大計(jì)算芯片企業(yè)逐漸從Multi-Die模式轉(zhuǎn)向Central IO Die模式。以 IO Die ...
2023-12-20 標(biāo)簽:cpu數(shù)據(jù)中心chiplet 3.9k 0
數(shù)據(jù)中心處理器采用Chiplet有何優(yōu)勢?
生成式人工智能和大模型的驅(qū)動(dòng)下,我們正置身于一個(gè)算力領(lǐng)域千載難逢的拐點(diǎn):一個(gè)類似于個(gè)人電腦、互聯(lián)網(wǎng)、移動(dòng)設(shè)備和云誕生的時(shí)刻。
奇異摩爾聯(lián)合成立智算互聯(lián)芯粒實(shí)驗(yàn)室
2026年4月2日,ODCC春季全體會(huì)議在浙江舟山成功召開。中國信通院云大所總工程師郭亮,ODCC網(wǎng)絡(luò)工作組組長、騰訊基礎(chǔ)網(wǎng)絡(luò)中心總監(jiān)何澤坤、奇異摩爾聯(lián)...
2026-04-07 標(biāo)簽:FPGA實(shí)驗(yàn)室奇異摩爾 115 0
新思科技EDA工具和車規(guī)IP助力芯粒架構(gòu)汽車SoC設(shè)計(jì)
汽車行業(yè)正在經(jīng)歷重大變革,這一變革由軟件工作負(fù)載的日益復(fù)雜以及嚴(yán)格的功耗和安全標(biāo)準(zhǔn)推動(dòng)。隨著車輛變得更加互聯(lián)和自動(dòng)化,系統(tǒng)級(jí)芯片(SoC)解決方案的架構(gòu)...
奇異摩爾ODCC 2026超節(jié)點(diǎn)大會(huì)精彩回顧
北京-1月22日,由ODCC(開放數(shù)據(jù)中心委員會(huì))主辦的2026超節(jié)點(diǎn)大會(huì)在北京順利舉辦。本次大會(huì)圍繞超節(jié)點(diǎn)部件、超節(jié)點(diǎn)協(xié)議、超節(jié)點(diǎn)管理、超節(jié)點(diǎn)應(yīng)用四大...
2026-01-24 標(biāo)簽:數(shù)據(jù)中心奇異摩爾芯粒 2k 0
Arm解析未來芯片行業(yè)創(chuàng)新技術(shù)發(fā)展趨勢
全球計(jì)算技術(shù)的格局正在發(fā)生深刻變革 —— 計(jì)算模式正從集中式云架構(gòu),向覆蓋各類設(shè)備、終端及系統(tǒng)的分布式智能架構(gòu)演進(jìn)。2026 年是智能計(jì)算新紀(jì)元。計(jì)算將...
隨著摩爾定律放緩與AI算力需求的爆發(fā)式增長,傳統(tǒng)芯片設(shè)計(jì)模式正面臨研發(fā)成本高昂、能耗巨大、迭代周期長的多重壓力。在此背景下,Chiplet(芯粒)技術(shù)成...
在軟件定義汽車 (SDV) 的帶動(dòng)下,汽車行業(yè)迎來深層次轉(zhuǎn)型。隨著汽車愈發(fā)趨于由人工智能 (AI) 定義,底層汽車系統(tǒng)對計(jì)算性能、能效及設(shè)計(jì)靈活性提出了...
UCIe協(xié)議代際躍遷驅(qū)動(dòng)開放芯粒生態(tài)構(gòu)建
在芯片技術(shù)從 “做大單片” (單片SoC)向 “小芯片組合” (芯粒式設(shè)計(jì))轉(zhuǎn)型的當(dāng)下,一套統(tǒng)一的互聯(lián)標(biāo)準(zhǔn)變得至關(guān)重要。UCIe協(xié)議便是一套芯粒芯片互聯(lián)...
新思科技以AI驅(qū)動(dòng)EDA加速M(fèi)ulti-Die創(chuàng)新
Multi-Die設(shè)計(jì)將多個(gè)異構(gòu)或同構(gòu)裸片無縫集成在同一封裝中,大幅提升了芯片的性能和能效,因而在高性能計(jì)算(HPC)、人工智能(AI)、數(shù)據(jù)分析、先進(jìn)...
半導(dǎo)體領(lǐng)域正經(jīng)歷快速變革,尤其是在人工智能(AI)爆發(fā)式增長、對更高處理性能及能效需求持續(xù)攀升的背景下。傳統(tǒng)的片上系統(tǒng)(SoC)設(shè)計(jì)方案在尺寸與成本方面...
在我們近期與業(yè)界伙伴的多次交流中,明顯發(fā)現(xiàn)芯粒時(shí)代的大幕已徐徐拉開,行業(yè)已經(jīng)不再抱存對芯粒的質(zhì)疑態(tài)度,而是正在合作解決如何借助芯粒技術(shù),在集成電路的生態(tài)...
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