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JESD204B是一種新型的基于高速SERDES的ADC/DAC數據傳輸接口。JESD204和JESD204B修訂版數據轉換器串行接口標準由JEDEC委員會制定,旨在標準化并減少高速數據轉換器與FPGA(現場可編程門陣列)等其它器件之間的數據輸入/輸出數目。
JESD204B是一種新型的基于高速SERDES的ADC/DAC數據傳輸接口。JESD204和JESD204B修訂版數據轉換器串行接口標準由JEDEC委員會制定,旨在標準化并減少高速數據轉換器與FPGA(現場可編程門陣列)等其它器件之間的數據輸入/輸出數目。更少的互連可簡化布局布線,并支持實現更小尺寸的解決方案,同時不影響整體系統性能。這些特性對于克服許多高速ADC應用的系統尺寸和成本限制非常重要,包括無線基礎設施(GSM、EDGE、W-CDMA、LTE、CDMA2000、WiMAX、TD-SCDMA)、收發器架構、軟件定義無線電、便攜式儀器儀表、醫療超聲設備、雷達和安全通信等軍用/航空應用。
ADC/DAC的采樣速率變得越來越高,數據的吞吐量越來越大,對于500MSPS以上的ADC/DAC,動輒就是幾十個G的數據吞吐率,采用傳統的CMOS和LVDS已經很難滿足設計要求,JESD204B應運而生。現在各大廠商的高速ADC/DAC上基本都采用了這種接口。
隨著數模轉換器的轉換速率越來越高,JESD204B 串行接口已經越來越多地廣泛用在數模轉換器上,其對器件時鐘和同步時鐘之間的時序關系有著嚴格需求。本文就...
在從事高速數據擷取設計時使用FPGA的人大概都聽過新JEDEC標準「JESD204B」的名號。近期許多工程師均聯絡德州儀器,希望進一步了解 JESD20...
基于FPGA連接的JESD204B高速串行鏈路設計需要考慮的基本硬件及時序問題詳解
與賽靈思FPGA連接的數據轉換器正迅速采用全新JESD204B高速串行鏈路。要使用該接口格式及協議,設計必須考慮一些基本硬件及時序問題。
JESD204B子類(第二部分):子類1與子類2系統考慮因素
在“JESD204B子類(第一部分):JESD204B子類簡介與確定性延遲”一文中,我們總結了JESD204B子類和確定性延遲,并給出了子類0系統中多芯...
2019-04-15 標簽:JESD204B 5.9k 0
作者:Del Jones 許多行業的數據密集型應用持續突破界限,需要快速高效地傳輸有效載荷數據。5G通信網絡系統要求基礎設施及其連接器件具有更大帶寬。在...
JESD204B輸出ADC的多通道低抖動GHz時鐘解決方案分析
隨著使用多模數轉換器(ADC)的高速信號采集應用的復雜性提高,每個轉換器互補時鐘解決方案將決定動態范圍和系統的潛在能力。隨著新興每秒一千兆樣本(GSPS...
如何在Xilinx FPGA上快速實現JESD204B?操作步驟詳細說明
JESD204是一種連接數據轉換器(ADC和DAC)和邏輯器件的高速串行接口,該標準的 B 修訂版支持高達 12.5 Gbps串行數據速率,并可確保 J...
2017-11-17 標簽:jesd204bxilinxfpga 7.3k 0
TI推出基于KeyStone的高集成度66AK2L06片上系統解決方案
2015年4月22日,北京訊。在要求高速數據生成和采集的市場中,性能是關鍵。為了讓模數轉換器 (ADC)、數模轉換器 (DAC) 以及模擬前端 (AFE...
JESD204B與LVDS接口并行 管線式ADC延遲問題分析及解答
JESD204B為業界標準序列通信鏈接,數據轉換器與現場可編程門陣列(FPGA)、數字信號處理器(DSP)、特定應用集成電路(ASIC)等裝置間的數字數...
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