AXI4

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axi4技術(shù)

本章的實(shí)驗(yàn)任務(wù)是在 PL 端自定義一個(gè) AXI4 接口的 IP 核，通過(guò) AXI_HP 接口對(duì) PS 端 DDR3 進(jìn)行讀寫(xiě)測(cè)試，讀寫(xiě)的內(nèi)存大小是 4K 字節(jié)。

2025-11-24 標(biāo)簽：接口 DDR 內(nèi)存 3.8k 0

AMBA AXI4接口協(xié)議概述

AMBA AXI4（高級(jí)可擴(kuò)展接口 4）是 ARM 推出的第四代 AMBA 接口規(guī)范。AMD Vivado Design Suite 2014 和 IS...

2024-10-28 標(biāo)簽：FPGA 嵌入式接口協(xié)議 1.7k 0

漫談AMBA總線(xiàn)-AXI4協(xié)議的基本介紹

本文主要集中在AMBA協(xié)議中的AXI4協(xié)議。之所以選擇AXI4作為講解，是因?yàn)檫@個(gè)協(xié)議在SoC、IC設(shè)計(jì)中應(yīng)用比較廣泛。

2024-01-17 標(biāo)簽：數(shù)據(jù)傳輸總線(xiàn)AMBA 4.5k 0

FPGA AXI4協(xié)議學(xué)習(xí)筆記(三)

上文FPGA IP之AXI4協(xié)議1_信號(hào)說(shuō)明把AXI協(xié)議5個(gè)通道的接口信息做了說(shuō)明，本文對(duì)上文說(shuō)的信號(hào)進(jìn)行詳細(xì)說(shuō)明。

2023-05-24 標(biāo)簽：fpga 控制器接口 2.3k 0

FPGA AXI4協(xié)議學(xué)習(xí)筆記(二)

上文FPGA IP之AXI4協(xié)議1_協(xié)議構(gòu)架對(duì)協(xié)議框架進(jìn)行了說(shuō)明，本文對(duì)AXI4接口的信號(hào)進(jìn)行說(shuō)明。

2023-05-24 標(biāo)簽：FPGA 接口信號(hào) 3k 0

使用AXI4總線(xiàn)實(shí)現(xiàn)視頻輸入輸出

Xilinx vivado下通常的視頻流設(shè)計(jì)，都采用Vid In to axi4 stream --> VDMA write --> MM ...

2022-10-11 標(biāo)簽：視頻 Xilinx AXI4 7.8k 0

使用AXI4-Lite將Vitis HLS創(chuàng)建的IP連接到PS

在 AXI 基礎(chǔ)第 6 講 - Vitis HLS 中的 AXI4-Lite 簡(jiǎn)介中，使用 C 語(yǔ)言在 HLS 中創(chuàng)建包含 AXI4-Lite 接口的 ...

2022-08-02 標(biāo)簽：AXI4 Vivado Vitis 1.4k 0

如何在Vitis HLS中使用C語(yǔ)言代碼創(chuàng)建AXI4-Lite接口

您是否想創(chuàng)建自己帶有 AXI4-Lite 接口的 IP 卻感覺(jué)無(wú)從著手？本文將為您講解有關(guān)如何在 Vitis HLS 中使用 C 語(yǔ)言代碼創(chuàng)建 AXI4...

2022-07-08 標(biāo)簽：接口 C語(yǔ)言 AXI4 3k 0

如何使用AXI VIP在AXI4(Full)主接口中執(zhí)行驗(yàn)證和查找錯(cuò)誤

在 AXI 基礎(chǔ)第 2 講一文中，曾提到賽靈思 Verification IP (AXI VIP) 可用作為 AXI 協(xié)議檢查工具。在本次第4講中，我...

2022-07-08 標(biāo)簽：接口賽靈思 AXI 4.5k 0

Zynq中AXI4-Lite和AXI-Stream功能介紹

Zynq中AXI4-Lite功能 AXI4-Lite接口是AXI4的子集，專(zhuān)用于和元器件內(nèi)的控制寄存器進(jìn)行通信。AXI-Lite允許構(gòu)建簡(jiǎn)單的元件接口。...

2020-09-27 標(biāo)簽：Zynq AXI AXI4 1.0萬(wàn) 0

axi4帖子

RDMA設(shè)計(jì)36：驗(yàn)證環(huán)境設(shè)計(jì)

標(biāo)簽：RDMA AXI4 DUT 901 0

RDMA over RoCE V2設(shè)計(jì)2：ip 整體框架設(shè)計(jì)考慮

標(biāo)簽：FPGA RDMA AXI4 1403 0

RDMA over RoCE V2設(shè)計(jì)1：通用，穩(wěn)定及高性能！

標(biāo)簽：FPGA CMAC AXI4 1292 0

RDMA簡(jiǎn)介9之AXI 總線(xiàn)協(xié)議分析2

標(biāo)簽：FPGA RDMA AXI4 992 0

RDMA簡(jiǎn)介8之AXI 總線(xiàn)協(xié)議分析1

標(biāo)簽：FPGA RDMA AXI4 997 0

NVMe IP之AXI4總線(xiàn)分析

標(biāo)簽：FPGA AXI4 nvme 6148 0

提供NVMe AXI4主機(jī)控制器IP，AMBA-AXI4接口直接訪(fǎng)問(wèn)內(nèi)存

標(biāo)簽：dma AXI4 nvme 15826 2

SoC Designer AXI4協(xié)議包的用戶(hù)指南

標(biāo)簽：soc Designer AXI4 725 0

從零開(kāi)始學(xué)習(xí)紫光同創(chuàng)FPGA——PGL22G開(kāi)發(fā)板之DDR3 IP簡(jiǎn)單讀寫(xiě)測(cè)試（六）

標(biāo)簽：DDR3 AXI4 debugger 3649 0

看SpinalHDL軟硬件結(jié)合的極致

標(biāo)簽：AXI4 2296 0

axi4資料下載

wp379 AXI4即插即用IP立即下載

類(lèi)別：FPGA/ASIC 2012-03-07 標(biāo)簽：wp379 AXI4 1.1k 0

axi4資訊

Xilinx NVMe AXI4主機(jī)控制器，AXI4接口高性能版本介紹

NVMe AXI4 Host Controller IP可以連接高速存儲(chǔ)PCIe SSD，無(wú)需CPU，自動(dòng)加速處理所有的NVMe協(xié)議命令，具備獨(dú)立的數(shù)據(jù)...

2024-07-18 標(biāo)簽：pcie 主機(jī)控制器 AXI4 1.6k 0

AXI4-FULL總線(xiàn)多通道數(shù)據(jù)傳輸，合并生成一組數(shù)據(jù)的討論

對(duì)于AXI4-FULL總線(xiàn)時(shí)，握手信號(hào)共有5路，包括寫(xiě)地址，寫(xiě)數(shù)據(jù)，寫(xiě)應(yīng)答，讀地址，讀數(shù)據(jù)。當(dāng)主機(jī)burst寫(xiě)時(shí)，每發(fā)起一次猝發(fā)交易，需要有一筆應(yīng)答對(duì)應(yīng)。

2022-02-16 標(biāo)簽：數(shù)據(jù)總線(xiàn)AXI4 2k 0

AXI4交換機(jī)制是什么

設(shè)備之間的互聯(lián)，與其他具有對(duì)稱(chēng)的主端口和從端口設(shè)備一樣，可以連接真正的主設(shè)備和從設(shè)備。

2020-09-24 標(biāo)簽：AXI4 AXI4總線(xiàn) 3.2k 0

axi4數(shù)據(jù)手冊(cè)

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

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識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線(xiàn)束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線(xiàn)協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線(xiàn)。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪(fǎng)問(wèn)和亂序訪(fǎng)問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線(xiàn)傳輸中的概念。特性阻抗是射頻傳輸線(xiàn)影響無(wú)線(xiàn)電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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