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LMK04208是一款高性能時鐘調節器，具有卓越的時鐘抖動清除功能，生成和分發具有高級功能，以滿足下一代系統要求。雙環路PLLatinum?架構能夠使用低噪聲VCXO模塊的RMS抖動（12 kHz至20 MHz）為111 fs，或低于200 fs rms抖動（12 kHz 至 20 MHz），使用低成本外部晶體和變容二極管。
*附件：lmk04208.pdf

雙環架構由兩個高性能鎖相環（PLL）組成，一個低噪聲晶體振蕩器電路和高性能壓控振蕩器（VCO）。第一個PLL（PLL1）提供低噪聲抖動清除器功能，而第二個PLL（PLL2）執行時鐘生成。PLL1 可以配置為與外部 VCXO 模塊配合使用或帶有外部可調諧晶體和變容二極管的集成晶體振蕩器。什么時候 PLL1 與非常窄的環路帶寬配對，使用卓越的近相位噪聲（失調低于 50 kHz）或可調諧晶體，以清潔輸入時鐘。的輸出 PLL1用作PLL2的干凈輸入基準電壓源，鎖定集成VCO。循環可以優化 PLL2 的帶寬，以清除遠相位噪聲（偏移高于 50 kHz），其中集成VCO的性能優于PLL1中使用的VCXO模塊或可調諧晶體。

特性

超低RMS抖動性能
- 111 fs，RMS 抖動（12 kHz 至 20 MHz）
- 123 fs，RMS 抖動（100 Hz 至 20 MHz）
雙環路PLLatinum? PLL架構
PLL1
- 集成低噪聲晶體振蕩器電路
- 輸入時鐘丟失時的保持模式
  - 自動或手動觸發/恢復
PLL2
- 歸一化PLL本底噪聲為–227 dBc/Hz
- 相位檢測器速率高達 155 MHz
- OSCin 倍頻器
- 集成低噪聲VCO或外部VCO模式
兩個帶LOS的冗余輸入時鐘
- 自動和手動切換模式
50 % 占空比輸出分頻，1 至 1045（偶數和奇數）
6 個 LVPECL、LVDS 或 LVCMOS 可編程輸出
數字延遲：固定或動態可調
25 ps 步進模擬延遲控制
7 個差分輸出，多達 14 個單端
- 多達6個VCXO/晶體緩沖輸出
時鐘速率高達 1536 MHz
0-延遲模式
上電時三個默認時鐘輸出
多模：雙 PLL、單 PLL 和時鐘分配
工業溫度范圍：–40°C 至 +85°C
3.15V 至 3.45V 工作電壓
64引腳WQFN封裝（9.0 × 9.0 × 0.8 mm）

參數

方框圖

?1. 產品概述?
LMK04208是德州儀器（TI）推出的高性能雙鎖相環（PLL）時鐘抖動清除器，專為低噪聲時鐘生成、清理和分配設計。其核心特性包括：

?超低RMS抖動?：111 fs（12 kHz–20 MHz帶寬）和123 fs（100 Hz–20 MHz帶寬）。
?雙PLL架構?（PLLatinum?）：
- ?PLL1?：集成低噪聲晶體振蕩器電路，支持保持模式（Holdover）和手動/自動切換。
- ?PLL2?：支持高達155 MHz的相位檢測速率，集成低噪聲VCO或外部VCO模式。
?靈活輸出?：6個可編程輸出（LVPECL/LVDS/LVCMOS），支持數字/模擬延遲控制。
?應用領域?：無線基礎設施、數據轉換器時鐘、網絡設備（SONET/SDH）、醫療/軍事設備等。