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德州儀器CDCE6214Q1TM超低功耗時鐘發生器技術解析

科技觀察員 ? 2025-08-18 14:12 ? 次閱讀
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Texas Instruments CDCE6214Q1TM超低功耗時鐘發生器是是一款適合汽車應用的4通道、中級抖動時鐘發生器,可生成五個獨立時鐘輸出。這些輸出在各種驅動器模式之間可選。輸入源可以是單端或差分輸入時鐘源,也可以是晶體。CDCE6214Q1TM具有一個分數N PLL,可在任何輸入頻率下合成不相關的基礎頻率。

數據手冊:*附件:Texas Instruments CDCE6214Q1TM超低功耗時鐘發生器數據手冊.pdf

特性

  • 符合汽車應用類AEC-Q100標準
    • 溫度等級2(–40°C至+105°C)
  • 支持功能安全
    • 來輔助功能安全系統設計的文檔
  • 可配置的高性能、低功耗、frac-N PLL,具有帶雜散(12kHz至20MHz,FOUT>100MHz)的RMS抖動:
    • 整數模式
      • 最大差分輸出:典型值350fs,最大值600fs
      • LVCMOS 輸出:典型值1.05ps,最大值1.5ps
    • 分數模式
      • 差分輸出:典型值1.7ps,最大值2.1ps
      • LVCMOS輸出:典型值2.0ps,最大值4.0ps
  • 支持PCIe Gen1/2/3/4(有SSC)和Gen 1/2/3/4/5(無SSC)
  • 2.335GHz至2.625GHz內部VCO
  • 典型功耗:4輸出通道為65mA,單輸出通道為23mA。
  • 通用時鐘輸入,兩個用于冗余的參考輸入
    • 差分交流耦合或LVCMOS:10MHz至200MHz
    • 晶振:10MHz至50MHz
  • 靈活的輸出時鐘分配
    • 四通道分頻器,具有多達五個獨特輸出頻率,范圍為24kHz至328.125MHz
    • OUT0 – OUT4引腳具有類似LVDS、LP-HCSL或LVCMOS輸出
    • 無中斷輸出分頻器開關和輸出通道同步
    • 通過低電平有效GPIO和寄存器實現獨立輸出使能
  • 頻率裕量選擇
    • DCO模式:頻率以10ppb或更小的階躍幅度遞增/遞減
  • 完全集成、可配置的環路帶寬:100kHz至1.6MHz
  • 電源或混合電源可進行電平轉換:1.8V、2.5V、3.3V
  • 可配置的GPIO和靈活的配置選項
    • 兼容I^2^C的接口,高達400kHz
    • 具有兩個頁面和外部選擇引腳的集成EEPROM,可現場編程
  • 支持100Ω系統
  • 低電磁輻射
  • 小尺寸:24引腳 VQFN (4mm × 4mm)

功能框圖

1.png

德州儀器CDCE6214Q1TM超低功耗時鐘發生器技術解析

一、產品核心特性

CDCE6214Q1TM是德州儀器推出的汽車級超低功耗時鐘發生器,具有以下突出特性:

?1. 高性能時鐘生成?

  • 集成frac-N PLL,支持整數/分數模式
  • VCO頻率范圍:2.335GHz至2.625GHz
  • 支持PCIe Gen1-5時鐘生成(帶/不帶SSC)

?2. 多模式輸出?

  • 4個差分輸出通道(OUT1-OUT4)
  • 1個LVCMOS輸出(OUT0)
  • 支持LVDS、LP-HCSL和LVCMOS輸出格式

?3. 超低功耗設計?

  • 4通道輸出典型功耗65mA
  • 單通道輸出典型功耗23mA
  • 0.6μA超低關斷電流

?4. 汽車級可靠性?

  • AEC-Q100 Grade 2認證(-40℃至+105℃)
  • 24引腳VQFN封裝(4×4mm)

二、關鍵參數對比

參數條件典型值單位
?抖動性能?差分輸出,整數模式350fsRMS
?輸出頻率范圍?差分輸出24kHz-328.125MHz-
?輸入頻率范圍?晶體模式10-50MHz-
?電源電壓?核心/輸出1.8/2.5/3.3V-
?工作溫度?全范圍-40至+105

三、典型應用設計

1. PCIe時鐘生成方案

?配置要點?:

  • 使用25MHz晶體輸入
  • 配置為100MHz LP-HCSL輸出
  • 啟用0.5%下行擴頻(SSC)
  • 寄存器配置:
    • PLL_NDIV = 96
    • PSA = 4, IOD = 6
    • SSC_SEL = 3h(25MHz PFD,-0.5%下行擴頻)

?實測性能?:

  • RMS相位抖動:475fs(12kHz-20MHz)
  • 滿足PCIe Gen3規范要求

2. 汽車信息娛樂系統時鐘樹

?設計優勢?:

  • 單一器件生成多路時鐘:
    • 24.576MHz音頻時鐘(LVCMOS)
    • 100MHz處理器時鐘(LVDS)
    • 148.5MHz顯示時鐘(LP-HCSL)
  • 支持頻率微調(DCO模式,步進≤0.1ppm)

四、設計要點

1. 電源設計建議

  • ?去耦方案?:
    • 每電源引腳配置:
      • 4.7μF陶瓷電容(X7R)
      • 470nF陶瓷電容
      • 100nF陶瓷電容
  • ?布局要點?:
    • 電源走線寬度≥0.2mm
    • 使用多個過孔連接電源平面

2. 熱設計指南

  • 熱阻參數:
    • θJA = 32.5°C/W
    • θJC = 12.2°C/W
  • 推薦措施:
    • 使用2oz銅厚PCB
    • DAP焊盤配置12個φ0.3mm散熱過孔
    • 頂層銅箔面積≥15mm2
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