CML輸出驅動器

　　轉換器數字輸出接口的最新趨勢是使用具有電流模式邏輯（CML）輸出驅動器的串行接口。通常，高分辨率（≥14位）、高速（≥200 Msps）和需要小型封裝與低功耗的轉換器會使用這些類型的驅動器。CML輸出驅動器用在JESD204接口，這種接口目前用于最新轉換器。

　　采用具有JESD204接口的CML驅動器后，轉換器輸出端的數據速率可達12Gbps（當前版本JESD204B規格）。此外，需要的輸出引腳數也會大幅減少。時鐘內置于8b/10b編碼數據流，因此無需傳輸獨立時鐘信號。

　　數據輸出引腳數量也得以減少，最少只需兩個。由于轉換器的分辨率、速度和通道數增加，數據輸出引腳的數量可調整到適應所需的更高吞吐量。但是，由于CML驅動器采用的接口通常為串行接口，引腳數的增加與CMOS或LVDS相比要小得多。（CMOS或LVDS中傳輸的數據為并行數據，需要的引腳數多得多。）

　　表1所示為采用80Msps轉換器的三種不同接口，轉換器具有各種通道數和位分辨率。在CMOS和LVDS輸出中，數據用作每個通道數據的同步時鐘，使用CML輸出時，JESD204數據傳輸的最大數據速率為3.2Gbps。察看該表可以發現，CML的優勢十分明顯，引腳數大大較少。

　　表1：引腳數比較 - 80Msps ADC

　　CML驅動器用于串行數據接口，因此，所需引腳數要少得多。圖3所示為用于具有JESD204接口或類似數據輸出的轉換器的典型CML驅動器。該圖顯示了CML驅動器典型架構的一般情況。圖中顯示了可選源端接電阻和共模電壓。電路的輸入可將開關驅動至電流源，電流源則將適當的邏輯值驅動至兩個輸出端。

　　圖3：典型CML輸出驅動器

　　CML驅動器類似于LVDS驅動器，以恒定電流模式工作。這也使得CML驅動器在功耗方面具備一定優勢。在恒定電流模式下工作需要較少的輸出引腳，總功耗會降低。

　　和LVDS一樣，CML也需要負載端接、單端阻抗為50？的受控阻抗傳輸線路，以及100？的差分阻抗。驅動器本身也可能具有如圖3所示的端接，對因高帶寬信號靈敏度引起的信號反射有所幫助。

　　對符合JESD204標準的轉換器而言，差分和共模電平均存在不同規格，具體取決于工作速度。工作速度高達6.375Gbps，差分電平標稱值為800mV，共模電平約為1.0V。

　　在高于6.375Gbps且低于12.5Gbps的速度下工作時，差分電平額定值為400mV，共模電平仍約為1.0V。隨著轉換器速度和分辨率增加，CML輸出需要合適類型的驅動器提供必要速度，以滿足各種應用中轉換器的技術需求。