verilog

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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

verilog是什么_verilog的用途和特征是什么

本文首先介紹了verilog的概念和發(fā)展歷史，其次介紹了verilog的特征與Verilog的邏輯門級(jí)描述，最后介紹了Verilog晶體管級(jí)描述與ver...

2018-05-14 標(biāo)簽：verilog HDL 描述語(yǔ)言 4.7萬(wàn) 0

通過(guò)砷化鎵制程的PN結(jié)測(cè)量建模可以得出VerilogA模型的正確性和通用性

本文中論述的是二極管的小信號(hào)模型，適用于半導(dǎo)體材料組成的PN結(jié)以及金屬半導(dǎo)體組成的肖特基PN結(jié)。另外，論述的二極管的模型參數(shù)適用于GaAs HBT制程的...

2018-04-22 標(biāo)簽：Verilog 建模砷化鎵 7.1k 0

PS2鍵盤編碼Verilog源程序分享

之前探討過(guò)PS/2鍵盤編解碼以及數(shù)據(jù)傳輸協(xié)議，這次自己動(dòng)手實(shí)現(xiàn)了利用FPGA接收鍵盤編碼，然后通過(guò)串口傳輸?shù)絇C。做的比較簡(jiǎn)單，只是通過(guò)FPGA把大寫字...

2018-07-15 標(biāo)簽：Verilog 源程序 PS2鍵盤 6.4k 0

Verilog和SystemVerilog定義了4種描述信號(hào)狀態(tài)

在實(shí)際設(shè)計(jì)中有一種情況可能會(huì)產(chǎn)生這種問(wèn)題：cond信號(hào)來(lái)自于memory。比如漢明碼SECDED（single error correction do...

2018-03-29 標(biāo)簽：寄存器 Verilog 1.6萬(wàn) 0

關(guān)于verilog的學(xué)習(xí)經(jīng)驗(yàn)簡(jiǎn)單分享

學(xué)習(xí)verilog最重要的不是語(yǔ)法，“因?yàn)?0%的語(yǔ)法就能完成90%的工作”，verilog語(yǔ)言常用語(yǔ)言就是always@（），if~else，case...

2018-03-26 標(biāo)簽：verilog 3.2k 0

vhdl和verilog的區(qū)別_vhdl和verilog哪個(gè)好？

VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language，誕生于19...

2018-03-23 標(biāo)簽：verilog vhdl 12.5萬(wàn) 0

verilog編譯指令_verilog編譯器指示語(yǔ)句（數(shù)字IC）

以`（反引號(hào)）開(kāi)始的某些標(biāo)識(shí)符是編譯器指令。在Verilog 語(yǔ)言編譯時(shí)，特定的編譯器指令在整個(gè)編譯過(guò)程中有效（編譯過(guò)程可跨越多個(gè)文件），直到遇到其它的...

2018-03-23 標(biāo)簽：verilog 編譯器 verilog語(yǔ)言 1.7萬(wàn) 0

verilog語(yǔ)言基本語(yǔ)句_verilog語(yǔ)言詞匯大全

Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為...

2018-03-23 標(biāo)簽：verilog verilog語(yǔ)言 9.7萬(wàn) 1

Verilog generate語(yǔ)句的類型

Generate 結(jié)構(gòu)在創(chuàng)建可配置的RTL的時(shí)候很有用。Generate loop能夠讓語(yǔ)句實(shí)例化多次，通過(guò)index來(lái)控制。而conditio...

2018-03-16 標(biāo)簽：Verilog 2.3萬(wàn) 0

關(guān)于Verilog語(yǔ)言標(biāo)準(zhǔn)層次問(wèn)題

關(guān)于Verilog語(yǔ)言的官方標(biāo)準(zhǔn)全稱是《IEEE Std 1364-2001：IEEE Standard Verilog? Hardware Descr...

2018-07-06 標(biāo)簽：verilog 編程語(yǔ)言 5.4k 0

Verilog實(shí)現(xiàn)74LS194芯片設(shè)計(jì)程序

Verilog作為一種種硬件描述語(yǔ)言目前已經(jīng)得到了普遍運(yùn)用。本文主要介紹了Verilog特點(diǎn)、Verilog用途以及Verilog實(shí)現(xiàn)74LS194芯片...

2017-12-22 標(biāo)簽：Verilog 74LS194 7.3k 0

Verilog/VHDL語(yǔ)法學(xué)習(xí)是掌握基本代碼設(shè)計(jì)的技能以及經(jīng)驗(yàn)總結(jié)

無(wú)論是VHDL還是Verilog，建議初學(xué)者先掌握其中一門。

2017-12-19 標(biāo)簽：fpga verilog vhdl 7.9k 0

d觸發(fā)器verilog描述

觸發(fā)器是一個(gè)具有記憶功能的，具有兩個(gè)穩(wěn)定狀態(tài)的信息存儲(chǔ)器件，是構(gòu)成多種時(shí)序電路的最基本邏輯單元，也是數(shù)字邏輯電路中一種重要的單元電路。在數(shù)字系統(tǒng)和計(jì)算機(jī)...

2017-12-12 標(biāo)簽：verilog d觸發(fā)器 8.3k 0

verilog實(shí)現(xiàn)定時(shí)器函數(shù)

使用Verilog描述硬件的基本設(shè)計(jì)單元是模塊（module）。構(gòu)建復(fù)雜的電子電路，主要是通過(guò)模塊的相互連接調(diào)用來(lái)實(shí)現(xiàn)的。模塊被包含在關(guān)鍵字module...

2017-12-08 標(biāo)簽：verilog c語(yǔ)言 1.2萬(wàn) 0

基于Verilog的PS/2接口控制程序

通過(guò)Verilog編程實(shí)現(xiàn)在紅色颶風(fēng)II代Xilinx開(kāi)發(fā)板上面實(shí)現(xiàn)對(duì)鍵盤、LCD、RS-232等接口或者器件進(jìn)行控制，將有鍵盤輸入的數(shù)據(jù)在LCD上面顯...

2017-11-22 標(biāo)簽：verilog rs232 3.6k 0

通過(guò)編寫verilog代碼實(shí)現(xiàn)OLED驅(qū)動(dòng)和內(nèi)容顯示的解決方案

本實(shí)驗(yàn)通過(guò)verilog代碼的編寫，在EGO1開(kāi)發(fā)板上實(shí)現(xiàn)OLED的驅(qū)動(dòng)和內(nèi)容顯示。

2017-11-11 標(biāo)簽：OLED Verilog OLED驅(qū)動(dòng) 2.0萬(wàn) 1

改變數(shù)字硬件設(shè)計(jì)，實(shí)現(xiàn)真正工程化

與VHDL和Verilog一樣，SpinalHDL可用于通過(guò)定義寄存器和門來(lái)描述硬件，SpinalHDL不使用眾所周知的事件驅(qū)動(dòng)范式來(lái)描述硬件（如VHD...

2017-08-10 標(biāo)簽：verilog 數(shù)字電路智能硬件 4.7k 3

基于Verilog FPGA 流水燈設(shè)計(jì)

流水廣告燈主要應(yīng)用于LED燈光控制。通過(guò)程序控制LED的亮和滅，多個(gè)LED燈組成一個(gè)陣列，依次逐個(gè)點(diǎn)亮的時(shí)候像流水一樣，所以叫流水燈。由于其形成美觀大...

2017-08-09 標(biāo)簽：fpga verilog 流水燈 1.8萬(wàn) 0

Verilog的語(yǔ)言要素

本章介紹Verilog HDL的基本要素，包括標(biāo)識(shí)符、注釋、數(shù)值、編譯程序指令、系統(tǒng)任務(wù)和系統(tǒng)函數(shù)。另外，本章還介紹了Verilog硬件描述語(yǔ)言中的兩種...

2017-02-11 標(biāo)簽：FPGA Verilog 2.4k 0

Verilog HDL簡(jiǎn)明教程(2)

模塊是Verilog 的基本描述單位，用于描述某個(gè)設(shè)計(jì)的功能或結(jié)構(gòu)及其與其他模塊通信的外部端口。

2017-02-11 標(biāo)簽：Verilog HDL 1.5k 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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