設計的基礎上給出了SDRAM控制器的實現原理以及詳細的子模塊劃分。整個控制器的設計已用Verilog HDL語言實現并通過了Modelsim仿真和FPGA驗證。仿真結果表明所設計的控制器符合SDRAM內部
2014-01-02 13:59:42
5141 
本文提出了基于控制器局部網 CAN（Controller Area Network）總線數字模塊化三軸磁場監測系統的概念，研究了大型電機狀態監測系統架構設計，并重點設計與實現了傳感網絡節點模塊，以及 CAN總線上層協議的軟件設計，提高數據采集與傳輸的可靠性。
2020-12-18 10:23:236199 
CAN總線控制器Verilog代碼
2012-08-10 18:49:46
嵌入式開發Verilog教程（二）——Verilog HDL設計方法概述前言一、Verilog HDL語言簡介1.1 Verilog HDL語言是什么1.2前言在數字邏輯設計領域，迫切需要一種共同
2021-11-08 09:30:31
Verilog HDL語言有什么優越性Verilog HDL語言在FPGA/CPLD開發中的應用
2021-04-23 07:02:03
關鍵字：Altera 、FPGA、軟硬件協調設計（Verilog & C）、CPU、總線、外設FPGA硬件結構知識Verilog HDL語言編程基礎FPGA常用開發工具 SOPC硬件系統開發SOPC軟件系統開發Avalon總線規范Nios II外設及其編程 七段數碼管時鐘...
2021-12-22 08:06:06
的具體控制和運行。Verilog HDL語言不僅定義了語法，而且對每個語法結構都定義了清晰的模擬、仿真語義。因此，用這種語言編寫的模型能夠使用 Ve r i l o g仿真器進行驗證。語言從C編程語言
2020-11-30 19:03:38
Verilog HDL是一種用于數字邏輯電路設計的語言。用Verilog HDL描述的電路設計就是該電路的Verilog HDL模型。Verilog HDL既是一種行為描述的語言也是一種結構描述
2019-09-06 09:14:16
四個主要的方面來研究計算，即從算法和數據結構、編程語言、體系結構、軟件和硬件設計方法學。本課本的主題是從算法到硬線邏輯的實現，因此我們將從算法和數據結構、編程語言和程序、體系結構和硬線邏輯以及
2018-12-10 15:31:15
`共分為四部分，Verilog HDL語言、FPGA設計實例、ModelSim仿真工具及QuartusII開發工具。Verilog HDL設計與實戰.PDF版電子書回復帖子查看下載資料[hide][/hide]Verilog HDL設計與實戰配套代碼回復帖子查看下載資料[hide][/hide]`
2021-06-16 10:50:55
問題：用vhdl語言和Verilog語言和matlab協仿真同一個程序，在modelsim上跑出來的結果不一樣。導致時序有問題。網上查了很多資料沒有結果。（調用的.m函數一樣即輸入信號一樣）。例子
2015-04-28 09:12:50
Verilog模型有哪幾種？Verilog HDL模型是由哪些模塊構成的？如何用Verilog HDL語言描述D型主從觸發器模塊？
2021-10-19 08:36:32
本文采用Verilog FPGA設計懸掛運動控制系統的控制器，通過輸入模塊傳送控制參數，采用HDL語言編程實現的控制算法，驅動步進電機，對懸掛運動物體進行精確的控制。
2021-05-06 07:11:03
用Verilog語言編寫SJA1000 CAN控制器的驅動程序
2016-03-22 19:49:31
VHDL語言和verilog語言有何區別
2019-03-28 06:52:52
VHDL語言和verilog語言有何區別
2019-03-29 07:55:09
X-HDL:軟件簡介—SoftWare Description: X-HDL v3.2.55 VHDL/Verilog語言翻譯器
一款VHDL/Verilog語言翻譯器。可實現VHDL和Verilog語言的相互智能化轉化。這分別是windows、linux、solaris版本。
2006-03-25 12:00:47
357 CAN總線控制器Verilog代碼
2008-05-20 10:32:12170 本文針對賓館、酒店的客房控制和管理系統，介紹了基于CAN 總線的客房通信控制器的硬件電路結構、原理及軟件結構和主程序流程。關鍵詞：CAN 總線；現場總線；通信技術；樓
2009-06-13 12:06:0313 介紹一種以8051微控制器和82527獨立CAN總線控制器為核心組成的CAN總線智能傳感器節點的設計方法，并給出其硬件原理圖和初始化程序。
2009-07-17 08:41:1626 本文利用Verilog HDL 語言自頂向下的設計方法設計多功能數字鐘，突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優點，并通過Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成綜
2009-08-05 16:40:28642 采用 Verilog HDL 語言在Altera 公司的FPGA 芯片上實現了RISC_CPU 的關鍵部件狀態控制器的設計,以及在與其它各種數字邏輯設計方法的比較下,顯示出使用Verilog HDL語言的優越性.關鍵詞
2009-08-21 10:50:0569 簡述了I2C總線的特點；介紹了開發FPGA時I2C總線模塊的設計思想；給出并解釋了用Verilog HDL實現部分I2C總線功能的程序，以及I2C總線主從模式下的仿真時序圖。
2009-10-19 10:49:16104 Verilog-HDL實踐與應用系統設計本書從實用的角度介紹了硬件描述語言Verilog-HDL。通過動手實踐,體驗Verilog-HDL的語法結構、功能等內涵。在前五章,以簡單的實例列舉了Verilog-HDL的用法;
2009-11-14 22:57:40147 Verilog HDL 華為入門教程
本文主要介紹了Verilog HDL 語言的一些基本知識，目的是使初學者能夠迅速掌握HDL設計方法，初步了解并掌握Verilog HDL語言的基本要素，能
2010-02-11 08:35:38141 Verilog HDL入門教程(華為絕密資料)
本文主要介紹了Verilog HDL 語言的一些基本知識，目的是使初學者能夠迅速掌握HDL設計方法，初步了解并掌握Verilog HDL語言的
2010-04-02 11:52:210 SMBus是一種高效的同步串行總線。通過分析SMBus總線協議，提出了一種運行于基于PCI-Express技術的橋接芯片上的SMBus控制器的設計方案，并且用Verilog語言描述，最后在Altera公司的FPGA上
2010-07-16 15:08:1216 什么是Verilog HDL？
Verilog HDL是一種硬件描述語言，用于從算法級、門級到開關級的多種抽象設計層次的數字系統建模。被建模的數字系統
2009-01-18 14:53:264541 
摘 要：通過設計實例詳細介紹了用Verilog HDL語言開發FPGA/CPLD的方法，并通過與其他各種輸入方式的比較，顯示出使用Verilog HDL語言的優越性。
2009-06-20 11:51:282331 
摘要： 簡述了I2C總線的特點；介紹了開發FPGA時I2C總線模塊的設計思想；給出并解釋了用Verilog HDL實現部分I2C總線功能的程序，以及I2C總線主從模式下的仿真時序圖
2009-06-20 13:17:087139 
基于CAN總線的分布式控制器設計和實現
近年來大學生的科技創新設計活動越來越豐富,而為每個機電系統設計專門的控制器不僅耗時,而且難以滿足系統的穩定性要求,這
2009-10-26 14:11:46908 
基于CAN總線的家庭控制器的設計與實現
引言
CAN（Controller Area Network）總線是德國Bosch公司為解決現代汽車中眾多的控制與測試儀器之間的數據交換而開發
2009-11-07 09:30:32899 
Verilog HDL程序基本結構與程序入門
Verilog HDL程序基本結構
Verilog HDL是一種用于數字邏輯電路設計的語言。用Verilog HDL描述的
2010-02-08 11:43:302565 Verilog HDL語言實現時序邏輯電路
在Verilog HDL語言中，時序邏輯電路使用always語句塊來實現。例如，實現一個帶有異步復位信號的D觸發器
2010-02-08 11:46:435099 Verilog HDL語言簡介
1．什么是Verilog HDLVerilog HDL是硬件描述語言的一種，用于數
2010-02-09 08:59:334137 VHDL和Verilog HDL語言對比
Verilog HDL和VHDL都是用于邏輯設計的硬件描述語言，并且都已成為IEEE標準。VHDL是在1987年成為IEEE標準，Verilog HDL
2010-02-09 09:01:1710864 交通燈控制器原理
實例的內容及目標
1．實例的主要訓練內容本實例通過Verilog HDL語言設計一個簡易的交通等控制器，實現一個具有兩
2010-02-09 09:16:475802 Verilog HDL與VHDL及FPGA的比較分析. Verilog HDL優點：類似C語言，上手容易，靈活。大小寫敏感。在寫激勵和建模方面有優勢。
2011-01-11 10:45:291581 在我國使用Verilog HDL的公司比使用VHDL的公司多。從EDA技術的發展上看，已出現用于CPLD/FPGA設計的硬件C語言編譯軟件，雖然還不成熟，應用極少，但它有可能會成為繼VHDL和Verilog之后，設計大規模CPLD/FPGA的又一種手段。
2011-03-12 11:21:202003 ModelSim為HDL仿真工具，我們可以利用該軟件來實現對所設計的VHDL或Verilog程序進行仿真，支持IEEE常見的各種硬件描述語言標準。可以進行兩種語言的混合仿真，但推薦大家只對一種語言
2011-04-19 20:52:46152 ModelSim為HDL仿真工具，我們可以利用該軟件來實現對所設計的VHDL或Verilog程序進行仿真，支持IEEE常見的各種硬件描述語言標準。可以進行兩種語言的混合仿真，但推薦大家只對一種語言
2011-05-27 16:41:59132 本次設計將CAN總線控制器分解成三大模塊依次進行：設計寄存器邏輯模塊，完成對數據，控制器狀態以及處理器命令的存儲和讀寫功能：設計驗收濾波器模塊，完成幀的標識符的校驗，
2011-08-31 17:28:3653 本文首先介紹PCI總線控制器PCI9052與CAN總線通信控制器SJA1000的工作原理，并且介紹了PCI總線和CAN總線通信控制器接口的硬件和軟件實現方法。
2011-09-23 17:34:222521 
介紹了基于硬件描述語言Verilog HDL設計的SDX總線與Wishbone總線接口轉化的設計與實現,并通過Modelsim進行功能仿真,在QuartusⅡ軟件平臺上綜合,最終在Altera公司的CycloneⅢ系列FPGA上調試。實驗
2012-01-11 10:21:2125 基于對CAN 總線控制器的功能分析， 并應用Verilog語言進行軟件設計， 從而實現CAN節點之間的通信功能。
2012-04-28 09:56:5415287 
在此利用Verilog HDL設計了一款CAN總線控制器，首先根據協議把整個CAN總線控制器劃分為接口邏輯管理、寄存器邏輯和CAN核心模塊3個模塊，然后用Verilog HDL硬件描述語言設計了各個功能模塊
2012-07-31 14:25:248908 
Verilog_HDL的基本語法詳解（夏宇聞版）:Verilog HDL是一種用于數字邏輯電路設計的語言。用Verilog HDL描述的電路設計就是該電路的Verilog HDL模型。Verilog HDL既是一種行為描述的語言也是一種結
2012-10-08 14:48:310 本文簡單介紹在使用Verilog HDL語言時文件的調用問題之include使用方法介紹及舉例說明，詳見本文...
2013-01-24 14:40:427391 
運用低功耗C0rtex-M3微控制器STM32F103VBT6和FPGA芯片設計一種基于CAN總線的運動控制器。介紹系統的體系結構、主要硬件設計和軟件結構。利用FPGA高速處理能力實現控制算法，與外界通信采
2013-01-31 14:33:3945 Verilog HDL程序設計與實踐著重介紹了Verilog HDL語言
2015-10-29 14:45:4721 Verilog HDL作為一種規范的硬件描述語言被廣泛應用于電路的設計中。 他的設計描述可被不同的工具所支持可用不同器件來實現。利用 Verilog HDL語言自頂 向下的設計方法設計交通燈控制
2022-03-22 12:17:08117 Verilog HDL硬件描述語言
有需要的下來看看
2015-12-29 15:31:270 本章介紹Verilog HDL語言的發展歷史和它的主要能力。verilog相關教程材料，有興趣的同學可以下載學習
2016-04-25 16:09:3214 本章介紹Verilog HDL的基本要素，包括標識符、注釋、數值、編譯程序指令、系統任務和系統函數。另外，本章還介紹了Verilog硬件描述語言中的兩種數據類型。verilog相關教程材料，有興趣的同學可以下載學習。
2016-04-25 16:09:3217 Verilog_HDL語言的學習，為FPGA編程打下堅實的基礎
2016-05-19 16:40:5214 Xilinx FPGA工程例子源碼：FPGA實現CAN總線控制器源碼
2016-06-07 14:13:4397 本文主要介紹了Verilog HDL 語言的一些基本知識，目的是使初學者能夠迅速掌握HDL設計方法，初步了解并掌握Verilog HDL語言的基本要素，能夠讀懂簡單的設計代碼并能夠進行一些簡單設計的Verilog HDL建模。
2016-07-15 15:27:000 設計與驗證，很不錯的一本書，《設計與驗證》以實例講解的方式對HDL語言的設計方法進行介紹。全書共分9章，第1章至第3章主要介紹了Verilog HDL語言的基本概念、設計流程、語法及建模方式等內容
2016-10-10 17:04:40613 Verilog HDL硬件描述語言，感興趣的小伙伴們可以瞧一瞧。
2016-11-11 11:20:1111 基于FPGA Verilog-HDL語言的串口設計
2017-02-16 00:08:5935 基于DSP_FPGA與CAN總線的跟蹤控制器設計
2017-10-21 08:52:075 單片機，實現與CAN控制器的通信聯絡。FPGA／SOPC技術是實現嵌入式系統的最高形式，基于IP軟核的設計與應用也必將成為替代硬核的一種發展趨勢。憑借QuartuslI和NiosII工具，基于FPGA的VHDL（或Verilog）語言設計的IP核能夠提供靈活性和性能更好的控制器。
2017-12-07 11:20:3130 控制等領域。在CAN總線的節點設計中，目前應用較多的是通過單片機的控制來實現。有的單片機已經嵌入了CAN控制器的功能，比如Philips的P8XC592，Motorola的68HC05X4等，但這類
2020-04-12 07:48:008679 
控制器，而無法利用CAN總線來進行通信。為了使得LPC2131能夠利用CAN總線進行通信，可以通過外部擴展來實現其功能。目前，比較普通的方法是在LPC2131的外部采用CAN控制器設計CAN總線接口。LPC2131與CAN控制器的接口電路如圖1所示。
2019-04-18 08:08:004010 
本文檔的主要內容詳細介紹的是Verilog HDL入門教程之Verilog HDL數字系統設計教程。
2018-09-20 15:51:2686 本文主要介紹了Verilog HDL 語言的一些基本知識，目的是使初學者能夠迅速掌握HDL 設計方法，初步了解并掌握Verilog HDL語言的基本要素，能夠讀懂簡單的設計代碼并能夠進行一些簡單設計的Verilog HDL建模。
2019-02-11 08:00:00102 Verilog HDL作為現在最流行的FPGA開發語言，當然是入門基礎。
2019-02-18 14:47:0010863 Mentor公司的ModelSim是業界最優秀的HDL語言仿真軟件，它能提供友好的仿真環境，是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器。
2019-09-27 07:02:002621 
硬件描述語言基本語法和實踐
（1）VHDL 和Verilog HDL的各自特點和應用范圍
（2）Verilog HDL基本結構語言要素與語法規則
（3） Verilog HDL組合邏輯語句結構
2019-07-03 17:36:0054 本文檔的主要內容詳細介紹的是Verilog HDL語言組合邏輯設計方法以及QuartusII軟件的一些高級技巧。
2019-07-03 17:36:1220 本文檔的主要內容詳細介紹的是三態門原理HDL語言DSP和ARM總線的仿真及Modelsim使用教程資料主要內容包括了：1 ModelSimSE的使用流程，2 一個Verilog計數器仿真詳細流程附
2019-07-09 16:49:2710 本文參照CAN2.0 總線協議設計了一個CAN 控制器軟核。具體設計采用TOP-DOWN 方式，上層采用模塊化設計，最底層模塊以Verilog 語言編寫而成。測試了軟核在Xilinx 公司
2019-07-19 17:48:4127 硬件電路的設計主要是CAN通信控制器與微處理器之間和CAN總線收發器與物理總線之間的接口電路的設計。CAN通信控制器是CAN總線接口電路的核心，主要完成CAN的通信協議，而CAN總線收發器的主要功能是增大通信距離，提高系統的瞬間抗干擾能力，保護總線，降低射頻干擾（RFI），實現熱防護等。
2020-03-13 10:45:508845 
電子技術設計的核心是EDA，目前，EDA技術的設計語言主要有Verilog HDL和VHDL兩種，相對來說Verilog HDL語言相對簡單，上手快，其語法風格與C語言類似，據統計，Verilog
2020-03-25 08:00:004 的電子電路設計功能。EDA技術使得電子電路設計者的工作僅限于利用硬件描述語言和EDA軟件平臺來完成對系統硬件功能的實現，極大地提高了設計效率，縮短了設計周期，節省了設計成本。
2020-07-21 08:51:168900 
的是硬件描述語言。最為流行的硬件描述語言有兩種Verilog HDL/VHDL，均為IEEE標準。Verilog HDL具有C語言基礎就很容易上手，而VHDL語言則需要Ada編程基礎。另外Verilog
2020-09-01 11:47:095063 
接口控制新型的CAN 控制器MCP2515，使慣導系統不僅具備了接入CAN 總線的能力，而且在系統實現之后，節點可以根據現場應用提出的新要求進行升級，增加了使用的靈活性。目前實驗樣機已經設計完成，可以正確地通過CAN 總線進行通訊，達到了設計的要求。
2021-01-27 15:52:0017 本文首先分析了DDR SDRAM的基本特征，并提出了相應的解決方案詳細介紹了基于J EDEC DDR SDRAM規范的DDR SDRAM控制器設計方案。該控制器采用Verilog HDL硬件描述語言實現，并集成到高性能SoC中。
2021-03-28 10:57:2423 利用Verilog_HDL語言設計出租車計費器案例。
2021-04-09 16:22:1671 CAN總線節點軟件的設計與實現說明。
2021-04-19 16:59:1020 簡單介紹Verilog HDL語言和仿真工具。
2021-05-06 16:17:10619 Verilog HDL是一種以文本形式描述數字系統硬件的結構和行為的硬件描述語言，也可描述邏輯電路圖、邏輯表達式等。Verilog HDL和VHDL是目前主流的、最受歡迎的兩種硬件描述語言。
2021-07-23 14:36:5511932 1. 軟件基本介紹 軟件基本介紹 ： Modelsim 是 Model Technology（Mentor Graphics 的子公司）的 HDL 硬件描述語言的仿真軟件，該軟件可以用來實現
2021-11-09 09:24:246679 
Verilog HDL入門教程-Verilog HDL的基本語法
2022-01-07 09:23:42189 CAN 總線插卡可以任意插在 PC AT XT 兼容機上，方便地構成分布式監控系統。因此，用 FPGA 實現 CAN 總線通信控制器具有非常重要的應用價值。本篇將通過一個實例講解利用 FPGA 實現 CAN 總線通信控制器的實現方法。
2022-07-29 09:43:223512 今天給大俠帶來基于FPGA的CAN總線控制器的設計，由于篇幅較長，分三篇。今天帶來第一篇，上篇，CAN 總線協議解析以及 CAN 通信控制器程序基本框架。話不多說，上貨。
2023-05-18 09:21:302346 
建立用于RTL綜合的Verilog標準化子集。他是貝爾實驗室所開發的ArchSyn綜合系統的主要設計者之一。他曾為AT&T和Lucent的許多設計師講授Verilog HDL語言和Verilog HDL綜合課程。
2023-05-26 16:59:302184 
節點的硬件接口電路。基于對CAN 總線控制器的功能分析， 并應用Verilog語言進行軟件設計， 從而實現CAN節點之間的通信功能。 0 引言 CAN 總線允許高達1M bit /s通訊速率， 支持多主通訊模式， 有高抗電磁干擾性而且能夠檢測出通信過程中產生的任何錯誤， 已被廣泛應用到各自動
2023-06-18 11:15:014211 節通過硬件描述語言Verilog HDL對二十進制編碼器的描述，介紹Verilog HDL程序的基本結構及特點。
2023-08-28 09:54:345320 
ModelSim為HDL仿真工具，我們可以利用該軟件來實現對所設計的VHDL或Verilog程 序進行仿真，支持IEEE常見的各種硬件描述語言標準。可以進行兩種語言的混合仿真，但 推薦大家只對一種語言仿真。
2024-01-14 09:47:470 CAN總線控制器（Controller Area Network Bus Controller）是CAN總線通信系統中的核心部件，它扮演著接收、處理并轉發CAN總線數據的關鍵角色。下面將從CAN總線控制器的定義、功能、結構、工作原理以及應用等方面進行詳細闡述。
2024-09-03 14:16:173267 CAN（Controller Area Network，控制器局域網）總線控制器的工作原理涉及多個方面，包括消息傳輸、沖突檢測與解決、總線仲裁等關鍵機制。以下是對CAN總線控制器工作原理的詳細解析，旨在全面闡述其工作原理和機制。
2024-09-30 11:33:123095 在現代工業自動化和汽車電子領域，CAN（Controller Area Network）總線因其高可靠性、實時性和靈活性而成為廣泛使用的通信協議之一。選擇合適的CAN總線控制器對于確保系統性
2024-11-12 09:48:101335 Verilog HDL語言和C語言一樣也提供了編譯預處理的功能。“編譯預處理”是Verilog HDL編譯系統的一個組成部分。Verilog HDL語言允許在程序中使用幾種特殊的命令(它們不是一般
2025-03-27 13:30:311218 
概述ModelSim是業界最優秀的HDL語言仿真軟件，它能提供友好的仿真環境，是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器。它采用直接優化的編譯技術、Tcl/Tk技術、和單一內核
2025-11-13 11:41:53312 
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