調試過程中的一點小問題
生成IP核的調用之后,然后對其進行例化,格式是
rrra YourInstanceName (
.clka(clka),
.addra(addra), // Bus [9 : 0]
.douta(douta)); // Bus [43 : 0]
? ????? ????然后調用sinplify,對其進行綜合,結果很不順利。首先是synplify報不支持器件,才發現synplify 9.6.2是2008年的產品,比Spartan6器件還要老。更新到Synplify Pro D-2010.03之后,器件是支持了,但是一綜合就報錯停止了,卻不提示有什么錯誤。查看工程文件夾下面的.log和.srr文件,里面也是啥信息都沒給。沒辦法,只好切換會使用XST進行綜合。這回能給出信息了:因為例化了28次,所以有28個錯誤,全部提示ERROR:HDLCompilers:26 - "f7.v" line 49 unexpected token: 'rrra'。
? ????? ????HDLCompilers:26這個錯誤,一般情況下是把wire類型的值賦給了reg型的變量才提示的,但是仔細檢查了程序沒有發現有不對的類型聲明,非常納悶。思考了好久才發現,問題竟然就出在IP調用的身上。原來,我在使用rrra ROM0(start,addr0,temp0);調用之后,對應的douta它是一個端口,自然是wire類型的,而程序聲明中temp0是一個reg型的,用來傳遞參數時因為類型不匹配自然提示錯誤了。
? ???? ? ????這里也發現了在ISE中調用synplify進行綜合的一個不足之處,就是如果源程序中如果有錯誤的話,在直接調用synplify時,并不給出錯誤的具體信息,而是直接終止綜合;沒辦法還得使用XST點擊“check syntax”進行程序的語法檢查,而在synplify環境下點擊“syntax check”一樣也能給出錯誤信息。看來二者的接口還不是非常完善吧。
6系列FPGA中使用塊RAM的心得(4)
- FPGA(632043)
- RAM(119992)
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RAM是FPGA中常用的基礎模塊,可廣泛用于緩存數據的情況,同樣它也是ROM,FIFO的基礎。本實驗將為大家介紹如何使用FPGA內部的RAM以及程序對該RAM的數據讀寫操作。
2021-03-15 06:09:45
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14FPGA RAM簡介和使用案例
在FPGA 邏輯設計中經常用到的數據存儲方式有ROM、RAM和FIFO,根據不同的應用場景選擇不同的存儲方式。Xilinx 平臺三種存儲方式在使用過程中的區別如下。
2023-08-22 16:12:47
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在Virtex-6 FPGA中使用全數字VCXO替換技術實現三倍速率SDI直通
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2023-09-14 14:52:17
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5FPGA在一個時鐘周期可以讀取多個RAM數據嗎?
設計都涉及到對RAM的讀寫操作。在FPGA芯片中,RAM也叫做存儲塊(Block RAM),可以存儲大量的數據。 FPGA中的RAM可以一次讀取多個數據,這是因為RAM的結構是一個多列的數據表格,其中每一列都是一個包含多個存儲單元的塊。通過在時鐘的一次上升沿來讀取RAM中的數據,這個操作必須在一個
2023-10-18 15:28:20
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1986fpga雙口ram的使用
FPGA雙口RAM的使用主要涉及配置和使用雙端口RAM模塊。雙端口RAM的特點是有兩組獨立的端口,可以對同一存儲塊進行讀寫操作,從而實現并行訪問。
2024-03-15 13:58:14
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2071突破FPGA限制:TS-M4i系列數字化儀利用GPU加速實現高效塊平均處理
的容量,最大樣品量通常在32k到500k之間。 本白皮書將展示如何使用TS-M4i系列數字化儀的高速PCIe流模式來在軟件中實現塊平均處理,從而突破FPGA的限制。我們用了TS-M4i.2230(1通道,5 GS/s,8位垂直分辨率,1.5 GHz帶寬)作為例子,對比硬件和軟件進
2024-08-19 15:27:46
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詳解FPGA的基本結構
ZYNQ PL 部分等價于 Xilinx 7 系列 FPGA,因此我們將首先介紹 FPGA 的架構。簡化的 FPGA 基本結構由 6 部分組成,分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線資源、底層嵌入功能單元和內嵌專用硬核等。
2024-10-25 16:50:23
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