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      XILINX開發者社區

      文章：170 被閱讀：44.2w 粉絲數：21 關注數：0 點贊數：4

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      第二代AMD Kintex UltraScale+ FPGA的亮點

      第二代 AMD Kintex UltraScale+ FPGA 可有效賦能專業音視頻、廣播、醫療、機....
      的頭像 XILINX開發者社區 發表于 03-03 11:32 ?502次閱讀
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      如何使用Lopper實用工具為目標處理器生成DTB

      Lopper 是一個基于 Python 的框架，用于從系統設備樹中抽取系統元數據，例如，處理器地址映....
      的頭像 XILINX開發者社區 發表于 02-24 11:23 ?280次閱讀

      使用AMD Value Package加速提升工作效率

      AMD Value Package (AVP) 是一種一體化解決方案套件，旨在幫助工程團隊提升工作效....
      的頭像 XILINX開發者社區 發表于 01-30 11:01 ?548次閱讀

      使用Aurora 6466b協議實現AMD UltraScale+ FPGA與AMD Versal自適應SoC的對接

      在本博客中，我們將介紹使用 Aurora 6466b 協議實現 AMD UltraScale+ FP....
      的頭像 XILINX開發者社區 發表于 01-13 14:04 ?3414次閱讀
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      鎖存器中的時間借用概念與靜態時序分析

      對于基于鎖存器的設計，靜態時序分析會應用一個稱為時間借用的概念。本篇博文解釋了時間借用的概念，若您的....
      的頭像 XILINX開發者社區 發表于 12-31 15:25 ?5494次閱讀
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      AMD Power Design Manager 2025.2版本現已發布

      AMD Power Design Manager 2025.2 版本現已發布，并正式支持第二代 AM....
      的頭像 XILINX開發者社區 發表于 12-24 11:08 ?632次閱讀

      一文詳解SystemC仿真庫的編譯

      AMD Vivado 設計套件以文件和庫的形式提供仿真模型。仿真庫包含器件和 IP 的行為和時序模型....
      的頭像 XILINX開發者社區 發表于 12-12 15:08 ?4822次閱讀
      一文詳解SystemC仿真庫的編譯

      全新AMD Vitis統一軟件平臺2025.2版本發布

      AMD Vitis統一軟件平臺 2025.2 版現已推出，此版本為使用 AMD Versal AI ....
      的頭像 XILINX開發者社區 發表于 12-12 15:06 ?652次閱讀

      AMD Vivado Design Suite 2025.2版本現已發布

      AMD Vivado Design Suite 2025.2 版本現已發布，新增對 AMD Vers....
      的頭像 XILINX開發者社區 發表于 12-09 15:11 ?942次閱讀

      NoC性能監控器調試指南

      本篇博客展示了如何訪問 NPI 為 NoC（片上網絡）公開的 Performance Monitor....
      的頭像 XILINX開發者社區 發表于 12-01 14:38 ?1716次閱讀
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      如何在AMD Vitis Unified IDE中使用系統設備樹

      您將在這篇博客中了解系統設備樹 (SDT) 以及如何在 AMD Vitis Unified IDE ....
      的頭像 XILINX開發者社區 發表于 11-18 11:13 ?3113次閱讀
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      Video Processing Subsystem與HDMI示例設計

      在撰寫本文時，HDMI Transmitter Subsystem IP 核與 Video Proc....
      的頭像 XILINX開發者社區 發表于 11-07 10:35 ?712次閱讀
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      AMD Vitis AI 5.1測試版發布

      AMD Vitis AI 5.1全新發布——新增了對 AMD Versal AI Edge 系列神經....
      的頭像 XILINX開發者社區 發表于 10-31 12:46 ?793次閱讀

      如何在應用程序調試期間分析棧和堆使用情況

      隨著 AMD Vitis 統一軟件平臺 2021.2 的發布，Vitis 引入了一個 Tcl 腳本，....
      的頭像 XILINX開發者社區 發表于 10-24 16:54 ?890次閱讀
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      AMD Versal自適應SoC內置自校準的工作原理

      本文提供有關 AMD Versal 自適應 SoC 內置自校準 (BISC) 工作方式的詳細信息。此....
      的頭像 XILINX開發者社區 發表于 10-21 08:18 ?4179次閱讀

      如何利用XPIO構建并實現帶有Strobe的高速接口設計

      在 AMD Versal 自適應 SoC 器件中，SelectIO 是實現高速接口的重要組成部分。它....
      的頭像 XILINX開發者社區 發表于 10-17 09:22 ?2505次閱讀
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      AMD Vivado IP integrator的基本功能特性

      我們還將帶您了解在 AMD Zynq UltraScale+ MPSoC 開發板與 AMD Vers....
      的頭像 XILINX開發者社區 發表于 10-07 13:02 ?2129次閱讀
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      如何使用PetaLinux檢查RFDC IP狀態

      本篇博客演示了在 ZCU208 評估板和 ZCU216 評估板中通過運行簡單的 RFDC 示例來快速....
      的頭像 XILINX開發者社區 發表于 09-23 16:08 ?1161次閱讀
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      如何解決I/O時鐘布局器錯誤

      在 I/O 時鐘布局器階段可能會發生錯誤，指出該工具無法對該時鐘結構進行布局，直至最后 BUFG 仍....
      的頭像 XILINX開發者社區 發表于 09-23 16:05 ?1038次閱讀

      AMD Vivado ChipScope助力硬件調試

      許多硬件問題只有在整個集成系統實時運行的過程中才會顯現出來。AMD Vivado ChipScope....
      的頭像 XILINX開發者社區 發表于 09-05 17:08 ?1149次閱讀

      高扇出信號線優化技巧（下）

      該屬性會將每個驅動程序的扇出限制告知工具，并通過指示布局器了解扇出限制來指引該工具對高扇出的負載進行....
      的頭像 XILINX開發者社區 發表于 08-28 10:47 ?1840次閱讀
      高扇出信號線優化技巧（下）

      高扇出信號線優化技巧（上）

      高扇出信號線 (HFN) 是具有大量負載的信號線。作為用戶，您可能遇到過高扇出信號線相關問題，因為將....
      的頭像 XILINX開發者社區 發表于 08-28 10:45 ?2305次閱讀
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      AMD 2025.1版嵌入式軟件和工具的新增功能

      AMD 2025.1 版嵌入式軟件和工具是面向新一代嵌入式系統開發而打造的綜合平臺，全面加速概念構想....
      的頭像 XILINX開發者社區 發表于 08-15 15:32 ?1265次閱讀

      如何在AMD Vitis Unified 2024.2中連接到QEMU

      在本篇文章我們將學習如何在 AMD Vitis Unified 2024.2 中連接到 QEMU。 ....
      的頭像 XILINX開發者社區 發表于 08-06 17:24 ?1795次閱讀
      如何在AMD Vitis Unified 2024.2中連接到QEMU

      在AMD Versal自適應SoC上使用QEMU+協同仿真示例

      在任意設計流程中，仿真都是不可或缺的關鍵組成部分。它允許用戶在無任何物理硬件的情況下對硬件系統進行確....
      的頭像 XILINX開發者社區 發表于 08-06 17:21 ?1995次閱讀
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      AMD Versal自適應SoC上的級聯模式示例

      本篇博文主要講解在 PL 中如何使用 AXI Interrupt Controller (INTC)....
      的頭像 XILINX開發者社區 發表于 07-22 17:41 ?1682次閱讀
      AMD Versal自適應SoC上的級聯模式示例

      Vivado無法選中開發板的常見原因及解決方法

      在使用 AMD Vivado Design Suite 對開發板（Evaluation Board）....
      的頭像 XILINX開發者社區 發表于 07-15 10:19 ?1702次閱讀
      Vivado無法選中開發板的常見原因及解決方法

      AMD Power Design Manager 2025.1現已推出

      AMD Power Design Manager 2025.1 版（PDM）現已推出——增加了對第二....
      的頭像 XILINX開發者社區 發表于 07-09 14:33 ?1184次閱讀

      AMD FPGA異步模式與同步模式的對比

      本文講述了AMD UltraScale /UltraScale+ FPGA 原生模式下，異步模式與同....
      的頭像 XILINX開發者社區 發表于 07-07 13:47 ?1636次閱讀

      如何在Unified IDE中創建視覺庫HLS組件

      最近我們分享了開發者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程....
      的頭像 XILINX開發者社區 發表于 07-02 10:55 ?1440次閱讀
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