電源系統的電壓容差有幾個影響因素。電壓基準精度就是最為重要的一個影響因素，我們可以在電源管理器件的產品說明書中找到其規范。新型穩壓器要求達到±1%的精度或更高的溫度基準精度。一些成本較低的穩壓器可能會要求±2%或±3%的基準電壓精度。請在產品說明書中查看穩壓器廠商的相關規范，以確保穩壓精度可以滿足處理器的要求。另一個影響穩壓精度的因素是穩壓器外部反饋電阻的容差。

　　在要求精確容差值的情況下，我們推薦使用±1%的容差電阻。另外，在將這種電阻用于編程輸出電壓時，其將會提供額外±0.5%的精度。具體的計算公式如下：

　　輸出電壓精度=2×(1-VREF/VOUT)×TOLRES

　　第三個影響因素是輸出紋波電壓。一個卓越的設計實踐是針對低于1%輸出電壓的峰至峰輸出電壓進行設計，其可使電源系統的電壓精度提高±0.5%。假設為±2%基準精度，那么這3個影響因素加在一起則為±3%的電源系統精度。

　　DaVinci CVDD電源要求一個可帶來±4.2%精度的50mV容差的1.2V典型內核電源。3.3V DVDD電源具有一個可帶來±4.5%精度的150mV的容差，而1.8V DVDD電源則具有一個可帶來±5%精度的90mV的容差。使穩壓器靠近負載來減少路由損耗是非常重要的。需要注意的是，如果電源具有3%的容差，且處理器內核電壓要求具有4.2%容差的情況下，我們就必須對去耦網絡進行設計，以能夠適應1.2V電壓軌的1.2%精度或14mV容差。

　　歷史經驗數據顯示，內核電壓隨著處理技術的發展而不斷降低。對內核電壓稍作改變，便可提供更高的性能，或節省更多的電量。選擇一個具有可編程輸出電壓和±3% 以上輸出電壓容差的穩壓器是一種較好的設計方法。相比從零開始重新設計一種全新的電源，簡單的電阻器變化或引腳重新配置要容易得多。因此，我們要選擇一款可以支持低至0.9V或更低輸出電壓的穩壓器，以能夠最大化地重用，并幫助簡化TI片上系統(SoC)器件未來版本的使用。

　　6 參考設計

　　我們構建了若干電源管理參考設計，并經過數字音頻/視頻應用的測試。這些應用均使用了TI的TMS320DM6443和TMS320DM6446處理器，其能夠滿足排序、電壓精度和啟動要求。圖1顯示了12V電源的參考設計，該設計使用了TPS62111同步降壓轉換器、TPS62040同步降壓轉換器以及TPS73618低壓降調節器，以分別提供3.3V、1.2V和1.8V電壓軌。這種參考設計包含了一個簡單的外部MOSFET、電阻和電容延遲電路，以使3.3V電壓軌能夠適應自升壓模式排序方案要求。TPS62040不但提供了1.2V的內核電壓，而且還可滿足引腳5軟啟動電容的排序要求。這種解決方案擁有±3%容差，90%以上的效率。為了能夠適應主機升壓模式排序方案要求，我們可以添加一個類似的MOSFET、電阻以及電容電路添加至1.2V電壓軌。

　　7 總結

　　一旦充分了解了去耦、排序和容差要求以后，為DaVinci處理器設計一款電源解決方案就變得非常簡單明了。在為所有高性能處理器設計電源時，堅持使用上述技術是一個相當不錯的設計實踐。