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Xilinx是全球領先的可編程邏輯完整解決方案的供應商。Xilinx研發、制造并銷售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統級功能的IP（Intellectual Property）核。

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xilinx技術

Xilinx可編程邏輯器件設計與開發（基礎篇）連載49：Spartan

通常情況下，如果對性能要求不是太高，最好是讓PicoBlaze在低頻下工作，因為它所處理的外設一般為低速設備，例如，串行通信，按鍵等。另外，低頻工作也會...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 1k 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載48：Spartan

PicoBlaze微控制器實際上包含兩個部分，分別是內核KCPSM3 和指令存儲器ROM。

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 618 0

Xilinx可編程邏輯器件設計與開發（基礎篇）連載47：Spartan

PicoBlaze微控制器支持最大256個輸入口和256 個輸出口，PicoBlaze與輸入和輸出有關的信號在“PicoBlaze微控制器接口信號”部分...

2017-02-11 標簽：賽靈思 Xilinx 可編程邏輯 641 0

Virtex6 GTX設計總結：預加重、均衡、輸出振幅的值

在Xilinx的Virtex6 FPGA中，GTX作為一種低功耗的吉比特收發器，配置靈活，功能強大，并與FPGA內部的其他邏輯資源緊密聯系，可用于實現多...

2017-02-11 標簽：fpga Xilinx 4.3k 0

Nexys3學習手記6：ClockingWizard探秘

這一節，我們首先會來了解下Nexys3上的主角兒XC6SLX16（Spartan-6家族）的時鐘資源，當然不會照搬ug382.pdf（建議大家去瀏覽一遍...

2017-02-11 標簽：Xilinx ClockingWizard Nexys3PLL 4.1k 0

Nexys3學習手記5：流水燈在線運行

在進行第一個工程實例前，順便提一下設計工具相關資源的獲取。從特權同學接觸的幾家FPGA開發工具來看，Xilinx在這方面做得應該算是最人性化的了，其設計...

2017-02-11 標簽：FPGA Xilinx Nexys3 1.8k 0

Nexys3學習手記2：建立自己的開發環境

接過Nexys3時，本以為能夠提供一張資料光盤，結果大失所望，除了靜電袋里一塊精致的電路板，就只有一條用于供電和下載的USB連接線和兩張活頁。

2017-02-11 標簽：FPGA Xilinx Nexys3 1.7k 0

FPGA設計全流程：ModelsimSynplify.ProISE

介紹如何編譯HDL必須的Xilinx庫和結構仿真。創建將被編譯庫的目錄在編譯庫之前，最好先建立一個目錄（事實上必須建立一個目錄），步驟如下

2017-02-11 標簽：FPGA FPGA設計 Xilinx 1.6k 0

基于Xilinx FPGA的通用信號采集器

上一篇寫了基于Xilinx FPGA的通用信號發生器的案例，反響比較好，很多朋友和我探討相關的技術，其中就涉及到信號的采集，為了使該文更有血有肉，我在寫...

2017-02-11 標簽：FPGA Xilinx 2.2k 0

基于System Generator的FPGA開發總結

前一陣一直在忙，所以沒有來得及寫博文。弄完雜七雜八的事情，又繼續FPGA的研究。使用Verilog HDL語言和原理圖輸入來完成FPGA設計的方法都試驗...

2017-02-11 標簽：FPGA Xilinx 8.7k 0

借助Intel i7 處理器和 Xilinx FPGA實現的開放式毫米波測試平臺

美國國家儀器公司（NI）和德國德累斯頓工業大學開展合作，通過世界上第一臺開放式毫米波測試平臺來拓展德累斯頓5G實驗室（D5GL），該測試平臺能實時處理超...

2017-02-11 標簽：FPGA Xilinx Intel 1.3k 0

ZedBoard學習手記（三）為自定義外設編寫裸奔控制軟件

由于Xilinx已經為我們做了大部分的鋪墊工作，因此裸奔控制外設這一步就顯得十分簡單了，如果不用Linux和圖形界面顯示，大概我的作品早早的就完成了吧。

2017-02-11 標簽：Linux Xilinx ZedBoard 1.3k 0

Xilinx DDR3控制器接口帶寬利用率測試（四

描述：在此項測試中，發起四次讀寫訪問，其中讀寫操作分別間隔開，四次讀寫操作訪問的地址都是同一個，由此觀察讀寫切換引入的帶寬開銷。

2017-02-11 標簽：DDR3 Xilinx 6.2k 0

Xilinx DDR3控制器接口帶寬利用率測試（三）

描述：在此項測試中，每個Bank只訪問一次，接著依次訪問其它Bank。DDR3有限制在一定時間內可以輸入的Bank打開指令個數，即在一定時間內只允許輸入...

2017-02-11 標簽：DDR3 Xilinx 4.7k 0

Xilinx DDR3控制器接口帶寬利用率測試(二）

描述：單Bank內行切換時，每次打開一個Row，進行一次寫操作以后，必須重新打開另外一個Row，才能進行該Row的寫操作。兩個Row打開操作有時間間隙要...

2017-02-11 標簽：DDR3 Xilinx 3.2k 0

ZedBoard學習手記（九）在ZedBoard上運行QT圖形軟件

在Zynq平臺上運行QT其實與PC無異，都需要相應的執行環境，只不過PC上的QT Lib可以使用QT SDK自動安裝配置，而Zynq平臺上的QT Lib...

2017-02-11 標簽：Xilinx Zynq ZedBoard 1.7k 0

Transceiver對電源文波噪聲的要求

XILINX在Transceiver用戶手冊里提出了對模擬電源的文波噪聲要求：10mV p-p 10kHz~80Mhz。大多數客戶一看到該指標要求的第一...

2017-02-10 標簽：Xilinx Transceiver 電源文波 2.6k 0

參考時鐘對SERDES性能的影響

我們知道，SERDES對參考時鐘有嚴格的相位噪聲性能要求。通常，SERDES供應商會根據其SERDES采用的PLL以及CDR架構特點，以及性能數據，提出...

2017-02-10 標簽：Xilinx SERDES 參考時鐘 6.7k 0

Xilinx 7系列FPGA使用之CLB探索（一）

7系列FPGA是Xilinx新推出的基于28nm工藝的FPGA，其中包含三個系列：Artix、Kintex和Virtex。因項目要使用kintex7為平...

2017-02-10 標簽：FPGA Xilinx CLB 5.8k 0

6 FPGA LX9 MicroBoard成為學習FPGA的另一低成本方法

昨天為寫博客搜索關于miniSpartan6+開發板的一些信息，我偶然看到$89的 Xilinx Spartan-6 FPGA LX9 MicroBoa...

2017-02-10 標簽：賽靈思 Xilinx 1.4k 0

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