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fifo

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First Input First Output的縮寫(xiě)，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

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fifo技術(shù)

易靈思RAM使用指南

易靈思RAM在使用時(shí)可以會(huì)遇到一些問(wèn)題，這里把常用的問(wèn)題總結(jié)下。

2023-06-07 標(biāo)簽：RAM fifo 時(shí)鐘 2.8k 0

跨時(shí)鐘域知識(shí)點(diǎn)梳理

隨著實(shí)習(xí)面試的臨近、秋招的逐步靠近，愈發(fā)覺(jué)得知識(shí)需要成系統(tǒng)，讓它們串接起來(lái)。不然，太容易忘了。

2023-05-29 標(biāo)簽：脈沖 fifo 信號(hào) 2.3k 0

FPGA多bit跨時(shí)鐘域之格雷碼(一)

FPGA多bit跨時(shí)鐘域適合將計(jì)數(shù)器信號(hào)轉(zhuǎn)換為格雷碼。

2023-05-25 標(biāo)簽：fpga fifo 格雷碼 3.8k 0

FPGA跨時(shí)鐘域處理方法(三)

所謂數(shù)據(jù)流跨時(shí)鐘域即：時(shí)鐘不同但是時(shí)間段內(nèi)的數(shù)據(jù)量一定要相同。

2023-05-25 標(biāo)簽：fpga Xilinx fifo 2.8k 0

RA6T2無(wú)傳感器矢量控制應(yīng)用筆記：系統(tǒng)概述

相電流（單電阻）、逆變器總線電壓 (Vdc) 和轉(zhuǎn)速命令 (VR1) 在“單次掃描模式”下測(cè)量（使用硬件觸發(fā)器）。

2023-05-19 標(biāo)簽：轉(zhuǎn)換器 adc fifo 1.2k 0

跨時(shí)鐘域電路設(shè)計(jì)：多位寬數(shù)據(jù)通過(guò)FIFO跨時(shí)鐘域

FIFO是實(shí)現(xiàn)多位寬數(shù)據(jù)的異步跨時(shí)鐘域操作的常用方法，相比于握手方式，F(xiàn)IFO一方面允許發(fā)送端在每個(gè)時(shí)鐘周期都發(fā)送數(shù)據(jù)，另一方面還可以對(duì)數(shù)據(jù)進(jìn)行緩存。需...

2023-05-11 標(biāo)簽：電路設(shè)計(jì)fifo 信號(hào) 5.1k 0

詳細(xì)討論SERDES用到的各種關(guān)鍵技術(shù)

隨著大數(shù)據(jù)的興起以及信息技術(shù)的快速發(fā)展，數(shù)據(jù)傳輸對(duì)總線帶寬的要求越來(lái)越高，并行傳輸技術(shù)的發(fā)展受到了時(shí)序同步困難、信號(hào)偏移嚴(yán)重，抗干擾能力弱以及設(shè)計(jì)復(fù)雜度...

2023-05-10 標(biāo)簽：收發(fā)器濾波器 FPGA設(shè)計(jì) 2.9k 0

詳解單片機(jī)串口高效收發(fā)數(shù)據(jù)的實(shí)現(xiàn)方法

摘要：本文在探討傳統(tǒng)數(shù)據(jù)收發(fā)不足之后，介紹如何使用帶FIFO的串口來(lái)減少接收中斷次數(shù)，通過(guò)一種自定義通訊協(xié)議格式，給出幀打包方法；之后介紹一種特殊的串口...

2023-05-10 標(biāo)簽：單片機(jī)cpu RS485 3k 0

一種高效的串口收發(fā)思路及方案

2023-05-08 標(biāo)簽：cpu fifo 串口 1.3k 0

CAN周期波動(dòng)的優(yōu)化方法有哪些？

對(duì)于車(chē)載控制器來(lái)說(shuō)，CAN周期的波動(dòng)通常是有嚴(yán)格的標(biāo)準(zhǔn)

2023-05-06 標(biāo)簽：控制器 CAN通信 fifo 947 0

FPGA設(shè)計(jì)原則總結(jié)

這里的面積指一個(gè)設(shè)計(jì)消耗 FPGA/CPLD 的邏輯資源的數(shù)量，對(duì)于 FPGA 可以用消耗的 FF(觸發(fā)器)和 LUT(查找表)來(lái)衡量，更一般的衡量方式...

2023-05-04 標(biāo)簽：fifo Verilog HDL 1.1k 0

怎樣設(shè)計(jì)一個(gè)同步FIFO？（3）

我們說(shuō)這個(gè)結(jié)構(gòu)之所以使得FIFO的輸出Q在讀完SRAM之后保持穩(wěn)定，其實(shí)需要SRAM本身可以保持RDATA在讀操作之后的多個(gè)周期保持穩(wěn)定。即SRAM本身...

2023-05-04 標(biāo)簽：sram fifo 1.2k 0

怎樣設(shè)計(jì)一個(gè)同步FIFO？（2）

開(kāi)始往下讀之前，老李先問(wèn)一個(gè)問(wèn)題，假如現(xiàn)在讓你設(shè)計(jì)一個(gè)深度為N的基于2port SRAM的同步FIFO，請(qǐng)問(wèn)至少需要多大的SRAM？假設(shè)SRAM的位寬...

2023-05-04 標(biāo)簽：數(shù)據(jù)sram fifo 1.8k 0

怎樣設(shè)計(jì)一個(gè)同步FIFO？（1）

今天咱們開(kāi)始聊聊FIFO的設(shè)計(jì)。FIFO是一個(gè)數(shù)字電路中常見(jiàn)的模塊，主要作用是數(shù)據(jù)產(chǎn)生端和接受端在短期內(nèi)速率不匹配時(shí)作為數(shù)據(jù)緩存。FIFO是指First...

2023-05-04 標(biāo)簽：fifo 數(shù)字電路數(shù)據(jù)緩存 1.6k 0

介紹使用FIFO和DMA搭配的方式及運(yùn)作原理

在單片機(jī)或者是嵌入式編程中，通常軟件和硬件是緊密相連的。編程者需要同時(shí)擁有硬件思維和軟件技巧，才能使程序更高效、更穩(wěn)定的運(yùn)行在嵌入式系統(tǒng)中。

2023-05-04 標(biāo)簽：單片機(jī)嵌入式 fifo 4.8k 0

網(wǎng)卡的Ring Buffer詳解

DMA 將 NIC 接收的數(shù)據(jù)包逐個(gè)寫(xiě)入 sk_buff ，一個(gè)數(shù)據(jù)包可能占用多個(gè) sk_buff , sk_buff 讀寫(xiě)順序遵循FIFO（先入先出）原則。

2023-04-04 標(biāo)簽：網(wǎng)卡 fifo 函數(shù) 2.1k 0

FIFO的原理和設(shè)計(jì)

FIFO（First In First Out）是異步數(shù)據(jù)傳輸時(shí)經(jīng)常使用的存儲(chǔ)器。該存儲(chǔ)器的特點(diǎn)是數(shù)據(jù)先進(jìn)先出（后進(jìn)后出）。其實(shí)，多位寬數(shù)據(jù)的異步傳輸問(wèn)...

2023-03-26 標(biāo)簽：存儲(chǔ)器 fifo 計(jì)數(shù)器 5k 0

使用SVA的幾個(gè)好處

SVA支持多時(shí)鐘域（clock domain crossing (CDC)）邏輯，例如異步FIFO。 2. SVA是一種描述語(yǔ)言，可讀性比較強(qiáng)。

2023-03-21 標(biāo)簽：fifo CDC 異步 1.4k 0

AQS的同步組件有哪些呢？

AQS 的全稱(chēng)為 Abstract Queued Synchronizer，是在 JUC（java.util.concurrent）下子包中的類(lèi)。

2023-03-16 標(biāo)簽：fifo API TCLH 1.1k 0

簡(jiǎn)單介紹GaussDB網(wǎng)絡(luò)調(diào)度涉及的調(diào)度算法

QoS（Quality of Service）即服務(wù)質(zhì)量，是一種調(diào)度控制機(jī)制，是網(wǎng)絡(luò)設(shè)計(jì)和運(yùn)維的重要技術(shù)。

2023-03-13 標(biāo)簽：QoS fifo 調(diào)度器 1.7k 0

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相關(guān)話(huà)題

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

語(yǔ)音交互

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PCB封裝庫(kù)

PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

VHDL代碼

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powerlink

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Protel 99 se

Protel 99 se

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面包板

面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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