asic

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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

FPGA和ASIC的概念、基本組成及其應(yīng)用場(chǎng)景 FPGA與ASIC的比較

　　FPGA和ASIC都是數(shù)字電路的實(shí)現(xiàn)方式，但它們有不同的優(yōu)缺點(diǎn)和應(yīng)用場(chǎng)景。本文將以通俗易懂的方式解釋FPGA和ASIC的概念、基本組成、及其應(yīng)用場(chǎng)景。

2023-08-14 標(biāo)簽：fpga 模擬電路邏輯電路 3.4k 0

可編程邏輯器件和ASIC對(duì)比介紹

可編程邏輯器件PLD（Programmable Logic Device）就是一種可以由用戶定義和設(shè)置邏輯功能的數(shù)字集成電路，屬于可編程 ASIC。

2020-09-04 標(biāo)簽：fpga asic D觸發(fā)器 3.4k 0

FPGA如何抵抗單粒子效應(yīng)？

隨著工藝水平的提高，F(xiàn)PGA內(nèi)核電壓逐步降低，器件的輻射總劑量承受能力會(huì)越來越高，因此對(duì)采用先進(jìn)工藝的高性能FPGA來講，總劑量效應(yīng)影響會(huì)相對(duì)減小。

2023-10-08 標(biāo)簽：fpga 集成電路 asic 3.4k 0

FPGA模塊之間數(shù)據(jù)的發(fā)送與接收

FPGA同ASIC不同，開發(fā)的周期比較短，可以結(jié)合設(shè)計(jì)要求改變硬件的結(jié)構(gòu)，在通信協(xié)議不成熟的情況下可以幫助企業(yè)迅速推出新產(chǎn)品，滿足非標(biāo)準(zhǔn)接口開發(fā)的需求。

2019-11-27 標(biāo)簽：fpga asic 接口 3.3k 0

一顆芯片設(shè)計(jì)成型的主要四個(gè)部分

時(shí)序分析和驗(yàn)證時(shí)出現(xiàn)的錯(cuò)誤可能需要反復(fù)重做前面幾步才能解決，是一個(gè)多次迭代優(yōu)化的過程。下面我來仔細(xì)介紹一下這六個(gè)步驟。

2023-10-17 標(biāo)簽：asic IC設(shè)計(jì)芯片設(shè)計(jì) 3.3k 0

車規(guī)級(jí)芯片封裝技術(shù)發(fā)展及典型流程解讀

按功能種類劃分，車規(guī)級(jí)半導(dǎo)體大致可分為主控/計(jì)算類芯片（MCU、CPU、FPGA、ASIC和AI芯片等）、功率半導(dǎo)體（IGBT和MOSFET）、傳感器（...

2023-03-06 標(biāo)簽：fpga asic cpu 3.3k 0

【自適應(yīng)計(jì)算在機(jī)器人領(lǐng)域的應(yīng)用】連載二：工業(yè)類比CPU／GPU，ASIC和FPGA，誰更適合機(jī)器人計(jì)算

總體而言，CPU、GPU 和 ASIC 等采用固定架構(gòu)的器件，在其為開發(fā)者提供優(yōu)勢(shì)的同時(shí)，也讓其付出了代價(jià)。

2021-11-11 標(biāo)簽：fpga 機(jī)器人 asic 3.3k 0

ASIC設(shè)計(jì)轉(zhuǎn)FPGA時(shí)需要注意的幾點(diǎn)

FPGA原型驗(yàn)證和其他驗(yàn)證方法是不同的,任何一種其他驗(yàn)證方法都是ASIC驗(yàn)證中的一個(gè)環(huán)節(jié),而FPGA驗(yàn)證卻是一個(gè)過程。

2017-02-11 標(biāo)簽：FPGA asic 3.3k 0

FPGA和ASIC的優(yōu)劣勢(shì) FPGA和ASIC的應(yīng)用場(chǎng)景及前景

　　FPGA和ASIC是數(shù)字電路中常見的實(shí)現(xiàn)方式，因此人們經(jīng)常會(huì)想要了解哪種芯片在未來的發(fā)展中更具有前途。然而，這取決于具體的應(yīng)用場(chǎng)景和需求。在本文中，...

2023-08-14 標(biāo)簽：fpga 芯片邏輯電路 3.3k 0

TAKUMI公司：圖象IP核參考設(shè)計(jì)可用于S2C原型驗(yàn)證平臺(tái)

電子發(fā)燒友網(wǎng)訊：本文主要講述了TAKUMI公司的圖象IP核參考設(shè)計(jì)可用于S2C原型驗(yàn)證平臺(tái)。S2C宣布，一家總部位于日本的高級(jí)圖形知識(shí)產(chǎn)權(quán)(IP)供應(yīng)...

2012-07-03 標(biāo)簽：ASIC SoC IP核 3.3k 0

IC設(shè)計(jì)：clock-gating綜合實(shí)現(xiàn)方案

當(dāng)CK為0時(shí)，ECK 恒定為0， q值為E：如果E為1，則q為1，如果E為0，則q為0。當(dāng)CK為1時(shí)，ECK 恒定為q(n)，即對(duì)應(yīng)的上一次C...

2023-10-16 標(biāo)簽：asic 寄存器 IC設(shè)計(jì) 3.2k 0

云服務(wù)器FPGA架構(gòu)及其電源方案初探

天的 CPU 一直無法滿足當(dāng)前計(jì)算密集型應(yīng)用（如機(jī)器學(xué)習(xí)、數(shù)據(jù)分析和視頻處理等）的需求。加上網(wǎng)絡(luò)與存儲(chǔ)方面日益明顯的瓶頸，云服務(wù)供貨商轉(zhuǎn)而采用加速器來提...

2020-01-09 標(biāo)簽：fpga asic cpu 3.2k 0

專家支招：如何快速解決隔離FPGA設(shè)計(jì)中的錯(cuò)誤

在特定條件下采用更智能的技術(shù)來隔離特定錯(cuò)誤，找到問題電路的源頭并漸進(jìn)式修復(fù)錯(cuò)誤，這很重要。Synopsys 公司的Synplify Premier 和S...

2013-08-15 標(biāo)簽：FPGA ASIC EDA 3.2k 0

可編程硬件發(fā)展路線分析：eFPGA還是FPGA SoC

eFPGA IP和FPGA SoC，誰將在未來更受歡迎呢？筆者認(rèn)為，這兩種生態(tài)都表明了SoC在摩爾定律遇到瓶頸的今天走向可配置的潮流，只是eFPGA從S...

2018-02-10 標(biāo)簽：fpga asic xilinx 3.2k 0

DS18X20/DS1822 1-Wire溫度傳感器在微控制器環(huán)境中的接口

本應(yīng)用向用戶介紹簡(jiǎn)單的1-Wire軟件，用于將微控制器連接至DS18B20、DS18S20和DS1822 1-Wire溫度傳感器。本文舉例使用DS500...

2023-03-01 標(biāo)簽：微控制器溫度傳感器 ASIC 3.2k 0

泰克示波器新頻譜分析功能Spectrum View的特點(diǎn)和應(yīng)用場(chǎng)景

前兩篇文章主要介紹了Spectrum View的功能特點(diǎn)及相關(guān)理論知識(shí)，與示波器傳統(tǒng)的FFT測(cè)試頻譜方法相比，Spectrum View具有獨(dú)到的優(yōu)勢(shì)，...

2020-09-19 標(biāo)簽：測(cè)試示波器 asic 3.2k 0

镕銘微電子VPU如何降本增效

當(dāng)前視頻行業(yè)環(huán)境下，硬件芯片的機(jī)遇與挑戰(zhàn)并存，如何使得硬件芯片產(chǎn)品及方案設(shè)計(jì)更好地貼近用戶、服務(wù)用戶及滿足用戶更深層次需求？本次LiveVideoSta...

2023-06-12 標(biāo)簽：芯片 asic vpu 3.2k 0

專用集成電路的設(shè)計(jì)原則專用集成電路的設(shè)計(jì)方法

專用集成電路（ASIC）是一種定制的集成電路，專門針對(duì)特定應(yīng)用領(lǐng)域進(jìn)行設(shè)計(jì)和制造。與通用集成電路（如微處理器）相比，ASIC具有更高的性能、更低的功耗以...

2024-05-04 標(biāo)簽：asic 接口協(xié)議微處理器 3.1k 0

ADC12QS065里用LVDS格式解決輸出信號(hào)傳輸問題

在輸入信號(hào)轉(zhuǎn)換數(shù)字?jǐn)?shù)據(jù)之后，必須傳輸它們到DSP或ASIC/FPGA進(jìn)行處理。流行的全差分輸出信號(hào)傳輸是方便的。全差分的輸出信號(hào)通過兩條對(duì)稱線給出和吸收...

2020-04-04 標(biāo)簽：dsp fpga asic 3.1k 0

FPGA設(shè)計(jì)方法比ASIC好在哪里

一旦僅用于膠合邏輯，F(xiàn)PGA已經(jīng)發(fā)展到可以在單個(gè)器件上構(gòu)建片上系統(tǒng)（SoC）設(shè)計(jì)的程度。門和功能的數(shù)量急劇增加，以與傳統(tǒng)上僅通過ASIC設(shè)備提供的功能相...

2019-09-14 標(biāo)簽：dsp fpga asic 3.1k 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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