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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會，它是澳大利亞金融服務(wù)和市場的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

ASIC和GPU的原理和優(yōu)勢

? 本文介紹了ASIC和GPU兩種能夠用于AI計算的半導(dǎo)體芯片各自的原理和優(yōu)勢。 ASIC和GPU是什么 ASIC和GPU，都是用于計算功能的半導(dǎo)體芯片...

2025-01-06 標(biāo)簽：asic gpu 3.9k 0

ASIC芯片分類及特點分析

在集成電路界ASIC被認(rèn)為是一種為專門目的而設(shè)計的集成電路，是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計、制造的集成電路。ASIC的特點是面向特定用戶的...

2023-03-31 標(biāo)簽：集成電路 asic 電子系統(tǒng) 3.9k 0

為什么不把每一個類似的解決方案都構(gòu)建為ASIC呢?

PHY連接到包中的高帶寬內(nèi)存(HBM2)堆棧。值得注意的是，eSilicon在芯片和封裝級別的3D和2.5D系統(tǒng)構(gòu)建方面擁有豐富的經(jīng)驗，包括在模具和封裝...

2018-09-03 標(biāo)簽：ASIC 人工智能 AI芯片 3.9k 0

基于FPGA的ASIC協(xié)同原型驗證設(shè)計方案

鑒于芯片設(shè)計的復(fù)雜度提升，成功設(shè)計一個芯片所牽扯的步驟與過程也愈加復(fù)雜，所需花費的資金也成倍增加，一個典型的芯片開發(fā)項目的周期和花銷如下所示 ? ? ...

2020-12-30 標(biāo)簽：fpga asic Xilinx 3.8k 0

ASIC在加密貨幣中應(yīng)用的障礙

許多人對ASIC的悲觀態(tài)度持續(xù)了很長時間，并且也有足夠的理由。不過通用計算芯片像CPU、GPU甚至DRAM為了滿足通用計算需求都不能真正發(fā)揮其計算性能，...

2018-05-16 標(biāo)簽：芯片 ASIC 3.8k 0

FPGA在網(wǎng)絡(luò)安全產(chǎn)品設(shè)計中的作用 IPS上的奇葩還是到期的契約？

在網(wǎng)絡(luò)安全產(chǎn)品設(shè)計的時候，可以采用多種半導(dǎo)體解決方案，相對來講，目前主要采用的體系架構(gòu)包括了x86、NP、ASIC、FPGA四種。其中，CPU與NP的聯(lián)...

2018-04-18 標(biāo)簽：fpga asic xilinx 3.7k 0

幾種FPGA原理設(shè)計圖的性能與應(yīng)用分析

時至今日，F(xiàn)PGA市場的主要業(yè)者僅剩數(shù)家，包括Altera、Xilinx（賽靈思，過去稱為：智霖科技）、Actel、Atmel、Lattice、Quic...

2022-12-09 標(biāo)簽：fpga 單片機(jī)cpld 3.7k 0

“萬能芯片”FPGA在深度學(xué)習(xí)領(lǐng)域的用法

而眾所周知，在專用芯片與通用芯片中間，還有一個更為靈活，也更為神秘的領(lǐng)域：FPGA。無論是英特爾天價的收購還是微軟與 IBM 雄心勃勃的計劃，都讓人對其...

2018-07-02 標(biāo)簽：fpga asic 深度學(xué)習(xí) 3.7k 0

如何實現(xiàn)優(yōu)于1％的輸出電壓精度的電源設(shè)計

隨著FPGA，DSP，ASIC和高性能處理器的工藝幾何尺寸不斷縮小，對電源電壓精度的要求越來越嚴(yán)格。現(xiàn)在，內(nèi)核電壓通常會落在0.9V的范圍內(nèi)，內(nèi)核電流為...

2021-02-12 標(biāo)簽：處理器 fpga 集成電路 3.7k 0

高速低功耗的AES ASIC設(shè)計如何實現(xiàn)

AES是一個密鑰迭代分組密碼，對加密來說，輸入是一個明文分組和一個密鑰，輸出是一個密文分組。它將分組長度固定為128比特，而且僅支持128、196或25...

2018-10-09 標(biāo)簽：asic 寄存器低功耗 3.7k 0

FPGA芯片中邏輯資源和門是如何對應(yīng)的

而且現(xiàn)在的LUT都是4輸入或者6輸入，可以做成邏輯門的組合，跟普通的邏輯門個數(shù)肯定不會是一對一關(guān)系。今天我們來看下這個關(guān)系如果對應(yīng)。

2022-11-11 標(biāo)簽：asic LUT FPGA芯片 3.6k 0

GB200關(guān)于PCB相關(guān)的問答

GB200架構(gòu)的推廣將對PCB廠商產(chǎn)生積極影響。隨著GB200架構(gòu)增強(qiáng)了GPU間的連接層，導(dǎo)致交換機(jī)ASIC數(shù)量增加，從而推動了PCB價值量提升。

2024-04-28 標(biāo)簽：pcb asic gpu 3.6k 0

異步FIFO設(shè)計原理及應(yīng)用需要分析

在大規(guī)模ASIC或FPGA設(shè)計中，多時鐘系統(tǒng)往往是不可避免的，這樣就產(chǎn)生了不同時鐘域數(shù)據(jù)傳輸?shù)膯栴}，其中一個比較好的解決方案就是使用異步FIFO來作不同...

2022-03-09 標(biāo)簽：fpga asic fifo 3.6k 0

跨時鐘設(shè)計：異步FIFO設(shè)計

在ASIC設(shè)計或者FPGA設(shè)計中，我們常常使用異步fifo（first in first out）（下文簡稱為afifo）進(jìn)行數(shù)據(jù)流的跨時鐘，可以說沒使...

2023-07-31 標(biāo)簽：fpga asic 接口 3.6k 0

分散式與集中式汽車電子控制設(shè)計優(yōu)勢分析

借助應(yīng)用特定的 IC 簡化車門電子系統(tǒng)設(shè)計作者：Steven Keeping/Digi-Key 到 2030 年，電子系統(tǒng)將占一輛汽車成本的 50%，...

2020-10-14 標(biāo)簽：asic 線性穩(wěn)壓器電子系統(tǒng) 3.6k 0

FPGA和ASIC的工作原理、優(yōu)缺點及應(yīng)用領(lǐng)域

　　FPGA是一種現(xiàn)場可編程門陣列。它由大量的邏輯單元、輸入輸出模塊、存儲器和時鐘電路組成。FPGA的邏輯單元通常為可編程的邏輯單元，其內(nèi)部結(jié)構(gòu)由一組可...

2023-08-14 標(biāo)簽：fpga 集成電路模擬電路 3.6k 0

CDC同步器設(shè)計方案：為什么使用異步路徑？

在第二周期的同步觸發(fā)器處正確捕獲了DIN處的數(shù)據(jù)（沒有亞穩(wěn)態(tài)）。源脈沖的長度足以使目標(biāo)觸發(fā)器捕獲它。

2021-04-09 標(biāo)簽：asic 觸發(fā)器同步器 3.5k 0

鎖存器：組合電路與時序電路的橋梁

本系列整理數(shù)字系統(tǒng)設(shè)計的相關(guān)知識體系架構(gòu)，為了方便后續(xù)自己查閱與求職準(zhǔn)備。對于FPGA和ASIC設(shè)計中，避免使用Latch（鎖存器）一直是個繞不開的話題...

2023-08-08 標(biāo)簽：fpga asic 時序電路 3.5k 0

FPGA在醫(yī)療設(shè)備中有什么樣的作用

FPGA（現(xiàn)場可編輯門陣列）作為賽靈思（Xilinx）的一項重要發(fā)明，以其可編程和靈活性著稱。起初，F(xiàn)PGA只是用來仿真ASIC，再進(jìn)行掩碼處理和批量制...

2020-11-28 標(biāo)簽：FPGA ASIC 醫(yī)療設(shè)備 3.4k 0

EoPDH ASIC芯片的特點優(yōu)勢及應(yīng)用模式分析

由于以太網(wǎng)技術(shù)的成熟和低成本優(yōu)勢，以太網(wǎng)接入方式已經(jīng)成為很多用戶的首選。最早的客戶采用以太網(wǎng)到E1的轉(zhuǎn)換器，占用某幾個64kbit/s的時隙，而后逐步擴(kuò)...

2020-01-16 標(biāo)簽：芯片轉(zhuǎn)換器 asic 3.4k 0

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