一、引言

軟件無線電提供了一種建立多模式、多頻段、多功能無線設備的有效而且經(jīng)濟的方案，可以通過軟件升級實現(xiàn)功能的提高。軟件無線電可以使整個系統(tǒng)采用動態(tài)的軟件編程對設備特性進行重配置。軟件無線電軟加載切換的實現(xiàn)，需要設計相應的功能波形組件。以下設計了一種差分四相相移鍵控（DQPSK） 的調(diào)制解調(diào)系統(tǒng)，該系統(tǒng)可以將軟件加載到芯片上。

在數(shù)字信號的調(diào)制方式中，由于QPSK （四相移鍵控） 具有頻譜利用率較高，抗干擾性較強，而且在電路上實現(xiàn)也較為簡單等特點，使得它在衛(wèi)星數(shù)字信號調(diào)制方式、數(shù)字電視技術(shù)、HFC 網(wǎng)絡的用戶線纜等方面得到了廣泛的應用。在實際應用中，為了克服QPSK 解調(diào)時的相位模糊現(xiàn)象，在調(diào)制時對基帶信號進行了差分編碼，即DQPSK。

二、DQPSK 調(diào)制解調(diào)的系統(tǒng)方案

具體的DQPSK 調(diào)制解調(diào)系統(tǒng)框圖如圖1 所示，其中上半部分為調(diào)制系統(tǒng)，下半部分為解調(diào)系統(tǒng)。兩個系統(tǒng)之間還要有相應的射頻發(fā)送處理和射頻接收處理。

以下主要按圖1 的系統(tǒng)框圖，基于FPGA 設計DQPSK 調(diào)制解調(diào)系統(tǒng)，采用Xilinx 公司開發(fā)的系統(tǒng)生成器為設計工具，特殊功能模塊的實現(xiàn)采用Verilog HDL 語言編程實現(xiàn)。系統(tǒng)生成器具有強大的模塊化設計功能，多個小功能模塊讓設計人員可以自由搭建所設計的系統(tǒng)。而且，系統(tǒng)生成器可以直接生成位流文件下載到FPGA，也可以生成工程文件，采用ISE 的開發(fā)環(huán)境可以對工程進行綜合、仿真、下載。

1． DQPSK 調(diào)制解調(diào)的關(guān)鍵技術(shù)

（1） 差分編解碼技術(shù)：QPSK 調(diào)制方式是一種四相位的調(diào)制方式。在實現(xiàn)上通常有正交調(diào)制法，相位選擇法，脈沖插入法。其中，應用得最多的是正交調(diào)制法。本設計采用的是正交調(diào)制法。輸入碼元首先要進行串并轉(zhuǎn)換，將串信信號變?yōu)閮陕稩、Q 信號。假設I、Q 兩路的組合用｛a，b｝ 來表示，四相輸入碼元與調(diào)制的相位見表1。

對于QPSK 信號來說，沒有經(jīng)過編碼，直接采用輸入的I、Q 兩路碼元來調(diào)制載波的相位，在解調(diào)時，由于基帶數(shù)字處理載波跟蹤環(huán)的鑒相特性，會出現(xiàn)四重相位模糊的現(xiàn)象。為了克服相位模糊的出現(xiàn)，基帶調(diào)制時，要經(jīng)過差分編碼處理，再用差分編碼后的碼元按表1 的規(guī)則進行調(diào)相，這就是DQPSK。差分編解碼是DQPSK 調(diào)制方式的特點，也是在設計基帶調(diào)制時的一大難點。這里做詳細的分析。

差分解碼是編碼的逆過程，也分為兩種情況來分析。它主要由當前的輸入狀態(tài)和前一時刻的輸入狀態(tài)來決定當前的解碼輸出。

第一種情況：當前一時刻輸入碼元具有相同的數(shù)據(jù)時，即

或11 時，則當前的差分解碼輸出為

本設計中，差分編解碼模塊的實現(xiàn)采用VerilogHDL 語言在ISE 開發(fā)環(huán)境中設計仿真成功后，再采用黑盒子工具調(diào)用到系統(tǒng)生成器設計的調(diào)制解調(diào)系統(tǒng)中。采用Verilog HDL 設計成功后的差分編碼模塊用Modelsim 仿真后的的結(jié)果如圖2 所示，差分解碼的仿真結(jié)果如圖3 所示。由圖2 和圖3 可看出，設計的差分編解碼模塊達到了預期的效果。

采用Verilog HDL 語言實現(xiàn)差分編碼的關(guān)鍵代碼為：

其中，i＿out 和q＿out 分別為I、Q 兩路的編碼輸出。采用Verilog HDL 語言實現(xiàn)差分解碼的關(guān)鍵代碼為：

其中，i＿temp 和q＿temp 分別為2 位的寄存器，用來保存I、Q 兩路當前和前一時刻的輸入。

（2） DQPSK 載波同步的設計：DQPSK 的解調(diào)方法通常用相干解調(diào)法。采用相干解調(diào)法關(guān)鍵在于實現(xiàn)載波的同步。從已調(diào)信號中恢復出與發(fā)送載波同頻同相的本地載波信號，是解調(diào)技術(shù)的難點。載波同步的方法通常有插入導頻法、平方環(huán)法和科斯塔斯環(huán)法。科斯塔斯環(huán)法在實際的應用中有許多種改進的方案，本設計采用其中的一種改進方案四相松尾環(huán)法。四相松尾環(huán)的結(jié)構(gòu)組成如圖4 所示。圖4 中，假設輸入的信號為

式中，x（t）、y（t）分別為同相分量I 和正交分量Q 的基帶信號。NCO 用于產(chǎn)生本地載波，其本振頻率和發(fā)送頻率一樣。F （S） 為二階環(huán)路濾器。判決器的數(shù)學表達式規(guī)定為

則經(jīng)過之前各個模塊的處理后，最終輸入環(huán)路濾波器的誤差信號為

誤差信號ud 僅與發(fā)送載波與本地載波之間的相位差θ 有關(guān)。顯然，四相松尾環(huán)的鑒相特性是一個周期性的方波。ud 經(jīng)環(huán)路濾波器進行平滑，送到數(shù)控振蕩器，迫使本地載波與發(fā)送載波達到同頻同相。

四相松尾環(huán)載波同步設計如圖5 所示。松尾環(huán)對DQPSK 信號載波同步過程中的星座移動過程和最終鎖定的狀態(tài)如圖6 所示。由圖5 和圖6 可以看出，一開始星座并不在對角線上。經(jīng)過一定時間的捕捉過程后，星座最終收斂于四個點，且都在對角線上，抖動很小。

2． 其它模塊的設計

在調(diào)制端，串并模塊的功能主要是實現(xiàn)將基帶的串行數(shù)據(jù)轉(zhuǎn)換為并行數(shù)據(jù)。轉(zhuǎn)換后的并行數(shù)據(jù)為2 位。其原理是將輸入串行數(shù)據(jù)分為兩路后降2下采樣。其中一路加入一個單位延時，實現(xiàn)錯開的下采樣，實現(xiàn)串并轉(zhuǎn)換。解調(diào)端的并串模塊相反，將兩路數(shù)據(jù)上采樣后相加實現(xiàn)。串并轉(zhuǎn)換和并串轉(zhuǎn)換功能的實現(xiàn)如圖7 所示。

經(jīng)差分編碼后的信號需要進行極性轉(zhuǎn)換，以便接下來做調(diào)制處理。極性轉(zhuǎn)換將0、1 跳變的單極性信號轉(zhuǎn)變?yōu)椋?、-1 跳變的雙極性信號。解調(diào)端的設計思路相反。極性模塊的組成如圖8 所示，其中圖8 （a） 為調(diào)制端的極性轉(zhuǎn)換，圖8 （b） 為解調(diào)端的極性轉(zhuǎn)換。

極性轉(zhuǎn)換后的信號輸入到調(diào)制模塊。正交調(diào)制的實現(xiàn)，由可產(chǎn)生兩路正交載波的DDS 和兩個乘法器，一個加法器構(gòu)成。I、Q 兩路輸入信號分別與DDS 產(chǎn)生的兩路正交信號相乘，然后輸入到加法器，隨后輸出。正交調(diào)制模塊的構(gòu)成如圖9 所示。

其中，DDS 的頻率控制字由系統(tǒng)時鐘和載波頻率所決定。

3． DQPSK 系統(tǒng)的仿真

將各個功能模塊按圖1 的系統(tǒng)框圖聯(lián)在一起，組成了DQPSK 調(diào)制解調(diào)系統(tǒng)，如圖10 所示。圖中左半部分為調(diào)制系統(tǒng)，右半部分為解調(diào)系統(tǒng)?；鶐盘査俾蕿? MHz，系統(tǒng)時鐘為100 MHz。載波頻率為10 MHz。調(diào)制解調(diào)系統(tǒng)連在一起后的仿真結(jié)果如圖11 所示。由圖11 可以看出，解調(diào)端最終恢復出輸入的基帶原始信號。只要將調(diào)制系統(tǒng)和解調(diào)系統(tǒng)單獨生成工程，即可下載到FPGA 芯片上實現(xiàn)獨立的調(diào)制功能和解調(diào)功能。當然，在實際應用中調(diào)制系統(tǒng)輸出的信號還要進行DA 數(shù)模轉(zhuǎn)換，再進行射頻處理，然后才發(fā)射出去。相應的，在輸入解調(diào)端之前，也要進行相應的前端處理。

三、結(jié)束語

以上基于軟件無線電的應用背景，采用系統(tǒng)生成器設計工具并結(jié)合Verilog HDL 編程的方法，設計實現(xiàn)了基于FPGA 的DQPSK 的調(diào)制解調(diào)系統(tǒng)。重點設計分析了DQPSK 差分編解碼的實現(xiàn)，以及載波同步的實現(xiàn)。最終的仿真結(jié)果表明，設計的系統(tǒng)能夠?qū)崿F(xiàn)。