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接口/總線/驅(qū)動
權(quán)威的接口/總線/驅(qū)動技術(shù)專欄，內(nèi)容有接口/總線/驅(qū)動培圳資料以及應(yīng)用知識等；涉及接口/總線/驅(qū)動的芯片、技術(shù)、設(shè)計方法和應(yīng)用文章。
驗(yàn)證不同F(xiàn)lash對微控制器執(zhí)行程序性能的影響
在進(jìn)行 Flash 速度驗(yàn)證前，我們需要知道如何獲取各 Flash 的速度...
2023-06-02 標(biāo)簽：微控制器FPUQSPISRAM芯片Flash單片機(jī) 2552
MATLAB殘差神經(jīng)網(wǎng)絡(luò)設(shè)計
我們都知道在CNN網(wǎng)絡(luò)中，輸入的是圖片的矩陣，也是最基本的特征，整個CNN網(wǎng)絡(luò)就是一個信息提取的過程，從底層的特征逐漸抽取到高度抽象的特征...
2023-06-02 標(biāo)簽：神經(jīng)網(wǎng)絡(luò)MATLAB仿真cnnresnet 3321
怎么設(shè)計一個32bit浮點(diǎn)的加法器呢？
設(shè)計一個32bit浮點(diǎn)的加法器，out = A + B，假設(shè)AB均為無符號位，或者換個說法都為正數(shù)。...
配置不同VLAN之間通訊-使用三層交換機(jī)
在一臺交換機(jī)上劃分多個VLAN，正常情況下，不同的VLAN是不能互相通信，這是因?yàn)閂LAN隔離了廣播 域，但有時需要他們能相互訪問，下面通過華為的ENSP工具,演示如何進(jìn)行配置。...
2023-06-02 標(biāo)簽：交換機(jī)VLANVLAN技術(shù) 7848
談?wù)劮抢硐霑r鐘的時鐘偏差
本系列整理數(shù)字系統(tǒng)設(shè)計的相關(guān)知識體系架構(gòu)，為了方便后續(xù)自己查閱與求職準(zhǔn)備。在FPGA和ASIC設(shè)計中，時鐘信號的好壞很大程度上影響了整個系統(tǒng)的穩(wěn)定性，本文主要介紹了數(shù)字設(shè)計中的非理...
2023-06-02 標(biāo)簽：驅(qū)動器FPGA設(shè)計ASIC設(shè)計VDD時鐘信號 3327
常用的PCBA基板類型選擇
PCBA基板是PCBA主板的主要載體，制作PCBA基板的材料質(zhì)量對整個產(chǎn)品的整體性能有非常大的影響。...
大功率電機(jī)控制器硬件在環(huán)系統(tǒng)仿真測試
“EasyGo 仿真平臺，模型下載時間短，操作簡便，運(yùn)行速度快，不僅支持電路模型元件（如電機(jī)仿真模型、逆變橋模型等），還支持?jǐn)?shù)學(xué)計算，邏輯比較模塊自由搭建，確實(shí)很方便易用。”...
2023-06-02 標(biāo)簽：驅(qū)動器異步電機(jī)電機(jī)控制器simulink仿真 1139
基于DWC2的USB驅(qū)動開發(fā)-0x08 ULPI接口協(xié)議概覽
本篇概述了ULPI相關(guān)的內(nèi)容,內(nèi)容比較多后面還有工作模式和寄存器相關(guān)內(nèi)容會分開講。...
2023-06-02 標(biāo)簽：接口usbPHY驅(qū)動開發(fā)DWC2 11928
硬件設(shè)計非常基礎(chǔ)的60個問題匯總
半導(dǎo)體業(yè)界通常使用“半節(jié)距”、“物理柵長（ MOS管柵極的長度）”和“結(jié)深”等參數(shù)來描述芯片的集成度，這些參數(shù)越小，芯片的集成度越高。...
2023-06-02 標(biāo)簽：pcb開關(guān)電源濾波電感共射放大電路RS485收發(fā)器 3484
基于CHS軟件的線束設(shè)計開發(fā)流程
CHS軟件具有白查功能，所有的器件和電線符號標(biāo)示均是唯一的，當(dāng)輸入一個重復(fù)的名稱時會自動提示命名錯誤。DRC設(shè)計規(guī)則檢查使得在功能圖設(shè)計中，沒有連接到設(shè)備端、冗余電線、設(shè)備命名不...
2023-06-02 標(biāo)簽：線束設(shè)計 7838
靜電放電保護(hù)器件種類與特點(diǎn)
靜電放電(ESD)是一種意外的快速高壓瞬態(tài)波形，出現(xiàn)在電路內(nèi)的導(dǎo)體上。ESD引起的高電壓和電流峰值可能導(dǎo)致靜電敏感IC等器件發(fā)生故障。...
2023-06-02 標(biāo)簽：ESDemi靜電放電電磁輻射電機(jī)驅(qū)動器 1204
談?wù)刅erilog/System Verilog和C的幾種交互模式
PLI全稱 Program Language Interface，程序員可以通過PLI在verilog中調(diào)用C函數(shù)，這種訪問是雙向的。...
MM32F5270平臺ADC注入通道的單周期采樣的實(shí)現(xiàn)
MM32F5270的ADC可配置4個注入通道來擴(kuò)展轉(zhuǎn)換通道，那么可進(jìn)行轉(zhuǎn)換的通道最多可達(dá)20個。...
Verilog任務(wù)與函數(shù)的區(qū)別
和函數(shù)一樣，任務(wù)（task）可以用來描述共同的代碼段，并在模塊內(nèi)任意位置被調(diào)用，讓代碼更加的直觀易讀。...
Verilog編碼風(fēng)格的建議
良好的編碼風(fēng)格，有助于代碼的閱讀、調(diào)試和修改。雖然 Verilog 代碼可以在保證語法正確的前提下任意編寫，但是潦草的編碼風(fēng)格往往是一錘子買賣。...
外觀模式的目的及其設(shè)計方案
外觀模式的目的是為類的調(diào)用提供一個統(tǒng)一的接口，用戶只需要通過這個接口就可以實(shí)現(xiàn)內(nèi)部復(fù)雜類的方法...
2023-06-01 標(biāo)簽：printf函數(shù) 1122
Verilog狀態(tài)機(jī)的類型
有限狀態(tài)機(jī)（Finite-State Machine，F(xiàn)SM），簡稱狀態(tài)機(jī)，是表示有限個狀態(tài)以及在這些狀態(tài)之間的轉(zhuǎn)移和動作等行為的數(shù)學(xué)模型。...
2023-06-01 標(biāo)簽：VerilogRTL有限狀態(tài)機(jī)狀態(tài)機(jī)fsm 2907
卷針形狀對卷芯質(zhì)量的影響
鋰電池卷芯的卷繞過程一般是先用兩卷針夾緊兩層隔膜進(jìn)行預(yù)卷，然后依次送入正極片或負(fù)極片，極片分別夾在兩層隔膜之間進(jìn)行卷繞。...
2023-06-01 標(biāo)簽：鋰電池電池充電MATLAB仿真驅(qū)動電機(jī) 3128
過濾器模式是指什么？
過濾器模式是指通過構(gòu)造一系列不同的標(biāo)準(zhǔn)實(shí)現(xiàn)類，通過這些標(biāo)準(zhǔn)實(shí)現(xiàn)類把目標(biāo)對象（通常是多個）按照對應(yīng)的標(biāo)準(zhǔn)進(jìn)行過濾，從而得到想要的對象（或?qū)ο蠼M）。...
2023-06-01 標(biāo)簽：過濾器 2025
橋接模式的目標(biāo)與設(shè)計
橋接模式的目標(biāo)是使對象的抽象部分與實(shí)現(xiàn)部分分離，使之可以分別獨(dú)立變化，以盡量避免產(chǎn)生耦合。...
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