----PCM數(shù)字接口符合G.703標(biāo)準(zhǔn)，通過75Ω同軸電纜或120Ω雙絞線進(jìn)行非對(duì)稱或?qū)ΨQ傳輸，傳輸碼型為含有定時(shí)關(guān)系的HDB3碼，接收端通過譯碼可以恢復(fù)定時(shí)，實(shí)現(xiàn)時(shí)鐘同步，其時(shí)序關(guān)系如圖1所示。Fb為幀同步信號(hào)，C2為時(shí)鐘信號(hào)，速率為2.048Mbps，數(shù)據(jù)在時(shí)鐘下降沿有效，E1接口具有PCM幀結(jié)構(gòu)，一個(gè)復(fù)幀包括16個(gè)幀，一個(gè)幀為125μs，分為32個(gè)時(shí)隙，其中偶幀的零時(shí)隙傳輸同步信息碼0011011，奇幀的零時(shí)隙傳輸對(duì)告碼，16時(shí)隙傳輸信令信息，其它各時(shí)隙傳輸數(shù)據(jù)，每個(gè)時(shí)隙傳輸8比特?cái)?shù)據(jù)。本設(shè)計(jì)采用FPGA編程技術(shù)來實(shí)現(xiàn)PCM編碼原理，線路驅(qū)動(dòng)采用LEVEL ONE公司的LXT30芯片來實(shí)現(xiàn)。

三、利用FPGA編程技術(shù)實(shí)現(xiàn)PCM編碼原理

----根據(jù)以上PCM編碼原理，經(jīng)驗(yàn)證明可利用職權(quán)FPGA編程技術(shù)用一片LATTICE1032E可以實(shí)現(xiàn)一路低速數(shù)據(jù)的收發(fā)，其各功能模塊框圖如圖2所示。用大規(guī)模可編程集成電路實(shí)現(xiàn)系統(tǒng)設(shè)計(jì)，可以提高系統(tǒng)集成度，縮短開發(fā)周期，LATTICE芯片時(shí)延可控，如果要在一個(gè)芯片中實(shí)現(xiàn)多路數(shù)據(jù)的接入，可用XILINX、ALTERA公司更大規(guī)模可編程電路來實(shí)現(xiàn)。

----本接入設(shè)計(jì)主要由5個(gè)模塊組成：

1. 數(shù)據(jù)采集及處理模塊
   ----該模塊功能是異步數(shù)據(jù)接口的數(shù)據(jù)進(jìn)行采集及處理并轉(zhuǎn)換為所需用2M數(shù)據(jù)流。
   
2. 時(shí)鐘發(fā)生模塊
   ----該模塊是將8.192MHz的晶振所產(chǎn)生的原始時(shí)鐘經(jīng)過分頻后所產(chǎn)生的系統(tǒng)時(shí)鐘與從HCB3碼中所提取的2.048Mbps時(shí)鐘進(jìn)行比較并進(jìn)行（數(shù)字鎖相環(huán)），產(chǎn)生系統(tǒng)所需的2.048MbpsJF時(shí)鐘。
   
3. 時(shí)隙產(chǎn)生及控制模塊
   ----該模塊是利用時(shí)鐘發(fā)生模塊產(chǎn)生的2.048MHz的系統(tǒng)時(shí)鐘，經(jīng)分頻及處理后，產(chǎn)生系統(tǒng)所需的零時(shí)隙，幀信號(hào)及所需數(shù)據(jù)傳輸?shù)臅r(shí)隙信號(hào)等時(shí)隙及控制信號(hào)。

4. G.703接口功能模塊
   ----該模塊是完成2M數(shù)據(jù)中提取及插入同步碼及2M數(shù)據(jù)流變換為G.703標(biāo)準(zhǔn)的HDB3碼型。

5. 線路驅(qū)動(dòng)模塊
   ----該模塊采用LEVEL ONE公司的LXT301芯片及相關(guān)變壓器，并由該模塊提取2M系統(tǒng)時(shí)鐘。