早在20世紀 80 年代中期，摩爾定律就已經為集成電路的設計人員帶來了嚴峻的挑戰。如何使用所有這些復雜的晶體管？對于新型 RISC 處理器的設計人員來說，處理器要求的晶體管體積更小，數量更多。因此，在 1988 年開始定義 MIPS R2/3000 的后續產品時，我們在繼續采用 RISC 原理的同時，也在尋求可以使用更多晶體管的方法。當時存在的一些問題和發展趨勢，不僅使我們的工作迷失了方向，而且也使 R4000 處理器陷入困境。

第一個問題或者說是機遇（視您的觀點而定）是在試圖實現較低的每指令周期（CPI）時認識到大量高速緩存的重要性，因為對 CPI 降級起最大作用的是由高速緩存故障所引起的處理器失速?？山邮艿淖畹透咚倬彺娲笮〖s8 Kbytes，分別用于指令和數據，表明這些高速緩存在 R2/3000 系列處理器中均是外部的。然而，CPI 當然不會是整個決定因素?？傮w計算吞吐量是 IPC（1/CPI）和頻率的乘積，而在 R2/3000 家族中，處理器頻率受限于這些相同外部高速緩存的訪問速度。將內部高速緩存和外部高速緩存的最高頻率和最大高速緩存大小的頻率與 IPC 乘積繪制成圖，使我們能夠迅速評估相關的折衷方法。從圖上來看，由于 CPI 改進在 32 Kbyte 之上趨于平緩，但是性能改進因頻率增加而繼續呈線性發展，因而它非常有利于集成高速緩存。在采用 1.0 微米技術的 R4000 中，我們最后以 8 KByte 指令與數據高速緩存而告終。

一旦集成了高速緩存，就有機會通過將高速緩存訪問管道化來進一步提高頻率。甚至有可能在必要時，在地址解碼和陣列存取之間放置管道注冊器。對于 R4000，2 周期高速緩存訪問可以產生一個 8 階管道，而 R2/3000 卻只能產生 5 階單周期高速緩存訪問。通過 RISC 架構開創先河，使用更出色的管道粒度的技術稱為超級流水線，后來在 x86 架構實施中發揮到極至。雖然這不像高速緩存的使用那么明顯，但是隨著相對于額外長度近似線性的增長，加深管道同樣也要使用更多的晶體管。這種線性增長適用于控制邏輯和數據路徑邏輯。

另一個趨勢是，通過廣泛采用 IEEE754 浮點標準及其在 CAD 應用、打印以及成像市場中的普遍使用，為硬件浮點的集成提供了更為強大的推動力。獨立支持除法和方根、完全管道化的浮點乘積單位復雜性約等于整數單位的復雜性?，F在對于浮點來說，主導數據類型是雙精度，或為了實現快速實施而需要 64 位寬數據路徑的 64 位浮點。如果要提供帶有數據的 64 位浮點單位，則需要數據高速緩存的寬度也是 64 位。因此，我們擁有 64 位浮點單位、64 位數據高速緩存等等……

最后，根據操作系統專家觀察，地址位正以一個速率逐漸被消耗，此速率可以在 R4000 的周期內獲得所需的 64 位尋址 —— 行業已經迫不及待地“消化”了 4、8 和 16 位，并且正忙于“咀嚼”32位。雖然這對 R4000 自身來說并不是一個極為樂觀的前景，但是 64 位 MMU 架構和指令擴展了當今幸存 R4000 的開發范圍，并且成為所有 64 位 MIPS 實施的基礎。擁有 64 位尋址并不意味著擁有 64 位整數單位，但是將分段用在 x86 架構中的想法對于 RISC 的支持者來說是十分可怕的，對于編譯人員和操作系統技術人員來說尤為如此。

如今，64 位尋址變得越來越普遍，英特爾和 AMD 最近推出計算 64 位處理器便是一個有力的見證。而且，將 64 位用于數據處理將沖擊新興的高性能網絡市場?？傊?，對64位尋址、可輸送 64 位浮點單位的 64 位寬數據高速緩存、可輕松擴展至后向兼容 64 位架構的純 32 位 RISC 架構的期待，以及相信最終架構能夠長期立于不敗之地的信心開創了引人注目的前景。64 位 R4000 從此誕生。

就此，Quantum Effect Devices (QED) 公司嶄露頭角。QED 是一家致力于 CMOS VLSI 的 MIPS 計算機系統公司，其開發了一款 MIPS 架構的處理器—— R4600。該處理器專門面向嵌入市場，并在設計方面戰勝了思科、朗訊、Extreme Networks 以及其他眾多的領先網絡公司。R4600 秉承了 RISC 高速緩存大小不斷提高的傳統（高速緩存成倍增長），以通過改善 CPI 及所采用設備的組合性來提高高速緩存的效率。充分利用 Microsoft 開發用于各種嵌入應用的WindowsCE，R4600還可以用于當代 PVR 的先驅，WebTV 和 EchoStar的機頂盒中。

同時，QED 開發了 R4600，而另一個 MIPS 架構的授權方——NEC 則正在開發其自己的 64 位 MIPS 處理器—— R4300。NEC 的處理器為 Nintendo-64 及惠普的高性能激光打印機系列提供了強勁的動力。