傳統(tǒng)的DC-DC一般要求輸入輸出的壓差在2～3V以上，隨著時代的發(fā)展，這樣的條件已經(jīng)不能滿足實際應(yīng)用的需要。例如在無線通信領(lǐng)域，GPRS模塊常用到的電壓是4V，經(jīng)常是通過5V轉(zhuǎn)換而來，輸入輸出的壓差需低至1V。針對這樣的情況，于是LDO（Low dropout regulator）應(yīng)運而生。

　　相對DC-DC而言，LDO的優(yōu)點是噪音低，靜態(tài)電流小。很多DC-DC在外圍電路里還需要有電感和續(xù)流二極管，而LDO的典型電路非常簡單，很多LDO只需在輸入端及輸出端各接一顆旁路電容就能夠穩(wěn)定工作，對于節(jié)省PCB的布局空間也很有優(yōu)勢。Ricoh推出的很多LDO，還具有如負(fù)載短路保護、過壓關(guān)斷、過熱關(guān)斷、反接保護等其它的功能。

　　很多硬件工程師在LDO的應(yīng)用中主要考慮輸入電壓范圍，輸出電壓和電流、壓差、紋波、功耗、靜態(tài)電流等，然而往往會忽略一個很重要的參數(shù)：負(fù)載調(diào)整率。本文就筆者在應(yīng)用Ricoh的RP170N401B時由于忽視了負(fù)載調(diào)整率而來帶的問題，并最終通過改進(jìn)設(shè)計得到解決的過程，分享自己的一些經(jīng)驗。

　　問題描述

　　筆者的電路如圖1所示，系統(tǒng)12V轉(zhuǎn)為5V，5V轉(zhuǎn)換成3.3V和4V分別供MCU和通信模塊。由于通信模塊是定時打開和關(guān)閉的，使用中發(fā)現(xiàn)只要U12（RP170N401B）的使能腳為低電平，系統(tǒng)就能正常工作，在MOD_EN拉高時，整個系統(tǒng)則被復(fù)位。

　　圖1：筆者設(shè)計的最初版原理圖

　　問題分析

　　筆者最初是懷疑4V后端的電路短路，導(dǎo)致5V電源被拉底，但由于6臺樣機均會發(fā)生這個問題，4V短路的可能性被排除。實際上在電路中還有看門狗兼電源監(jiān)控的設(shè)計，如圖2所示，問題就發(fā)生在這里，其中的PW_EN腳直接控制5V轉(zhuǎn)3.3V的LDO芯片。

　　圖2：看門狗電路

　　筆者首先測量了系統(tǒng)各個電源在MOD_EN被拉高時的波形，得到波形如圖3所示。

　　圖3：系統(tǒng)各電源波形

　　波形分析：圖中從上至下依次為12V、5V、4V、3.3V波形，圖中3.3V被拉低了184ms，需要進(jìn)一步看一下5V和4V電源線上的尖峰細(xì)節(jié)。將以上波形進(jìn)行放大后，得到如圖4所示波形圖。

　　圖4：系統(tǒng)各電源波形放大

　　波形分析：圖中從上至下依次為12V、5V、4V、3.3V波形細(xì)節(jié)。圖中5V電壓被拉至2.3V，此電壓低于2.63V時706會輸出200mS復(fù)位信號。實測時間184mS，在測量的誤差范圍內(nèi)，與706的電源監(jiān)控復(fù)位時間相近，可繼續(xù)監(jiān)測706的復(fù)位信號，得到如圖5、6所示波形。

　　圖5：看門狗706的復(fù)位信號

　　波形分析：圖中從上至下依次為12V、5V、4V、PW_EN波形細(xì)節(jié)。4V跳變的瞬間，RST輸出了低電平復(fù)位信號，將5V轉(zhuǎn)3.3V的LDO使能腳拉底。

　　圖6：復(fù)位波形細(xì)節(jié)

　　波形分析：在5V跌落后回升至3V前，看門狗706即輸出了低電平復(fù)位信號，且復(fù)位信號分兩段，在電源電壓2.65V前后出現(xiàn)拐點，拐點前的跌落波形是隨5V電源電壓同步跌落；而拐點后的下降波形是看門狗芯片706監(jiān)測到電源電壓低于2.63V輸出的復(fù)位信號。

　　圖7：RP170N401B手冊上的負(fù)載調(diào)整率

　　通過查看RP170N401B的器件手冊，發(fā)現(xiàn)其在負(fù)載突然變大時，輸出電壓由于不能及時調(diào)整而有瞬間的跌落。對應(yīng)到系統(tǒng)中，在使能4V電源LDO使能端的瞬間，因LDO后端有負(fù)載，瞬間電流的沖擊，使得LDO輸入和輸出均有一定瞬間壓降，系統(tǒng)把12V拉低至9.6V，更嚴(yán)重的是在50us內(nèi)把5V電平拉低至2.6V以下，4.7V拉低到2.6V以下，引起電源監(jiān)控芯片706輸出復(fù)位信號，從而導(dǎo)致文頭所述系統(tǒng)重啟現(xiàn)象。

　　改進(jìn)方案

　　從圖7可見，當(dāng)調(diào)整LDO輸出的電容值時，其電壓跌落也會變得平緩，同時采取了以下兩個辦法：

　　1）LDO輸出串聯(lián)電感，通過電感的飽和電流來抑制芯片啟動時的瞬態(tài)大電流。

　　2）調(diào)整LDO輸入輸出兩端的電容的拓?fù)浣Y(jié)構(gòu)，通過電容儲能來消除跌落。

　　圖8：改進(jìn)后的電路

　　LDO的負(fù)載變化率也是十分重要的參數(shù)，這往往也是設(shè)計中的一個盲區(qū)。最終筆者的電路如圖8所示，增加了電感L1，C77調(diào)整到1000uF，重啟的現(xiàn)象也成功解決。

　　經(jīng)驗總結(jié)

　　在LDO芯片的應(yīng)用中，負(fù)載調(diào)整率也是一個很重要的參數(shù)，在新產(chǎn)品設(shè)計的選型之初就應(yīng)當(dāng)重視這個參數(shù)。對老產(chǎn)品已經(jīng)使用的芯片，當(dāng)其負(fù)載調(diào)整率不能滿足實際使用的要求時，通過控制后端負(fù)載電路的瞬間功率、調(diào)整LDO級聯(lián)的拓?fù)浣Y(jié)構(gòu)等方法，可以使得電源設(shè)計滿足系統(tǒng)要求，從而使產(chǎn)品穩(wěn)定可靠地運行。