深入解析PLL1707-Q1：高性能多時鐘發生器的理想選擇

在電子設計領域，時鐘發生器是系統穩定運行的關鍵部件。今天要介紹的是德州儀器（TI）的PLL1707 - Q1，一款專為滿足汽車應用需求而設計的低成本、高性能多時鐘發生器。

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一、產品概述

PLL1707 - Q1是一款3.3V雙PLL多時鐘發生器，具備27 - MHz主時鐘輸入，能夠從該參考輸入頻率生成四個系統時鐘和兩個緩沖的27 - MHz時鐘。它支持多種采樣頻率，輸出時鐘具有零PPM誤差和低抖動的特點，非常適合用于MPEG - 2應用，如DVD刻錄機、硬盤錄像機、多媒體PC的DVD附加卡、數字高清電視系統和機頂盒等。

二、產品特性亮點

2.1 豐富的時鐘輸出

• 該器件可以生成四個系統時鐘SCKO0 - SCKO3，以及兩個27 - MHz的主時鐘MCKO1和MCKO2。其中，SCKO0固定輸出33.8688MHz時鐘；SCKO1可根據不同條件選擇輸出24.576MHz或36.864MHz；SCKO2和SCKO3的輸出頻率則由采樣頻率(f{S})決定，分別為256(f{S})和384(f_{S}) ，支持的采樣頻率包括32kHz、44.1kHz、48kHz、64kHz、88.2kHz和96kHz。

  2.2 低抖動性能

• 時鐘抖動是衡量時鐘信號質量的重要指標之一。PLL1707 - Q1的典型時鐘抖動僅為50ps，能夠為系統提供穩定、精確的時鐘信號，滿足高性能音頻DAC和/或ADC對低抖動的要求。

  2.3 多種控制方式

• 采用并行控制方式，可通過采樣頻率控制引腳（FS1、FS2）、采樣率控制引腳（SR）和SCKO1頻率選擇控制引腳（CSEL）對時鐘輸出進行靈活控制，用戶可以根據實際需求選擇合適的采樣頻率、采樣率和SCKO1頻率。

  2.4 其他特性

• 該產品經過汽車應用認證，工作溫度范圍為 - 40°C至85°C，具備良好的可靠性和穩定性。此外，它采用3.3V單電源供電，使用20引腳SSOP封裝，為無鉛產品，符合環保要求。

三、電氣特性分析

3.1 數字輸入/輸出特性

• 數字輸入邏輯兼容CMOS，輸入邏輯高電平(V{IH})最小為0.7(V{DD})，輸入邏輯低電平(V{IL})最大為0.3(V{DD})。輸入邏輯電流(I{IH})在(V{IN}=V{DD})時最大為100μA，(I{IL})在(V_{IN}=0V)時最大為±10μA。
• 數字輸出邏輯也為CMOS類型，輸出邏輯高電平(V{OH})在(I{OH}=-4mA)時為(V{DD}-0.4V)，輸出邏輯低電平(V{OL})在(I_{OL}=4mA)時最大為0.4V。

  3.2 主時鐘特性

• 主時鐘MCKO1和MCKO2的頻率范圍為26.73MHz至27.27MHz，典型值為27MHz。輸入電平(V{IH})最小為0.7(V{CC})，(V{IL})最大為0.3(V{CC})，輸入電流在(V{IN}=V{CC})和(V_{IN}=0V)時均最大為±10μA。
• 輸出電壓為3.5Vp - p，輸出上升時間和下降時間在20%至80%和80%至20%的(V_{DD})范圍內典型值均為2ns，占空比在晶體振蕩時為45%至55%，典型值為51%；外部時鐘時為50%。時鐘抖動典型值為50ps，上電時間為0.5ms至1.5ms。

  3.3 PLL交流特性

• 系統時鐘SCKO0 - SCKO3的輸出特性也有詳細規定。例如，SCKO0固定輸出33.8688MHz，SCKO1在48kHz時可選擇輸出24.576MHz或36.864MHz，SCKO2和SCKO3根據采樣頻率輸出相應的頻率。輸出上升時間和下降時間典型值均為2ns，占空比為45%至55%，典型值為50%。SCKO0和SCKO1的輸出時鐘抖動為58ps至100ps，SCKO2和SCKO3為50ps至100ps，頻率穩定時間為50ns至150ns，上電時間為3ms至6ms。

  3.4 電源和溫度特性

• 電源電壓(V{CC})和(V{DD})范圍為2.7V至3.6V，典型值為3.3V。在(V{DD}=V{CC}=3.3V)且(f{S}=48kHz)的條件下，電源電流(I{DD}+I_{CC})典型值為19mA，最大功率為35mA，功耗為63mW至130mW。
• 工作溫度范圍為 - 40°C至85°C，熱阻(theta_{JA})典型值為150°C/W。

四、工作原理與控制方式

4.1 主時鐘和系統時鐘輸出原理

• PLL1707 - Q1由雙PLL時鐘和主時鐘發生器組成，它接受一個27 - MHz的主時鐘輸入，可以是XT1和XT2之間的晶體振蕩器，也可以是XT1的外部輸入（此時XT2必須開路）。主時鐘經過內部的PLL和分頻器處理后，生成所需的系統時鐘和主時鐘輸出。

  4.2 電源復位與功能控制

• 該器件具有內部上電復位電路，在上電后，經過1024個主時鐘周期，所有時鐘輸出將以默認設置啟用。其內置功能可以通過并行模式進行控制，使用SR、FS1和FS2引腳。用戶可以通過這些引腳選擇采樣頻率、采樣率和SCKO1頻率。
• 在并行模式下，采樣頻率組可由FS1和FS2選擇，例如FS2低電平、FS1低電平選擇48kHz采樣頻率；采樣率可由SR選擇，SR低電平為標準采樣率，高電平為雙倍采樣率；SCKO1頻率可由CSEL選擇，CSEL低電平輸出36.864MHz，高電平輸出24.576MHz。

五、應用場景與典型連接

5.1 應用場景

• PLL1707 - Q1在MPEG - 2應用中表現出色，可用于DVD刻錄機、硬盤錄像機、DVD播放器、多媒體PC的DVD附加卡、數字高清電視系統和機頂盒等。它能夠從27 - MHz的視頻時鐘為CD - DA DSP、DVD DSP、卡拉OK DSP、ADC和DAC等提供音頻系統時鐘。

  5.2 典型連接

• 典型連接圖顯示，PLL1707 - Q1有四個數字和模擬電源地，但建議使用一個公共接地連接以避免閂鎖或其他電源相關問題。電源應盡可能靠近器件進行旁路處理。在時鐘輸出端，為了獲得良好的抖動性能，應盡量減小負載電容，推薦通過緩沖器驅動時鐘輸出，特別是在SCKO0和SCKO1有重負載的情況下。

六、總結與思考

PLL1707 - Q1憑借其豐富的時鐘輸出、低抖動性能、靈活的控制方式和廣泛的應用場景，成為電子工程師在設計高性能系統時鐘時的一個優秀選擇。在實際應用中，我們需要根據具體的系統需求，合理選擇采樣頻率、電源配置和外部電路連接，以充分發揮該器件的性能優勢。同時，也需要注意ESD防護等問題，避免器件受到損壞。大家在使用PLL1707 - Q1的過程中遇到過哪些問題呢？又是如何解決的呢？歡迎在評論區分享交流。