碳化硅（SiC）MOSFET模塊硬并聯中環流產生的根本機理及綜合抑制策略研究報告

BASiC Semiconductor基本半導體一級代理商傾佳電子（Changer Tech）是一家專注于功率半導體和新能源汽車連接器的分銷商。主要服務于中國工業電源、電力電子設備和新能源汽車產業鏈。傾佳電子聚焦于新能源、交通電動化和數字化轉型三大方向，代理并力推BASiC基本半導體SiC碳化硅MOSFET單管，SiC碳化硅MOSFET功率模塊，SiC模塊驅動板等功率半導體器件以及新能源汽車連接器。?

傾佳電子楊茜致力于推動國產SiC碳化硅模塊在電力電子應用中全面取代進口IGBT模塊，助力電力電子行業自主可控和產業升級！

傾佳電子楊茜咬住SiC碳化硅MOSFET功率器件三個必然，勇立功率半導體器件變革潮頭：

傾佳電子楊茜咬住SiC碳化硅MOSFET模塊全面取代IGBT模塊和IPM模塊的必然趨勢！

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1. 緒論：寬禁帶功率器件的并聯挑戰

隨著電力電子技術向高頻、高壓、高功率密度方向發展，碳化硅（Silicon Carbide, SiC）金屬氧化物半導體場效應晶體管（MOSFET）憑借其卓越的開關速度、低導通電阻和高耐壓特性，正逐步取代傳統的硅基IGBT，成為集中式儲能變流器PCS、商用車電驅動及固態變壓器等核心裝備的首選功率器件 。然而，單顆SiC芯片或單個標準功率模塊的載流能力往往受限于半導體制造工藝的良率及封裝散熱極限，難以滿足兆瓦級應用對數千安培電流的需求。因此，將多個SiC MOSFET芯片或模塊進行“硬并聯”（Hard Paralleling）已成為提升系統功率容量的必由之路 。

所謂的硬并聯，是指將多個功率器件的柵極（Gate）、漏極（Drain）和源極（Source）分別直接電氣連接，使其在邏輯上作為一個單一的大功率開關工作。然而，SiC MOSFET極高的開關速度（dv/dt>100V/ns, di/dt>5kA/μs）使其對電路寄生參數的敏感度遠超傳統硅器件 。在硬并聯配置中，微小的器件參數差異或電路布局的不對稱，都會在納秒級的開關瞬態過程中被急劇放大，誘發嚴重的動態均流失衡。

其中，最為隱蔽且危害巨大的現象是發生在輔助源極（Auxiliary Source，或稱Kelvin Source）回路中的環流，常被稱為“S極環流”。這種環流不僅會導致器件損耗分布不均，更可能直接熔斷模塊內部的鍵合線，導致柵極失控甚至炸機 。傾佳電子楊茜剖析SiC模塊硬并聯中環流產生的根本物理機理，特別是S極環流的形成機制，量化其潛在危害，并系統性地闡述從無源抑制到有源驅動的綜合解決方案。

2. SiC硬并聯環流的分類與物理根源

在并聯SiC MOSFET系統中，環流（Circulating Current）是指在并聯支路之間流動的非負載電流。根據產生的時間域和物理機制，環流可分為靜態環流和動態環流。雖然靜態環流主要影響熱分布，但動態環流——特別是涉及S極換流的瞬態電流——是造成系統失效的主要原因。

2.1 靜態環流的形成機理

靜態環流發生在器件完全導通的穩態階段，其根本原因在于并聯支路間導通電阻（RDS(on)?）的不匹配 。

ΔIstatic?≈Iload??∑RDS(on)?ΔRDS(on)??

盡管SiC MOSFET的導通電阻具有正溫度系數（PTC），即溫度升高電阻增大，這種特性在一定程度上能提供負反饋，抑制熱失控（溫度高的芯片電流減小），但SiC的PTC效應不如硅MOSFET顯著 。如果模塊內部芯片篩選不嚴格，或者外部母排連接阻抗差異過大，靜態不均流仍會導致個別芯片長期過熱，加速老化。例如，在BASIC Semiconductor的ED3系列模塊中，雖然通過高導熱的Si3?N4?基板優化了散熱，但嚴格控制芯片RDS(on)?的一致性仍是并聯應用的前提 。

2.2 動態環流與“S極環流”的根本原因

動態環流發生在開關瞬態（Turn-on/Turn-off），其幅值可能達到負載電流的數倍。除了器件本身的閾值電壓（VGS(th)?）和跨導（gfs?）差異外 ，最核心的根源在于寄生電感的耦合效應與輔助源極回路的低阻抗特性。

2.2.1 閾值電壓（VGS(th)?）與跨導失配

VGS(th)?決定了器件開啟和關斷的時間點。VGS(th)?較低的器件會先開啟、后關斷。在開關過程中，這意味著該器件將在更長的時間窗口內承擔負載電流。研究表明，僅1V的VGS(th)?差異就可能導致巨大的峰值電流失衡和開關損耗差異 。由于SiC MOSFET的VGS(th)?通常隨溫度升高而降低（例如BMF540R12MZA3從25°C的2.7V降至175°C的1.85V ），這種負溫度系數效應會形成正反饋：承擔更多電流的器件溫度升高，VGS(th)?進一步降低，從而承擔更多電流，最終導致動態熱失控。

2.2.2 S極環流（輔助源極環流）的電磁機理

這是SiC并聯應用中最危險的環流形式。現代SiC模塊（如ED3系列）普遍采用開爾文源極（Kelvin Source / Auxiliary Source）設計，以解耦功率回路與驅動回路 。然而，在多模塊并聯時，這種結構引入了一個致命的寄生回路。

物理回路構成：

當兩個SiC模塊（Module A和Module B）并聯時，它們的功率源極（Power Source, SPWR?）通過外部母排連接在一起，形成大電流路徑。同時，為了共用同一個柵極驅動信號，它們的輔助源極（Auxiliary Source, SAUX?）通常在驅動板上連接到同一個驅動地（Driver GND）。這就形成了一個物理閉環：

LoopAux?:SPWR_A?→SPWR_B?→InternalChipB?→SAUX_B?→DriverPCB→SAUX_A?→InternalChipA?→SPWR_A?

電動勢驅動機制：

由于機械布局的限制，Module A和Module B的功率源極寄生電感（LS_PWR?）幾乎不可能完全相等。當總負載電流以極高的di/dt（例如3 kA/μs）變化時，兩個模塊功率源極電感上感應出的電壓（V=L?di/dt）將產生差異：

ΔVinduced?=(LS_PWR_A??LS_PWR_B?)?dtdi?

這個電壓差ΔVinduced?直接施加在上述的輔助源極回路上。

“青少年電子”效應（Teenager Electrons）： 由于輔助源極回路通常由內部鍵合線和PCB走線構成，在高頻下，其阻抗可能低于主功率回路（盡管電阻較大，但電感可能較小）。電流傾向于選擇“阻抗最低”而非“電阻最低”的路徑。這種現象被形象地稱為“青少年電子”效應——電流像叛逆的青少年一樣，不走寬闊的“主路”（功率母排），而是擠進狹窄的“小路”（輔助源極鍵合線）。

由此產生的S極環流（Icirc_aux?）不再是微小的信號電流，而是可能高達數百安培的能量流。它不是簡單的均流誤差，而是功率回路能量向控制回路的猛烈倒灌。

3. SiC模塊硬并聯環流的深層危害

S極環流及其他動態環流對系統的危害是多維度的，從瞬態的物理損毀到長期的可靠性衰減。

3.1 輔助源極鍵合線熔斷（Catastrophic Failure）

這是S極環流最直接、最致命的后果。

額定值差異： SiC模塊內部的功率源極鍵合線（Power Source Bond Wires）設計用于承載數百安培的負載電流，通常由多根粗鋁線或銅線并聯。然而，輔助源極鍵合線（Auxiliary Source Bond Wire）僅設計用于傳輸柵極充電電流（通常<10A）和電壓采樣，極為纖細 。

熔斷過程： 當di/dt誘發的ΔVinduced?驅動數百安培的S極環流通過輔助源極時，該電流瞬間超過鍵合線的熔斷電流（I2t極限）。鍵合線會在微秒甚至納秒級時間內迅速氣化、熔斷 。

后果： 輔助源極一旦斷路，柵極驅動回路隨即斷開。MOSFET的柵極將處于浮空狀態（Floating Gate）。在米勒電容（Crss?）的耦合作用下，漏極電壓的波動會將浮空柵極電壓拉高，導致器件誤導通進入線性區或直通短路。此時，器件將承受全母線電壓和短路電流，導致瞬間過熱炸裂，甚至引發連鎖反應燒毀整個變流器 。

3.2 柵極振蕩與氧化層擊穿（Gate Oscillation & Oxide Stress）

并聯系統中的寄生電感（Lg?,Ls?）與SiC MOSFET的輸入電容（Ciss?）構成了高Q值的LCR諧振網絡。

激發源： 極高的di/dt和S極環流作為激勵源，極易激發該網絡的寄生振蕩 。

電壓過應力： 振蕩會導致柵源電壓（VGS?）大幅超出安全范圍（通常為+20V/-5V）。正向過壓會導致柵極氧化層（Gate Oxide）發生時經介質擊穿（TDDB），縮短器件壽命；負向過壓則可能導致柵極反向擊穿。

寄生導通： 劇烈的電壓振蕩若突破閾值電壓VGS(th)?，會導致橋臂直通。BASIC Semiconductor的文檔特別強調了在驅動SiC時使用**米勒鉗位（Miller Clamp）**功能的必要性，正是為了防止這種由dv/dt和振蕩引起的誤導通 。

3.3 動態熱失控與壽命衰減

即使環流未導致立即失效，長期的動態不均流也會導致并聯芯片間的熱應力分布極不均勻。

熱循環疲勞： 承載更大動態電流的芯片會經歷更劇烈的溫度波動（ΔTj?）。根據Coffin-Manson模型，這種熱循環會加速芯片焊接層和鍵合點的疲勞老化。

陶瓷基板應力： 模塊內部的陶瓷基板（如Si3?N4? AMB）在反復的熱沖擊下承受機械應力。雖然Si3?N4?相比Al2?O3?具有更好的抗彎強度和抗熱震性（如BMF540R12MZA3所述，能承受1000次熱沖擊而不分層 ），但長期的極端熱不平衡仍可能導致基板裂紋或銅層剝離。

4. 抑制策略與解決方案

針對SiC硬并聯中的環流問題，特別是S極換流，工程界已經發展出一套從電路拓撲、無源器件到有源控制的綜合抑制策略。

4.1 無源抑制方案（Passive Suppression）

無源抑制是通過在回路中串聯阻抗元件來限制環流幅值或阻斷環流路徑，是最常用且性價比最高的方法。

4.1.1 輔助源極電阻 / 開爾文源極電阻 (RKS?)

這是防止S極鍵合線熔斷的“標準配置”。

原理： 在每個并聯模塊的輔助源極引腳與驅動器地之間串聯一個低阻值電阻（RKS?）。

作用： 該電阻增加了輔助源極回路（S極環流路徑）的阻抗，從而大幅衰減由LS?失配感應出的環流。由于柵極驅動電流相對較小且為脈沖狀，RKS?對正常驅動波形的影響可控。

選值建議： 研究表明，RKS?的取值通常在 0.5Ω 到 2Ω 之間 。

若阻值過小（<0.5Ω），對大電流環流的抑制效果不足，鍵合線仍有風險。

若阻值過大（>5Ω），在大電流關斷時，主功率回路的di/dt會在RKS?上產生顯著壓降，從而對柵極電壓產生反向偏置（Debiasing），導致關斷速度變慢，開關損耗增加 。

4.1.2 柵極共模電感（Common Mode Choke, CMC）

在柵極回路中串聯共模電感是抑制高頻環流的有效手段。

原理： 對于正常的柵極驅動電流（差模信號，從Gate流進，從Source流出），CMC呈現極低阻抗；而對于在并聯模塊之間流動的環流（共模信號，從一個模塊的Source流向另一個模塊的Source），CMC呈現高阻抗 。

優勢： 相比單純增加柵極電阻（Rg?），CMC可以在不顯著犧牲開關速度的前提下，有效阻斷由于Vth?失配或LS?失配引起的動態環流 。實驗表明，CMC能將并聯電流不平衡度從26%降低至3%左右 。

4.1.3 功率回路差模電感（Differential Mode Choke, DMC）

雖然主要用于柵極，但在源極功率路徑中引入差模電感（或耦合電感）也可以強制均流。

原理： 利用磁耦合原理，當兩路電流不平衡時，磁通不抵消，電感呈現高阻抗對抗電流變化；當電流平衡時，磁通抵消，阻抗接近零 。

局限： 由于需要承載主功率電流，DMC體積龐大，且會增加主回路電感，這與SiC追求低電感設計的初衷相悖，因此在高功率密度模塊中應用較少 。

4.1.4 磁珠（Ferrite Beads）

在柵極和源極引腳套接磁珠，利用其高頻損耗特性來消耗振蕩能量，抑制主要由寄生參數引起的高頻柵極振蕩（幾十MHz以上）。

4.2 有源抑制與驅動策略（Active Suppression）

有源方案通過智能調節柵極信號來動態補償器件差異。

4.2.1 有源柵極驅動（Active Gate Driver, AGD）

延遲補償： AGD檢測電流過零點或開啟時刻，對Vth?較低（開啟較快）的器件施加微秒級的驅動延遲，使其與慢速器件同步 。

多電平驅動： 通過輸出階梯狀的柵極電壓，控制di/dt的變化率，從而減小寄生電感上的感應電壓差，間接抑制環流 。

閉環控制： 實時監測每個支路的源極電流，動態調整下一周期的驅動電壓幅值或時序 。

4.2.2 獨立的柵極驅動架構

最徹底的解耦方式是為每個并聯模塊配備獨立的隔離驅動器（或獨立的光耦/隔離級）。

原理： 每個模塊擁有獨立的驅動回路，輔助源極不再直接硬連接，而是通過光耦或磁隔離解耦。這從物理上切斷了S極環流的路徑。

缺點： 系統成本顯著增加，且需要極其精確地控制各路驅動信號的同步性（Skew time），否則驅動信號本身的時差會引發新的不均流 。

4.3 模塊內部與系統布局優化

從源頭消除不確定性是最高效的策略。

對稱布局（Symmetry）： 無論是PCB設計還是母排設計，必須嚴格遵循“蝴蝶型”或“星型”對稱布局，確保所有并聯支路的功率路徑（Ld?,Ls?）和驅動路徑（Lg?）阻抗完全一致 。

基板材料選擇： 選用高可靠性基板如Si3?N4? AMB，利用其高熱導率和高機械強度，增強模塊對殘留不均流引起的熱應力的耐受能力，防止因局部過熱導致的基板分層 。

直接源極互連（Direct Source Interconnection, DSI）： 新的研究提出在并聯芯片的源極之間增加低電感的互連線，通過強耦合強制電位拉平，從拓撲上抑制驅動回路的差模電壓 。

5. 結論與建議

深圳市傾佳電子有限公司（簡稱“傾佳電子”）是聚焦新能源與電力電子變革的核心推動者：
傾佳電子成立于2018年，總部位于深圳福田區，定位于功率半導體與新能源汽車連接器的專業分銷商，業務聚焦三大方向：
新能源：覆蓋光伏、儲能、充電基礎設施；
交通電動化：服務新能源汽車三電系統（電控、電池、電機）及高壓平臺升級；
數字化轉型：支持AI算力電源、數據中心等新型電力電子應用。
公司以“推動國產SiC替代進口、加速能源低碳轉型”為使命，響應國家“雙碳”政策（碳達峰、碳中和），致力于降低電力電子系統能耗。代理并力推BASiC基本半導體SiC碳化硅MOSFET單管，BASiC基本半導體SiC碳化硅MOSFET功率模塊，BASiC基本半導體SiC模塊驅動板等功率半導體器件以及新能源汽車連接器。

SiC MOSFET模塊的硬并聯應用是通向高功率電力電子系統的必經之路，但其面臨的“S極換流”挑戰不容忽視。該現象的本質是高頻開關瞬態下，功率回路的電磁能量通過寄生電感差異耦合進脆弱的驅動回路。其直接后果是輔助源極鍵合線的熔斷和模塊的毀滅性失效。

為確保系統安全，工程設計必須采取分層防御策略：

基礎防御： 在每個并聯模塊的輔助源極處必須串聯0.5Ω～2Ω的電阻，這是防止鍵合線熔斷的最后一道防線。

性能優化： 采用**柵極共模電感（CMC）**來抑制高頻振蕩，同時不犧牲開關速度。

驅動保護： 驅動器必須具備**米勒鉗位（Miller Clamp）**功能，防止dv/dt誘發的誤導通，并推薦使用具有獨立隔離或高同步性的驅動方案。

器件選型： 優先選擇參數一致性好（Vth?分檔）、采用高強度Si3?N4?基板的模塊（如BASIC ED3系列），從物理層面提高系統的魯棒性。

通過上述綜合措施，可以有效馴服SiC MOSFET的“野性”，在享受其高頻高效優勢的同時，確保并聯系統的長期可靠運行。

審核編輯 黃宇