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?LMK5B33216網絡同步器技術文檔總結

科技綠洲 ? 2025-09-11 11:46 ? 次閱讀
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該LMK5B33216是一款高性能網絡同步器和抖動清除器,旨在滿足基于以太網的網絡應用的嚴格要求,時序精度< 5ns(ITU-T G.8273.2 D 類)。

該器件集成了三個 DPLL 和三個 APLL,通過可編程環路帶寬 (LBW) 和一個外部環路濾波電容器提供無中斷開關和抖動衰減,從而最大限度地提高靈活性和易用性。
*附件:lmk5b33216.pdf

APLL3 在 VCO 中采用 TI 專有的體聲波 (BAW) 技術的超高性能 PLL,無論 DPLL 基準輸入頻率和抖動特性如何,都可以生成 312.5MHz 輸出時鐘和 42fs 典型 RMS 抖動(12kHz 至 20MHz)。APLL2 和 APLL1 具有傳統的 LC VCO,可為第二或第三頻率域和/或同步域提供選項。

基準電壓源驗證電路監控DPLL基準電壓源輸入,并在檢測到或丟失輸入時自動執行無中斷開關。零延遲模式 (ZDM) 提供對輸入和輸出之間相位關系的控制。

該器件可通過I2C或SPI完全編程。集成的EEPROM可用于自定義系統啟動時鐘。該器件還具有出廠默認的ROM配置文件作為后備選項。

特性

  • 基于超低抖動 BAW VCO 的以太網時鐘
    • 625MHz時為13fs典型RMS抖動,采用4MHz一階高通濾波器(HPF)
    • 312.5MHz時為24fs典型RMS抖動,4MHz一階HPF
    • 312.5MHz時典型值為42fs/最大RMS抖動為60fs
    • 156.25MHz時47fs(典型值)/65fs(最大RMS抖動)
  • 三個高性能數字鎖相環 (DPLL),帶有配對的模擬鎖相環 (APLL)
    • 1mHz至4kHz的可編程DPLL環路帶寬
    • < 1ppt DCO調頻步長
  • 兩個差分或單端 DPLL 輸入
    • 1Hz (1PPS) 至 800MHz 輸入頻率
    • 數字保持和無中斷開關
  • 16 個差分輸出,具有可編程 HSDS、AC-LVPECL、LVDS 和 HSCL 格式
    • 當配置在 OUT[1:0]_P/N、GPIO1 和 GPIO2 上配置 6 個 LVCMOS 頻率輸出時,總頻率輸出高達 20 個,在 OUT[15:0]_P/N 上配置 14 個差分輸出
    • 1Hz (1PPS) 至 1250MHz 輸出頻率,具有可編程擺幅和共模
    • 符合 PCIe Gen 1 至 6 標準
  • I2C、3 線 SPI 或 4 線 SPI
  • –40°C 至 85°C 工作溫度

參數

image.png
?1. 產品概述?
LMK5B33216是德州儀器(TI)推出的高性能網絡同步器和抖動清除器,專為基于以太網的網絡應用設計。該器件集成3個數字鎖相環(DPLL)、3個模擬鎖相環(APLL)和16路輸出時鐘,支持超低抖動(如13fs RMS @625MHz)和多種時鐘格式(HSDS、LVDS、HCSL等),適用于SyncE、IEEE-1588 PTP、數據中心交換機等場景。

?2. 核心特性?

  • ?時鐘性能?:
    • BAW VCO技術提供超低抖動(典型值42fs @312.5MHz)。
    • 支持1Hz至1250MHz輸出頻率,兼容PCIe Gen1-6標準。
  • ?靈活配置?:
    • 3個DPLL支持1mHz至4kHz可編程帶寬,2路差分/單端輸入。
    • 16路差分輸出可編程為HSDS/LVDS/HCSL/LVCMOS格式。
  • ?接口與控制?:I2C、SPI接口,支持-40°C至85°C工作溫度。

?3. 關鍵功能模塊?

  • ?輸入模塊?:
    • 支持XO/TCXO/OCXO輸入(10MHz至156.25MHz),可配置AC/DC耦合及終端阻抗。
    • 參考輸入(IN0/IN1)支持差分/單端,帶頻率、丟失脈沖監測功能。
  • ?PLL架構?:
    • ?DPLL?:數字TDC+DLF實現精密頻率/相位跟蹤,支持無中斷切換(Hitless Switching)。
    • ?APLL?:BAW APLL(APLL3)提供基準低抖動,APLL1/2為LC VCO,支持級聯模式。
  • ?輸出模塊?:
    • 每路輸出帶12位分頻器和20位SYSREF分頻器,支持零延遲模式(ZDM)和相位對齊。

?4. 應用場景?

  • ?有線網絡?:時序卡、線卡、核心路由器(100G-800G)。
  • ?數據中心?:智能網卡(NIC)、112G/224G SerDes時鐘生成。
  • ?工業?:測試設備、醫療成像。

?5. 設計支持?

  • 提供熱阻、ESD等級、電氣特性等詳細參數(如PSNR >100dBc)。
  • 典型應用框圖包含PHY恢復時鐘、PCIe參考時鐘等系統集成方案。

?6. 文檔結構?

  • 包含特性、引腳定義、規格參數、時序圖、典型特性曲線及寄存器配置說明,覆蓋硬件設計到軟件編程的全流程。

該文檔為硬件工程師提供全面的時鐘解決方案設計指南,適用于高精度網絡同步和低抖動時鐘需求場景。

聲明:本文內容及配圖由入駐作者撰寫或者入駐合作網站授權轉載。文章觀點僅代表作者本人,不代表電子發燒友網立場。文章及其配圖僅供工程師學習之用,如有內容侵權或者其他違規問題,請聯系本站處理。 舉報投訴
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