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　　現(xiàn)在，很明顯，如果 ADC 的熱噪聲增加，對高輸入頻率采樣時時鐘抖動便非常重要。例如，一個 16 位 ADC 具有 ~77 到 80 dB 的熱噪聲層。根據(jù)圖 4 所示曲線圖，為了最小化 100MHz 輸入頻率 SNR 的時鐘抖動影響，時鐘抖動需為大約 150 fs 或更高。

　　確定采樣時鐘抖動

　　如前所述，采樣時鐘抖動由時鐘的計時不準(zhǔn)(相位噪聲)和 ADC 的窗口抖動組成。這兩個部分結(jié)合組成如下：

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　　我們在產(chǎn)品說明書中可以找到 ADC 的孔徑口抖動 (aperture jitter)。這一值一般與時鐘振幅或轉(zhuǎn)換速率一起指定，記住這一點(diǎn)很重要。低時鐘振幅帶來低轉(zhuǎn)換速率，從而增加窗口抖動。

　　時鐘輸入抖動

　　時鐘鏈(振蕩器、時鐘緩沖器或 PLL)中器件的輸出抖動一般規(guī)定在某個頻率范圍內(nèi)，該頻率通常偏離于基本時鐘頻率 10 kHz 到 20 MHz(單位也可以是微微秒或者繪制成相位噪聲圖)，可以將其整合到一起獲取抖動信息。但是，低端的 10kHz 和高端的 20MHz 有時并非正確的使用邊界，因?yàn)樗鼈冋{(diào)試依賴于其他系統(tǒng)參數(shù)，我們將在后面進(jìn)行詳細(xì)介紹。圖 6 描述了設(shè)置正確整合限制的重要性，圖中的相位噪聲圖以其每十倍頻抖動內(nèi)容覆蓋。我們可以看到，如果將下限設(shè)定為 100-Hz 或 10kHz 偏移，則產(chǎn)生的抖動便極為不同。同樣地，例如，設(shè)置上整合限制為 10 或 20MHz，可得到相比 100MHz 設(shè)置極為不同的結(jié)果。

　　圖 5 產(chǎn)生的 ADC SNR 受熱噪聲和時鐘抖動的限制

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　　圖 6 每十倍頻計算得到的時鐘相位噪聲抖動影響

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　　確定正確的整合下限

　　在采樣過程中，輸入信號與采樣時鐘信號混頻在一起，包括其相位噪聲。當(dāng)進(jìn)行輸入信號 FFT 分析時，主 FFT 容器 (bin) 集中于輸入信號。采樣信號周圍的相位噪聲(來自時鐘或輸入信號)決定了鄰近主容器的一些容器的振幅，如圖 7 所示。因此，小于 1/2 容器尺寸的偏頻的所有相位噪聲都集中于輸入信號容器中，且未增加噪聲。因此，相位噪聲整合帶寬下限應(yīng)設(shè)定為 1/2 FFT 容器尺寸。 FFT 容器尺寸計算方法如下：

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　　為了進(jìn)一步描述該點(diǎn)，我們利用兩個不同的FFT尺寸—131,072 和 1,048,576 點(diǎn)，使用 ADS54RF63 進(jìn)行實(shí)驗(yàn)。采樣速率設(shè)定為 122.88MSPS，而圖 8 則顯示了時鐘相位噪聲。我們將一個 6-MHz、寬帶通濾波器添加到時鐘輸入，以限制影響抖動的寬帶噪聲數(shù)量。選擇 1-GHz 輸入信號的目的是確保 SNR 減弱僅由于時鐘抖動。圖 8 表明兩個 FFT 尺寸的 1/2 容器尺寸到 40MHz 相位噪聲整合抖動結(jié)果都極為不同，而“表 1”的 SNR 測量情況也反映這種現(xiàn)象。

　　圖 7 近區(qū)相位噪聲決定主容器附近 FFT 容器的振幅

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　　設(shè)置正確的整合上限

　　圖 6 所示相位噪聲圖抖動貢獻(xiàn)量為 ~360 fs，其頻率偏移為 10 到 100MHz 之間。這比 100Hz 到 10MHz 之間偏移的所有 ~194 fs 抖動貢獻(xiàn)值要大得多。因此，所選整合上限可極大地影響計算得到的時鐘抖動，以及預(yù)計SNR匹配實(shí)際測量的好壞程度。