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　　Vivado設計套件，是FPGA廠商賽靈思公司2012年發布的集成設計環境。包括高度集成的設計環境和新一代從系統到IC級的工具，這些均建立在共享的可擴展數據模型和通用調試環境基礎上。

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Vivado與ISE同時運行出現的奇怪現象

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Vivado中DONT TOUCH該如何使用？

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2023-11-09 標簽：時鐘時序 Vivado 1.4k 0

Vivado2018版本中Modelsim的配置

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module name需要包含一定的功能展現，什么意思呢，比如要設計address remap，你就叫XXX_addr_remap或者XXX_addr_...

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