modelsim

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　　Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語(yǔ)言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù)，編譯仿真速度快，編譯的代碼與平臺(tái)無(wú)關(guān)，便于保護(hù)IP核，個(gè)性化的圖形界面和用戶接口，為用戶加快調(diào)錯(cuò)提供強(qiáng)有力的手段，是FPGA/ASIC設(shè)計(jì)的首選仿真軟件。

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modelsim技術(shù)

如何用Python實(shí)現(xiàn)Vivado和ModelSim仿真自動(dòng)化？

我們?cè)赪indows系統(tǒng)下使用Vivado的默認(rèn)設(shè)置調(diào)用第三方仿真器比如ModelSim進(jìn)行仿真時(shí)，一開(kāi)始仿真軟件都會(huì)默認(rèn)在波形界面中加載testben...

2023-09-13 標(biāo)簽：二進(jìn)制仿真仿真器 3k 0

modelsim安裝運(yùn)行patch閃退

模擬器的安裝和運(yùn)行是計(jì)算機(jī)科學(xué)中非常重要的一環(huán)。ModelSim是一種流行的數(shù)字電子設(shè)計(jì)自動(dòng)化工具，用于驗(yàn)證和仿真硬件設(shè)計(jì)。然而，有時(shí)安裝和運(yùn)行Patc...

2024-01-04 標(biāo)簽：計(jì)算機(jī)操作系統(tǒng)ModelSim 3k 0

正點(diǎn)原子開(kāi)拓者FPGA視頻:Modelsim軟件的使用（2）

ModelSim有幾種不同的版本：SE、PE、LE和OEM，其中SE是最高級(jí)的版本，而集成在 Actel、Atmel、Altera、Xilinx以及La...

2019-09-19 標(biāo)簽：fpga 軟件 modelsim 2.9k 0

使用modelsim時(shí)的問(wèn)題分析

仿真對(duì)于FPGA設(shè)計(jì)來(lái)說(shuō)至關(guān)重要，我們經(jīng)常使用modelsim來(lái)進(jìn)行功能仿真或者時(shí)序仿真，這樣就需要將modelsim和設(shè)計(jì)軟件（quartus ii）...

2024-10-24 標(biāo)簽：FPGA 仿真軟件 2.8k 0

鋯石FPGA A4_Nano開(kāi)發(fā)板視頻：ModelSim軟件使用講解

Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語(yǔ)言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。

2019-09-27 標(biāo)簽：fpga 仿真器 modelsim 2.7k 0

介紹一種ISE聯(lián)合仿真轉(zhuǎn)換為Moldelsim單獨(dú)仿真的方法

找到仿真頂層的tb文件，cut_through_top_tb。

2023-01-29 標(biāo)簽：FPGA設(shè)計(jì)asic ModelSim 2.7k 0

Modelsim的仿真之路(Memory小技能)

許久沒(méi)更新了，間歇性來(lái)寫(xiě)寫(xiě)，還是繼續(xù)Modelsim中關(guān)于內(nèi)存的操作，涉及的文件可在文末自行獲取，本篇對(duì)應(yīng)memory的文件夾。

2022-10-24 標(biāo)簽：仿真 Memory ModelSim 2.6k 0

在modelsim中指定賽靈思的仿真庫(kù)方法

批命令 A、開(kāi)始-運(yùn)行：cmd 在DOS窗口輸入：“ compxlib –s mti_se –f all –l all –o c:\Modeltech ...

2017-02-11 標(biāo)簽：賽靈思 Xilinx modelsim 2.5k 0

使用ModelSim軟件進(jìn)行時(shí)序仿真

通過(guò)該圖，我們可以看出，這個(gè)工程是我們之前做功能仿真的工程，當(dāng)我們關(guān)閉 ModelSim之后，我們?cè)俅未蜷_(kāi) ModelSim 這個(gè)軟件，它會(huì)自動(dòng)記錄上一...

2022-07-18 標(biāo)簽：ModelSim 時(shí)序仿真 2.2k 0

通過(guò)文件讀寫(xiě)方式實(shí)現(xiàn)Matlab和Modelsim的聯(lián)合仿真的經(jīng)驗(yàn)總結(jié)

雖然Modelsim的功能非常強(qiáng)大，仿真的波形可以以多種形式進(jìn)行顯示，但是當(dāng)涉及到數(shù)字信號(hào)處理的算法的仿真驗(yàn)證的時(shí)候，則顯得有點(diǎn)不足

2017-02-11 標(biāo)簽：FPGA Matlab Modelsim 1.9k 0

Modelsim的仿真之路

對(duì)于仿真的激勵(lì)測(cè)試，其實(shí)會(huì)有代碼覆蓋率一說(shuō)，不過(guò)我們平常可能更多是功能覆蓋，代碼覆蓋估計(jì)關(guān)注的人要少些，不過(guò)作為相對(duì)系統(tǒng)性的學(xué)習(xí)，還是大概看下這個(gè)功能吧~

2022-10-24 標(biāo)簽：仿真 ModelSim 代碼 1.9k 0

減少Xilinx Ise與Modelsim聯(lián)合仿真的錯(cuò)誤方法

我們經(jīng)常使用Xilinx Ise與Modelsim聯(lián)合仿真，但是經(jīng)常出現(xiàn)一些由于庫(kù)沒(méi)有編譯而出現(xiàn)的錯(cuò)誤！下面是我總結(jié)的方法：

2017-02-11 標(biāo)簽：Xilinx Modelsim 1.8k 0

記利用compxlibgui工具編譯Xilinx庫(kù)

當(dāng)ISE調(diào)用ModelSim進(jìn)行仿真的時(shí)候，如果在FPGA設(shè)計(jì)中使用了Xilinx提供的的IP core或者其他的原語(yǔ)語(yǔ)句，ModelSim不添加X(jué)il...

2017-02-11 標(biāo)簽：賽靈思 Xilinx ModelSim 1.8k 0

傳統(tǒng)FPGA開(kāi)發(fā)方式講解

對(duì)于一個(gè)軟件開(kāi)發(fā)人員，可能聽(tīng)說(shuō)過(guò) FPGA，甚至在大學(xué)課程設(shè)計(jì)中，可能拿FPGA做過(guò)計(jì)算機(jī)體系架構(gòu)相關(guān)的驗(yàn)證，但是對(duì)于它的第一印象可能覺(jué)得這是硬件工程師...

2023-07-27 標(biāo)簽：fpga 計(jì)算機(jī)ModelSim 1.2k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

+關(guān)注

為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

+關(guān)注

FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

+關(guān)注

FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

+關(guān)注

pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

語(yǔ)音交互

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PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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