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PicoZed SDR?開發套件捆綁了啟動軟件定義無線電?(SDR)?設計所需的一切。?該套件包含穩健的低功耗小型?PicoZed SDR Z7035/AD9361 SOM?和一個載卡，可使用USB、千兆位以太網、SFP+?以及?RF?電源模塊等標準高帶寬接口進行原型設計。了解更多??
PicoZed SDR SOM Z7035/AD9361 開發套件
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2024-12-13 15:18:41
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2024-01-02 11:46:26
AD9361 BBPLL鎖相環失鎖（Z706）
各位好！ 我在嘗試用FPGA直接配置AD9361，但是BBPLL一直失鎖，具體問題如下：
這是9361配置表，在9361初始化時，index一直卡在24，說明BBPLL失鎖，觀察spi讀寫
可以看到sdi值一直為0，sdo波形也很奇怪。其中，spi函數的輸入時鐘是40M。
請問可能是什么問題？
2024-03-25 16:14:46
AD9361 Evaluation Software驅動安裝不成功
您好，我現在在用AD9361 Evaluation Software軟件，想通過這個軟件配置AD9361，我現在是將AD9361和Zedboard通過FMC插槽連接起來，然后用u***-uart線將
2018-12-24 14:40:31
AD9361 FDD模式沒有任何輸出
AD9361采用官網zynq7000 no os版本驅動程序進行配置，芯片初始化完成，并且寄存器回讀正確，配置AD9361在FDD模式下工作，ad9361有載頻信號輸出，但是通過FPGA輸出數字正弦波信號至AD9361數字端，AD9361模擬端沒有任何輸出，只有載頻，請問大神們這是什么原因?。?/div>
2019-01-14 09:10:54
AD9361 SPI無響應
用SPI 配置AD9361，不知道SPI是否寫成功？SPI讀回來全是1，用示波器探頭點著SPI_DO，讀回來就變變成了全0，SPI寫時序是正確的。上電后，沒有配置之前有哪些方法可以判斷AD9361是正常的？
2019-02-19 14:14:07
AD9361信號輸出的問題
設計師反饋:電路板調試過程中，完成AD9361寄存器配置，發射端工作正常，產生840MHz單音信號，軟件各部分工作正常，寄存器配置通過。同時，接收端的clk和frame信號也正常，意味著AD9361
2019-07-31 11:05:16
AD9361數字CMOS接口時序問題
AD9361在1R1T傳輸時，當RX_FRAME和TX_FRAME信號為高電平時（即電平模式），AD9361數據收發并口傳輸時序圖？ 數據手冊中并口的timming使用的是pulse mode，電平模式的timing沒有看到，我從哪里可以找到相應的時序圖。 謝謝！
2018-12-19 09:25:01
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我在用zedboard和FMCOMMS3進行ad9361的開發，使用官方提供的基于ARM的程序沒有問題?，F在我想用純verilog hdl（沒有用ARM）通過SPI對ad9361的寄存器進行了配置
2018-09-25 14:19:38
AD9361無法發出信號
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2019-02-26 10:32:58
AD9361星座圖點很散
我配置完AD9361后，只用來發送數據。在半雙工 TDD SDR模式下10M采樣率發送QPSK,16QAM,64QAM,256QAM的數據，連接到頻譜儀上，通過VSA 89600看星座圖，能看出大致
2018-12-19 09:30:21
AD9361校準問題
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2019-01-21 12:27:31
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