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本文轉載自： OpenFPGA微信公眾號
AXI DMA測試
增加一個AXIDMA章節，這部分內容是很多例程的基礎，難度不大但是也不小，需要徹底理解整個運行機制。
圖4?61 測試框圖
處理器通過M_AXI_GP0接口和AXI_DMA通信，以設置、啟動和監控數據傳輸。數據傳輸通過S_AXI_HP0接口。整個過程如下：
lPS 控制 DMA，使 DMA 通過數據通道讀取 DDR 中的數據； DMA 將讀取到的數據傳給 FIFO。
lFIFO 將數據傳輸給 DMA； PS 控制 DMA，使 DMA 通過數據通道將數據寫入 DDR 中。
l傳輸校驗，對比接收數據與發送數據是否一致。
詳細的建立工程細節請參考例程下的《DOC》文件夾。
BD框圖：
圖4?62 BD框圖
SDK部分詳見《DOC》文件夾下的《AXI DMA LOOP SDK代碼說明.docx》。
詳細代碼見百度云鏈接：
鏈接：https://pan.baidu.com/s/18hj_MzNwCo1QB6u9CA47ww
提取碼：open
后期會整理好統一發到GitHub上。
AXI總線
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