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CD74HC138-Q1 汽車類高速 CMOS 邏輯 3 至 8 線路解碼器多路解復用器(反向和非反向)

數據:

描述

CD74HC138是一款高速硅柵CMOS解碼器,非常適合存儲器地址解碼或數據路由應用。該電路具有低功耗,通常與CMOS電路相關,但速度可與低功耗肖特基TTL邏輯相媲美。該電路有三個二進制選擇輸入(A0,A1和A2)。如果器件使能,這些輸入將確定HC138的8個常高輸出中的哪一個將變低。

兩個低電平有效和一個高電平有效( E1 E2 和E3)以簡化解碼器的級聯。解碼器的8個輸出可以驅動10個低功率肖特基TTL等效負載。

特性

  • 符合汽車應用的要求
  • 選擇八種數據輸出中的一種低電平
  • I /O端口或存儲器選擇器
  • 三個使能輸入以簡化級聯
  • 典型傳播延遲為13 ns,V CC = 5 V,C L < /sub> = 15 pF,T A = 25°C
  • 扇出(超溫范圍)
    • 標準輸出。 。 。 10 LSTTL負載
    • 總線驅動器輸出。 。 。 15 LSTTL負載
  • 平衡傳播延遲和轉換時間
  • 與LSTTL邏輯IC相比顯著降低功耗
  • 2-V至6VV CC 操作
  • 高抗噪性; N IL 或N IH = 30%的V CC ,V CC = 5 V
  • < /ul>

參數 與其它產品相比?編碼器和解碼器

?
Function
Technology Family
VCC (Min) (V)
VCC (Max) (V)
Channels (#)
Voltage (Nom) (V)
F @ Nom Voltage (Max) (Mhz)
ICC @ Nom Voltage (Max) (mA)
tpd @ Nom Voltage (Max) (ns)
Configuration
Type
IOL (Max) (mA)
IOH (Max) (mA)
Rating
Operating Temperature Range (C)
Package Group
Package Size: mm2:W x L (PKG)
Bits (#)
Digital input leakage (Max) (uA)
ESD Charged Device Model (kV)
ESD HBM (kV)
CD74HC138-Q1 CD54HC138 CD74HC138
Decoder ? ? Decoder/Demultiplexer ? ? Decoder
Demultiplexer ? ?
HC ? ? HC ? ? HC ? ?
2 ? ? 2 ? ? 2 ? ?
6 ? ? 6 ? ? 6 ? ?
1 ? ? 1 ? ? 1 ? ?
3.3
5 ? ?
3.3
5 ? ?
3.3
5 ? ?
28 ? ? 28 ? ? 28 ? ?
0.08 ? ? 0.08 ? ? 0.08 ? ?
30 ? ? 30 ? ? 30 ? ?
3:8 ? ? 3:8 ? ? 3:8 ? ?
Push-pull
Inverting
Non-inverting ? ?
Standard ? ? Standard ? ?
5.2 ? ? 5.2/-5.2 ? ? 5.2 ? ?
-5.2 ? ? ? -5.2 ? ?
Automotive ? ? Military ? ? Catalog ? ?
-40 to 125 ? ? -55 to 125 ? ? -55 to 125 ? ?
SOIC ? ? CDIP ? ? PDIP
SOIC ? ?
16SOIC: 59 mm2: 6 x 9.9(SOIC) ? ? See datasheet (CDIP) ? ? See datasheet (PDIP)
16SOIC: 59 mm2: 6 x 9.9(SOIC) ? ?
8 ? ? 8 ? ? 8 ? ?
5 ? ? 5 ? ? 5 ? ?
0.75 ? ? 0.75 ? ? 0.75 ? ?
2 ? ? 2 ? ? 2 ? ?

技術文檔

數據手冊(1)
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