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NVIDIA公布未來繪圖芯片的發(fā)展路線圖 7納米制程芯片將由臺積電代工

半導(dǎo)體動(dòng)態(tài) ? 來源:網(wǎng)絡(luò)整理 ? 作者:工程師吳畏 ? 2018-08-28 16:11 ? 次閱讀
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日前才正式發(fā)表新一代顯示卡的繪圖芯片大廠輝達(dá) (NVIDIA),日前又公告未來繪圖芯片的發(fā)展路線圖。其中,針對再下一代的代號 Ampere 的顯示卡,除了制程將升級到 7 納米節(jié)點(diǎn)之外,雖然性能還是未知數(shù),但是藉由 7 納米制程技術(shù)將會(huì)把繪圖芯片的芯片核心面積大幅降低,從現(xiàn)在 754㎜2 的 GV102 或者 TU102 的核心面積,將降低到 440㎜2 左右的核心面積。

根據(jù)國外科技網(wǎng)站《3DCenter》日前的報(bào)導(dǎo)指出,在 NVIDIA 自 2016 年到 2020 年的繪圖芯片路線圖中,可以看出當(dāng)前 Volta 及 Turing 的 12納米制程芯片,以及未來的 Ampere 的 7 納米制程芯片發(fā)展。其中,在 12 納米制程的 Volta 與 Turing 芯片中,目前主要有 3 種核心。GV100 的核心面積高達(dá) 815㎜2。而 GV102,也就是現(xiàn)在的 TU102 核心是 754㎜2。至于 GV014,也就是才剛發(fā)表的 TU104 核心面積,估算是來到 500㎜2 左右。

而在這樣的核心架構(gòu)下,雖然 12 納米制程節(jié)點(diǎn)的繪圖芯片架構(gòu)更適合高性能計(jì)算及 AI 運(yùn)算,而且 Turing 架構(gòu)的芯片還加入了游戲用的光線追蹤功能。但是,總體來說還是 Volta 的架構(gòu),芯片核心面積比 Pascal 大,成本也很高,對主流市場上的低階產(chǎn)品銷售不利。

因此,游戲玩家還是在等待下一代的 7 納米制程 Ampere 芯片。雖然,現(xiàn)在連影子都還沒看到。不過,《3DCenter》網(wǎng)站根據(jù) 7 納米制程的特點(diǎn)做了估算,使用新制程之后的繪圖芯片核心面積將會(huì)大幅降低,GA100 會(huì)降至 550㎜2 左右,GA102核心降至 440㎜2,GA104 核心更只有 290㎜2。另外,在主流市場的 GA106 只有 190㎜2、GA107 則是 120㎜2,入門級的 GA108 核心只有 67㎜2。因此,可說 7 納米繪圖芯片核心面積較上一代下降了大概 30% 到 40%,這對降低成本以及制造難度都有其幫助。

另外,預(yù)計(jì) NVIDIA 的 7 納米制程繪圖芯片也將是臺積電代工。而且根據(jù)臺積電的消息,與 16 納米制程技術(shù)相比,臺積電的 7 納米制程技術(shù)將提升 35% 的性能,降低 65% 的能耗。同時(shí)晶體管密度是之前的三倍。臺積電預(yù)計(jì) 2019 年初會(huì)推出內(nèi)含 EUV 技術(shù)的 7 納米 + 制程技術(shù),晶體管密度將會(huì)再提升 20%,功耗降低 10%。屆時(shí)也會(huì)把芯片的性能再提升,更適合用在高效能的圖形運(yùn)算上。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報(bào)投訴
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