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開源的AI MPU

eeDesigner ? 2025-04-02 17:44 ? 次閱讀
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1. 基于RISC-V的開源AI MPU/加速器?

?**(1) SiFive Intelligence系列**?

  • ?特點?:SiFive提供開源的RISC-V IP核,支持AI擴展指令集(如向量擴展V擴展、自定義指令)。
  • ?開源內容?:部分RISC-V核設計(如X280)可定制AI加速指令。
  • ?適用場景?:邊緣推理、TinyML。
  • ?鏈接?:SiFive GitHub

? (2) CORE-V(OpenHW Group) ?

  • ?特點?:開源RISC-V處理器家族,支持AI加速擴展(如DSP/向量指令)。
  • ?代表IP?:CV32E40P(支持自定義AI協處理器)。
  • ?適用場景?:低功耗嵌入式AI。
  • ?鏈接?:OpenHW Group

? (3) VEGA(ETH Zurich) ?

  • ?特點?:開源RISC-V SoC,集成自定義AI加速單元(支持INT8/FP16)。
  • ?性能?:1-4 TOPS(取決于配置)。
  • ?開源內容?:RTL代碼、工具鏈。
  • ?鏈接?:VEGA GitHub

?2. 開源AI加速器IP核?

? (1) NVDLA(NVIDIA Deep Learning Accelerator) ?

  • ?特點?:NVIDIA開源的深度學習加速器IP,支持CNN推理。
  • ?開源內容?:完整RTL代碼(Verilog)、編譯器工具鏈。
  • ?兼容性?:可集成到ARM/RISC-V SoC中。
  • ?局限?:僅支持推理,無訓練功能。
  • ?鏈接?:NVDLA GitHub

? (2) TENSAI(開源AI加速器) ?

  • ?特點?:輕量級開源AI加速器,支持INT8/FP16。
  • ?適用場景?:物聯網、邊緣設備。
  • ?開源內容?:RTL設計、測試用例。
  • ?鏈接?:TENSAI GitHub

? (3) OpenAI Accelerator(社區項目) ?

  • ?特點?:基于Chisel設計的開源AI加速器,支持靈活配置。
  • ?性能?:可擴展至多TOPS。
  • ?鏈接?:GitHub示例

? 3. 開源SoC平臺(集成AI加速) ?

? (1) PULP(Parallel Ultra Low Power) ?

  • ?特點?:蘇黎世聯邦理工學院(ETH)開源的RISC-V多核SoC平臺,支持AI加速擴展。
  • ?代表項目?:
    • ?GAP9?(GreenWaves商用芯片的學術版,開源RTL)
    • ?Hero?(集成自定義AI加速單元)
  • ?適用場景?:傳感器端AI、TinyML。
  • ?鏈接?:PULP Platform

? (2) OpenTitan(安全AI SoC) ?

  • ?特點?:谷歌支持的開源安全芯片項目,可集成AI加速模塊。
  • ?適用場景?:安全敏感的AI邊緣設備。
  • ?鏈接?:OpenTitan
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