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LMK1D120x 時鐘緩沖器能夠以超低的時鐘分配偏斜， 將兩個可選時鐘輸入（IN0 和 IN1）之一分配給 4 或 8 對差分 LVDS 時鐘輸出 （ OUT0 至 OUT7 ） 。 LMK1D12x 系列可接受兩個時鐘源傳入一個輸入多路 復用器。輸入可以為 LVDS、LVPECL、LP-HCSL、 HCSL、CML 或 LVCMOS。 LMK1D12x 專為驅動 50Ω 傳輸線路而設計。在以單端 模式驅動輸入的情況下，必須將圖 9-6 中所示的適當偏 置電壓施加到未使用的負輸入引腳。 IN_SEL 引腳用于選擇要發送到輸出的輸入。如果該引 腳保持開路，該引腳將禁用輸出（邏輯低電平）。該器 件支持失效防護功能。該器件還整合了輸入遲滯，可防 止在沒有輸入信號的情況下輸出隨機振蕩。
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