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針對高速率QPSK數據傳輸鏈系統，比較分析了數字中頻接收與零中頻接收的優、缺點，并提出了一種基于多相濾波的寬帶中頻正交采樣數字零中頻接收方案。基于FPGA對此數字零中頻正交變換方案進行了實現和驗證，同時，對一種全數字零中頻QPSK信號的高速解調算法及其FPGA硬件實現進行了介紹。
隨著現代通信技術的發展，對通信數據鏈路的傳輸速率及誤碼率的要求越來越高，高速率QPSK數據傳輸也應用在了衛星和地面站的饋電鏈路、無人機與地面的數據傳輸等多個領域。對于高速率QPSK調制系統，如何選擇較為優化的數字化接收及AD采樣方案并能保證高速解調和低誤碼率的要求，是需要研究和折衷的。
常用的接收機數字化方式有兩種：中頻數字化接收和零中頻數字化接收。中頻數字化接收對中頻信號進行采樣數字化，之后再進行數字下變頻和數字解調，避免了模擬解調器使用兩個乘法器引起的同相支路與正交支路幅度和相位不匹配對解調性能造成的影響，但其能處理的已調信號頻率受ADC采樣速率的限制；零中頻數字化接收在模擬端將接收信號轉換為I、Q兩路零中頻信號，之后再進行數字化和零中頻解調，由于是對基帶信號進行采樣，ADC的采樣速率可以大大降低，但由于模擬正交本振會導致I、Q兩路信號幅度和相位不匹配，而且由于射頻和本振之間的漏載導致混頻器之后產生直流偏置，而采用交流耦合抑制直流分壓的方式不能應用于QPSK方式，這都會導致解調性能的下降。本文提出了一種基于多相濾波的寬帶中頻正交采樣數字零中頻接收方案，并介紹了一種全數字零中頻解調算法，兼顧了中頻數字化解調和零中頻數字化解調的優點，不會產生模擬正交本振導致的I、Q信號幅度和相位不匹配，又可以降低ADC的采樣頻率，而且也降低了數字處理模塊時鐘速率，十分適用于高速率QPSK調制的數據接收和解調。
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