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      電子發燒友網>電子資料下載>DSP>ADS8323與高速FIFO接口電路的CPLD實現

      ADS8323與高速FIFO接口電路的CPLD實現

      2010-08-06 | rar | 128 | 次下載 | 5積分

      資料介紹

      以CPLD為邏輯控制核心實現了ADS8323與高速FIFO的接口電路，該電路具有可靠性高、通用性強、易于移植等特點。在設計過程中，以QuartusII作為開發環境，采用圖形輸入和Verilog HDL語言輸入相結合的方式，簡化了開發流程。
      ADS8323
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