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PLL1706 3.3V 雙路 PLL 多時鐘發生器

數據:

描述

PLL1705 很低成本,鎖相環(PLL)多鎖發生器。 PLL1705和PLL1706可以從27 MHz參考輸入頻率生成四個系統時鐘。 PLL1705的時鐘輸出可通過采樣頻率控制引腳進行控制,而PLL1706的時鐘輸出可通過串行模式控制引腳進行控制。該器件通過消除外部元件,為客戶提供成本和空間節省,使客戶能夠實現高性能音頻DAC和/或ADC所需的極低抖動性能。 PLL1705和PLL1706非常適合使用27-MHz主時鐘的MPEG-2應用,如DVD播放器,多媒體PC的DVD附加卡,數字高清電視系統和機頂盒。

特性

  • 27-MHz主時鐘輸入
  • 生成的音頻系統時鐘:
    • SCKO0:768 f < sub> S (f S = 44.1 kHz)
    • SCKO1:384 f S ,768 f S (f S = 44.1 kHz)
    • SCKO2:256 f S (f S = 32,44.1,48 ,64,88.2,96 kHz)
    • SCKO3:384 f S (f S = 32,44.1,48,64,88.2,96 kHz )
  • 零PPM錯誤輸出時鐘
  • 低時鐘抖動:50 ps(典型值)
  • 多個采樣頻率:
    • f S = 32,44.1,48,64,88.2,96 kHz
  • 3.3V單電源
  • PLL1705:并行控制
    PLL1706:串行控制
  • 封裝:20引腳SSOP(150 mil),無鉛產品
  • 應用
    • DVD播放器
    • 多媒體電腦的DVD附加卡
    • 數字高清電視系統
    • 機頂盒

PLL1705和PLL1706使用相同的芯片,除模式控制外,它們的電氣相同。

參數 與其它產品相比?音頻時鐘

?
Supply Voltage(s) (V)
Operating Temperature Range (C)
Pin/Package
Rating
PLL1706
3.3 ? ?
-25 to 85 ? ?
20SSOP ? ?
Catalog ? ?

技術文檔

數據手冊(1)
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