深度解析ADC3668/3669：高性能ADC的卓越之選

在電子設計領域，模擬到數字轉換器（ADC）的性能往往直接影響著整個系統的表現。今天，我們就來深入剖析一款備受關注的ADC產品——德州儀器（TI）的ADC3668和ADC3669。

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一、產品概述

ADC3668和ADC3669（統稱ADC366x）是16位、雙通道的ADC，采樣率分別可達250MSPS和500MSPS。這兩款產品專為實現高信噪比（SNR）而設計，噪聲頻譜密度低至 -160dBFS/Hz，在同類產品中表現卓越。其采用單核心（非交錯）ADC架構，孔徑抖動僅為75fs，為高精度信號轉換提供了有力保障。

二、關鍵特性

2.1 模擬輸入特性

• 可編程輸入阻抗：模擬輸入具有內部緩沖器，可將采樣電容的毛刺噪聲與外部輸入電路隔離開來。輸入阻抗可通過SPI寄存器編程設置為100Ω或200Ω的差分終端，輸入滿量程為2Vpp，共模電壓 (V_{CM}) 為1.4V。
• 寬輸入帶寬：全功率輸入帶寬（-3dB）達到1.4GHz，能夠處理高頻信號，適用于多種應用場景。
• Nyquist區選擇：內置數字誤差校正功能，可根據感興趣信號所在的Nyquist區進行優化。通過SPI寄存器選擇正確的輸入頻率范圍和Nyquist區，可實現最佳性能。
• 模擬前端設計建議：為優化ADC的SNR和HD3性能，建議在模擬輸入前端添加RCR電路。當輸入頻率低于或高于500MHz時，RCR電路的參數有所不同。若ADC由外部放大器驅動，則可能無需RCR電路。

2.2 采樣時鐘輸入

• 差分輸入設計：采樣時鐘輸入采用差分驅動方式，需外部交流耦合和終端匹配。ADC內部提供共模電壓偏置，內部采樣時鐘路徑設計旨在降低殘余相位噪聲。
• 時鐘噪聲特性：內部殘余時鐘噪聲由相位噪聲和幅度噪聲兩部分組成。相位噪聲隨輸入頻率和采樣率變化，而幅度噪聲則保持相對穩定。時鐘的幅度也會影響內部殘余時鐘噪聲，因此在設計時需要選擇合適的時鐘幅度。

2.3 多芯片同步

• 不同模式下的同步方式：在DDC旁路模式下，設備本身具有確定性延遲，可通過匹配各設備的時鐘走線實現外部多芯片同步。同時，可使用SYSREF信號重置內部RAMP測試模式。在DDC模式下，使用SYSREF信號將與抽取濾波器相關的內部模塊（如時鐘分頻器、NCO相位等）重置為確定性狀態，并通過匹配時鐘和SYSREF信號走線實現外部多芯片同步。
• SYSREF監控：設備內部設有SYSREF監控電路，用于檢測SYSREF信號在采樣瞬間附近的邏輯電平亞穩態，以避免設備間的對齊誤差。該電路可檢測SYSREF邏輯狀態轉換是否在采樣時鐘上升沿的 -60ps至 +140ps范圍內，并相應地觸發SYSREF XOR標志。

2.4 時間戳功能

ADC366x具備時間戳功能，可在DDC旁路模式下對模擬輸入的特定樣本進行標記。通過SPI使能該功能后，GPIO/SYSREF引腳的邏輯低到高轉換將在采樣時鐘的上升沿被記錄，并在DOUT0（LSB）通道輸出時間戳信號，但該信號與輸出數據的延遲不匹配。

2.5 過范圍指示

當信號超出可表示的數字范圍（最大代碼）時，設備會觸發過范圍指示。過范圍輸出可通過寄存器配置，指示方式有兩種：一是通過GPIO引腳，每個通道可使用一個GPIO OVR引腳，或使用一個GPIO引腳將兩個ADC的OVR信號進行OR運算；二是在LSB數據中，OVR信號可替代每個通道輸出數據的LSB。

2.6 外部電壓參考

為實現高精度和低溫度漂移，可通過GPIO1引腳為ADC提供外部1.2V電壓參考。建議在GPIO1和AGND引腳之間連接10μF和0.1μF的陶瓷旁路電容器，并盡量靠近引腳放置。

2.7 數字增益

設備為兩個通道都提供了可編程數字增益，可通過寄存器0x15B（CHA）和0x15C（CHB）進行設置。8位寄存器字段包含7位數據和1位符號位（2的補碼），實際增益（dB）計算公式為：20 x log (1 + (7位增益 / 128))。

2.8 抽取濾波器

• 多通道配置：ADC366x最多可提供四個數字下變頻器（DDC），通過交叉點開關和SPI寄存器設置，可將任意DDC連接到任意ADC或2x AVG模塊的輸出。雙頻段模式（2個DDC）支持 /2 至 /32768的抽取，而4個DDC模式下最小抽取比為 /4。
• 不同抽取方式：支持實抽取（單頻段）和復抽取，實抽取的通帶約為40%，復抽取的通帶約為80%。抽取功能可通過設置SPI寄存器（0x169, D3 - D0）來啟用，默認設置為實抽取，復抽取出通過寄存器 (0x162, D2) 啟用。
• 非均勻抽取比：DDC可被編程為具有不等的、獨立的抽取比，輸出數據速率基于抽取濾波器中最低的抽取比。抽取比高的DDC輸出樣本會在輸出數據流中相應重復。
• 抽取濾波器響應：復濾波器的通帶約為80%（-1dB），阻帶抑制至少為85dB。文檔中提供了不同抽取比下的濾波器響應曲線，展示了濾波器的通帶、過渡帶和阻帶特性。
• 抽取濾波器配置：數字抽取濾波器的操作可通過寄存器0x163至0x169控制，NCO頻率映射到寄存器0x200至0x2DF。通過一系列寄存器設置，可配置DDC以實現不同的工作模式，如固定NCO頻率或慢變化NCO頻率的靜態工作模式。

2.9 數字接口

• DDR LVDS接口：在DDC旁路模式下，使用16位寬的DDR LVDS接口輸出數據，利用輸出時鐘的上升沿和下降沿進行傳輸。輸出數據的ChA/ChB通道的DOUT0/1/2可被過范圍輸出OVR、PRBS位或時間戳信號替代，具體配置可通過寄存器實現。
• 串行LVDS（SLVDS）接口：在使用實抽取或復抽取時，輸出數據被序列化并通過較少的LVDS發射器傳輸。幀時鐘（FCLK）標記樣本的開始和結束，數據位在數據時鐘（DCLK）的上升沿和下降沿輸出。輸出接口映射默認從DOUT15開始，輸出通道數量和數據速率可根據相關參數計算。
• 輸出數據格式和分辨率：輸出數據格式可通過SPI寄存器設置為二進制補碼（默認）或偏移二進制格式。ADC366x支持16位和32位輸出分辨率，對于較高的抽取比（實抽取 /16 或更高、復抽取 /32 或更高），建議使用32位輸出分辨率以避免因量化噪聲限制導致的SNR下降。
• 輸出擾碼器和MUX：設備包含一個可選的輸出擾碼器，內部PRBS生成器生成的PRBS模式與每個數據位進行XOR運算，擾碼后的數據通過并行或串行LVDS傳輸，同時PRBS位可替代輸出數據的LSB、LSB - 1或LSB - 2。LVDS輸出接口還包括一個輸出MUX，可將任何內部數字通道重新路由到任何LVDS輸出通道，提供通道映射的靈活性，可用于鏈路冗余或修復。
• 測試模式：設備內置測試模式發生器，用于簡化LVDS輸出的調試和校準。啟用測試模式發生器后，會替代當前所有輸出數據樣本，測試模式對所有通道相同，可通過寄存器配置為不同的模式，如具有自定義步長的斜坡模式。

三、電氣特性

3.1 絕對最大額定值和ESD等級

文檔給出了ADC366x在不同工作條件下的絕對最大額定值，包括電源電壓范圍、輸入引腳電壓范圍、峰值RF輸入功率、結溫、存儲溫度等。同時，還給出了ESD等級，包括人體模型（HBM）和帶電器件模型（CDM）的ESD耐受電壓。

3.2 推薦工作條件和熱信息

列出了推薦的工作條件，包括電源電壓、工作環境溫度、工作結溫等。熱信息部分給出了各項熱指標，如結到環境的熱阻、結到頂部的熱阻、結到電路板的熱阻等，為散熱設計提供了重要參考。

3.3 電氣特性 - 功耗、直流和交流規格

詳細給出了不同采樣率下的功耗、直流規格和交流規格。功耗方面，展示了不同電源電壓下的供電電流和功耗，以及全局斷電模式下的功耗。直流規格包括無缺失碼、差分非線性（DNL）、積分非線性（INL）、失調誤差、失調漂移、增益誤差、增益漂移等。交流規格包括噪聲頻譜密度、噪聲系數、信噪比（SNR）、信號與噪聲和失真比（SINAD）、有效位數（ENOB）、總諧波失真（THD）、二次諧波失真（HD2）、三次諧波失真（HD3）、無雜散動態范圍（SFDR）、雙音互調失真（IMD3）等。

3.4 典型特性曲線

提供了大量的典型特性曲線，展示了ADC3668和ADC3669在不同工作條件下的性能表現。這些曲線包括不同輸入頻率下的頻譜、AC性能與輸入頻率、采樣率、時鐘占空比、電源電壓、共模電壓、環境溫度等參數的關系，以及DNL、INL、直流偏移直方圖、脈沖響應等特性。

四、應用與實現

4.1 應用領域

ADC366x適用于多種應用領域，包括雷達、頻域數字化儀、頻譜分析儀、測試和通信設備以及軟件定義無線電（SDR）等。

4.2 典型應用 - 寬帶頻譜分析儀

詳細介紹了寬帶頻譜分析儀的典型配置，包括輸入信號路徑、時鐘設計和詳細的設計步驟。輸入信號路徑需要使用適當的帶限濾波器來抑制不需要的頻率，使用平衡變壓器將單端RF輸入轉換為差分輸入，并進行交流耦合。時鐘輸入必須進行交流耦合，時鐘源應具有低抖動，可使用帶通濾波器去除部分寬帶時鐘噪聲。在多通道系統中，SYSREF信號可使用LMK04828或LMK04832設備生成。

4.3 詳細設計步驟

• 采樣時鐘：為了最大化ADC的SNR性能，需要一個低抖動（< 75fs）的采樣時鐘。文檔展示了SNR與輸入頻率、外部時鐘抖動和時鐘幅度的關系曲線，同時說明了在使用平均和/或抽取時，需要先估計單個ADC核心的SNR，再考慮內部平均和/或抽取帶來的SNR改善。
• 初始化設置：上電后，需要通過在RESET引腳施加高脈沖來對內部寄存器進行硬件復位，將其初始化為默認值。文檔給出了詳細的上電時序和寄存器初始化步驟，以及在需要時使用SPI對內部寄存器進行編程的方法。

4.4 電源供應建議和布局

• 電源供應：ADC需要四種不同的電源供應，AVDD18和AVDD12為內部模擬和時鐘電路供電，DVDD18和DVDD12為數字邏輯和LVDS數字接口供電。電源序列需要按照特定順序進行，并且電源需要低噪聲以實現數據手冊中的性能。建議使用高效降壓開關穩壓器和低噪聲LDO進行兩級穩壓，同時在引腳附近放置去耦電容。
• 布局：在電路板設計中，對于模擬輸入和時鐘信號、數字LVDS輸出接口以及電源和接地連接有特定的布局要求。模擬輸入和時鐘信號的走線應盡量短，避免過孔，采用松散耦合的100Ω差分走線，并盡量匹配差分走線長度。數字LVDS輸出接口應采用緊密耦合的100Ω差分走線。電源和接地連接應提供低電阻路徑，使用電源和接地平面，避免窄的、孤立的路徑。

五、總結

ADC3668和ADC3669憑借其卓越的性能、豐富的功能和靈活的配置，為電子工程師在設計高性能數據采集系統時提供了一個強大的選擇。無論是在雷達、通信、測試測量還是其他領域，這兩款ADC都有望發揮重要作用。在實際應用中，工程師需要根據具體需求，合理設計輸入電路、時鐘電路、電源電路和布局，以充分發揮ADC的性能優勢。同時，通過對文檔中提供的各種數據和曲線的分析，工程師可以更好地理解ADC的工作特性，為系統設計提供有力支持。大家在使用過程中有遇到什么問題，或者有更好的應用經驗，歡迎在評論區分享交流。