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ADC3421-Q1 汽車四通道 12 位 25MSPS 模數轉換器

科技綠洲 ? 2025-11-03 15:33 ? 次閱讀
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ADC3421-Q1 是一款汽車級、高線性度、超低功耗、四通道、12 位、25 MSPS 模數轉換器ADC)。該器件專為支持具有大動態范圍要求的高輸入頻率信號而設計。輸入時鐘分頻器為系統時鐘架構設計提供了更大的靈活性,SYSREF 輸入可實現完整的系統同步。ADC3421-Q1 支持串行低壓差分信號 (LVDS),以減少接口線的數量,從而實現高系統集成密度。串行 LVDS 接口為兩線,其中每個 ADC 數據都經過兩個 LVDS 對串行化和輸出。內部鎖相環 (PLL) 將輸入的 ADC 采樣時鐘相乘,以得出用于序列化每個通道的 12 位輸出數據的位時鐘。除了串行數據流外,幀和位時鐘也作為LVDS輸出傳輸。
*附件:adc3421-q1.pdf

特性

  • 符合 AEC-Q100 標準,適用于汽車應用
    • 溫度等級 1:–40°C 至 125°C T一個
  • 四通道
  • 12 位分辨率
  • 單電源:1.8 V
  • 串行LVDS接口
  • 靈活的輸入時鐘緩沖器,具有1、-2、-4分頻功能
  • SNR = 71.1 dBFS,SFDR = 90 dBc(f = 10兆赫
  • 超低功耗:
    • 44 mW/通道,25 MSPS
  • 信道隔離度:105 dB
  • 內部抖動器和斬波器
  • 支持多芯片同步

參數

image.png

方框圖

image.png
ADC3421-Q1 是德州儀器推出的車規級四通道 12 位模數轉換器(ADC),核心優勢為高線性度、超低功耗、寬輸入帶寬及多芯片同步能力,符合 AEC-Q100 標準,專為固態激光雷達(LiDAR)、電機控制反饋、雷達等汽車及工業高頻信號采集場景設計。

核心參數與特性

  1. 通道與采樣性能:四通道同步采樣,12 位分辨率,最高采樣速率 25 MSPS;積分非線性(INL)±0.15 LSB,微分非線性(DNL)±0.15 LSB,無丟失碼,線性度優異。
  2. 信號與帶寬性能:10 MHz 輸入時信噪比(SNR)71.1 dBFS,無雜散動態范圍(SFDR)90 dBc,總諧波失真(THD)-89 dBc;模擬輸入帶寬達 540 MHz,支持高頻信號采集;通道隔離度 105 dB,串擾抑制能力強。
  3. 功耗與封裝:單 1.8 V 供電,每通道功耗僅 44 mW(25 MSPS),總功耗典型值 177 mW;采用 56 引腳 VQFNP 封裝(8mm×8mm),工作溫度范圍 -40°C 至 125°C,滿足車規級溫度要求。
  4. 接口與同步:支持串行 LVDS 接口(1 線 / 2 線模式),減少接口線數;內置時鐘分頻器(1/2/4 分頻),靈活適配系統時鐘架構;SYSREF 輸入支持多芯片同步,提升多通道一致性。
  5. 附加功能:內置抖動(Dither)和斬波(Chopper)功能,優化低頻率噪聲性能;支持全局掉電和待機模式,喚醒時間分別為 85 μs 和 35 μs;集成溫度傳感器和診斷模塊,提升系統可靠性。

核心功能模塊

  • 采樣與信號調理:四通道獨立 12 位 ADC 核心,差分輸入設計,滿量程輸入范圍 2 Vpp;內置抖動算法優化 SFDR,斬波功能抑制 1/f 噪聲,適配高低頻信號采集。
  • 時鐘與同步:差分時鐘輸入(支持正弦波、LVPECL、LVDS 等格式),內置 PLL 生成位時鐘用于數據串行化;時鐘分頻器可降低系統時鐘設計復雜度,SYSREF 信號實現多芯片同步。
  • 數據輸出接口:LVDS 串行輸出,支持 6 倍(2 線模式)或 12 倍(1 線模式)序列化,位時鐘頻率最高 150 MHz;輸出數據格式支持二進制補碼或偏移二進制,可通過寄存器配置。
  • 功耗與診斷:支持全局掉電(功耗 5 mW)、待機(34 mW)和單通道掉電模式;集成溫度傳感器、均值 / 方差統計模塊、DC 輸入測試等診斷功能,可監測內部參考電壓和時鐘狀態。

應用場景

適用于汽車固態激光雷達(LiDAR)、電機控制反饋、無損檢測設備、雷達與智能天線陣列、彈藥制導系統等,尤其適配對高頻信號采集、低功耗、高可靠性有要求的車規級和工業級場景。

設計要點

  1. 接口配置:LVDS 輸出需外接 100 Ω 終端電阻,確保信號完整性;SPI 接口用于寄存器配置(最高 20 MHz 時鐘),支持測試模式、掉電控制等功能配置。
  2. 電源與時鐘:模擬電源(AVDD)和數字電源(DVDD)均為 1.7 V-1.9 V,需就近放置 0.1 μF 去耦電容,電源紋波需控制在 10 mV 以內;時鐘源需低抖動(推薦外部時鐘抖動 < 50 fs),高頻采樣時建議使用帶通濾波優化時鐘質量。
  3. 輸入電路:差分輸入需匹配 50 Ω 阻抗,高頻輸入(>230 MHz)建議串聯 10 Ω 電阻抑制振鈴;輸入共模電壓需匹配 VCM 引腳輸出(0.95 V),避免信號失真。
  4. 布局規范:PCB 需嚴格區分模擬區與數字區,模擬輸入線路遠離數字輸出和時鐘線路,減少串擾;電源引腳與去耦電容間無過孔,熱焊盤接地提升散熱;LVDS 信號線長度匹配,避免時序 skew。
聲明:本文內容及配圖由入駐作者撰寫或者入駐合作網站授權轉載。文章觀點僅代表作者本人,不代表電子發燒友網立場。文章及其配圖僅供工程師學習之用,如有內容侵權或者其他違規問題,請聯系本站處理。 舉報投訴
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