上拉電阻是一個電阻，它通常被連接到電路中的高電平值，以提供一個上拉電壓。這個電阻的作用是限制電流的流動，同時為電路提供高電平值。
在CMOS電路中，輸出驅動能力有限，輸出的高電平標準值是VCC。如果不需要這個高電平，在輸出端口接上拉電阻可以提高抗干擾的能力。一般選擇上拉電阻的阻值時要考慮上拉電壓、輸出驅動能力等多個因素。
上拉電阻的使用方法如下：
當TTL電路驅動COMS電路時，如果TTL電路輸出的高電平低于COMS電路的最低高電平（一般為3.5V），這時就需要在TTL的輸出端接上拉電阻，以提高輸出高電平的值。
OC門電路必須加上拉電阻，以將開關輸出改成電平輸出。
為加大輸出引腳的驅動能力，有的單片機管腳上也常使用上拉電阻。
在COMS芯片上，為了防止靜電造成損壞，不用的管腳不能懸空，一般接上拉電阻產生降低輸入阻抗，提供泄荷通路。
芯片的管腳加上拉電阻來提高輸出電平，從而提高芯片輸入信號的噪聲容限增強抗干擾能力。
提高總線的抗電磁干擾能力。管腳懸空就比較容易接受外界的電磁干擾。
長線傳輸中電阻不匹配容易引起反射波干擾，加上下拉電阻是電阻匹配，有效的抑制反射波干擾。
上拉電阻阻值的選擇原則包括：綜合考慮上拉電路的供電電壓、負載電流、與下拉電阻的匹配等，通常在1k到10k之間選取。