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如何獲取和使用Github上的開放資源

OpenFPGA ? 來(lái)源:XILINX開發(fā)者社區(qū) ? 作者: Yang Chen ? 2021-04-09 11:51 ? 次閱讀
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自從 Vitis 發(fā)布后,Xilinx 在 Github 上持續(xù)開源了很多資源,方便開發(fā)者進(jìn)行自己的設(shè)計(jì),減少產(chǎn)品上市時(shí)間。所以本期文章我們來(lái)看下如何獲取和使用 Github 上的開放資源。

1. 在 Vitis IDE 上的使用方法:

以 Vitis_example 為例,

Vitis IDE 是基于 eclipse 開發(fā)而成的,Xilinx 在此基礎(chǔ)上添加了很多自己的功能。在 Vitis IDE上使用 Vitis example 的方法相對(duì)簡(jiǎn)單,具體的操作如下:

1)。 Vitis IDE 下載方式

Xilinx-》Examples-》Download

4ef87c06-986f-11eb-8b86-12bb97331649.png

等待一段時(shí)間后,下載完成后的界面如下圖所示。

4f4f2f1a-986f-11eb-8b86-12bb97331649.png

有的用戶會(huì)遇到下載失敗的情況,最典型的錯(cuò)誤: fatal unableto find remote helper for ‘https’這個(gè)其實(shí)跟git的設(shè)置或缺少庫(kù)有關(guān),可以參考

如果還有其他問(wèn)題,也可以在我們的中文論壇上尋求幫助。

2)。 當(dāng)你新建application工程之后你就會(huì)看到下載的 exampledesign,選擇并點(diǎn)擊 finish 即可。

4f8bf3d2-986f-11eb-8b86-12bb97331649.png

2. 基于makefile的使用方法:

有些軟件開發(fā)者更趨向基于 makefile 的命令行方式來(lái)進(jìn)行開發(fā),它的優(yōu)點(diǎn)是更加靈活,但是對(duì)Vitis的理解有要求,具體如下:

1)。 下載 example design:

4fa52992-986f-11eb-8b86-12bb97331649.png

或使用命令:

git clone https://github.com/Xilinx/Vitis_Accel_Examples.git

2)。 進(jìn)入文件目錄,例如 hello_world,可以先輸入 make,獲取 make 指令的用途和選項(xiàng):

50acdb50-986f-11eb-8b86-12bb97331649.png

3)。 根據(jù)我們安裝的 platform,在這里我們使用的是 u50 板卡。我們可以該目錄下輸入:

make all TARGET=sw_emu DEVICE=xilinx_u50_xdma_201920_3

可以得到示例工程生成的目標(biāo)文件。

51bd92b4-986f-11eb-8b86-12bb97331649.png

當(dāng)然在此之前我們要確認(rèn)這個(gè) example design 支持的 platform 有沒(méi)有限制,所以推薦先閱讀一下各個(gè)示例的 README.rst

https://github.com/Xilinx/Vitis_Accel_Examples/tree/master/hello_world

4)。 當(dāng)我們生成完所需的目標(biāo)文件后,我們可以進(jìn)行軟件仿真(硬件仿真,硬件)運(yùn)行。可以輸入:

make run TARGET=sw_emu DEVICE=xilinx_u50_xdma_201920_3

會(huì)輸出如下:

5222056e-986f-11eb-8b86-12bb97331649.png

可以看到 TEST PASSED,代表軟件仿真已經(jīng)通過(guò)。

5)。 如果要觀察仿真的結(jié)果或者報(bào)告分析,我們?cè)谀繕?biāo)生成目錄下可以命令啟動(dòng) Vitisanalyzer (vitis acceleration 流程只支持 Linux 操作系統(tǒng)):

vitis_analyzer 。/

它會(huì)自動(dòng)索引目錄下的 summary 文件,并且提供 GUI 化的可視界面,幫助用戶分析性能和評(píng)估板卡:

524d0750-986f-11eb-8b86-12bb97331649.png

附:如果你對(duì) V++ 熟悉的話,也可以根據(jù)自己的需求直接修改 makefile 文件和相關(guān)的 .ini 配置文件:

52a66c64-986f-11eb-8b86-12bb97331649.png

總結(jié)

以上就是使用 Vitis example 的兩類方法。

在前面圖片中 library 跟 example 出現(xiàn)在一起,Vitis library 是 Xilinx 提供的開源庫(kù),更趨近于不同專業(yè)領(lǐng)域的開發(fā)方向

并且其提供了測(cè)試工程示例,具體使用方法跟 vitis example 類似。
編輯:lyn

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原文標(biāo)題:如何獲取 Github 上Xilinx Vitis, Vitis 庫(kù)等資源

文章出處:【微信號(hào):Open_FPGA,微信公眾號(hào):OpenFPGA】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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