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Alveo加速器卡上的自適應比特率轉碼

YCqV_FPGA_EETre ? 來源:FPGA開發圈 ? 2020-07-01 14:52 ? 次閱讀
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介 紹

對實時視頻流的需求已發展成為一項至關重要的業務需求。視頻服務提供商面臨著艱難的權衡取舍,因為他們必須在管理基礎設施和運營成本的同時,還要為客戶提供高質量體驗。鑒于視頻轉換的計算強度,轉碼不斷推升對靈活應變硬件加速的需求。

賽靈思已開發出一款高性能視頻轉碼包,無需改變現有基礎設施即可為服務提供商提供所需低功耗與優異性能。 此外,該解決方案采用業經驗證的非常強大的 FFmpeg 命令行處理模式,方便任何人開發轉碼應用并將其與現有應用或自有基礎設施輕松集成。

產品簡介

賽靈思面向低比特率(Alveo U50)或高密度應用(Alveo U30)實現最高質量的實時編碼,并且以最低的主機 CPU 需求加速編碼。另外,在 Alveo U50 和 U30 加速器卡上使用 ABR 階梯提供 HEVC 和 H.264 編碼流以及基于行業標準 FFmpeg 的簡單 API

圖 1:轉碼 ABR 階梯示例

智能分區

賽靈思可以提供系統級最高性能。通過從 CPU 卸載編碼任務,確保 CPU 能夠為音頻和廣告插入等其他關鍵功能提供支持。

通過提供對 FFmpeg API 的支持,客戶能夠輕松地將多達 8 個 Alveo HHHL U50 或 U30 加速器卡和軟件集成到其 1 RU 服務器中。

圖 2:從內容生成器將數據流轉碼到消費端

優勢與特性

實時編碼可實現媲美 x265“慢速”預置編碼的畫質

U50 支持面向海量觀眾廣播的最低水平比特率編碼

低比特率 = 最低互聯網帶寬成本

在需要大量編碼器時實現高密度編碼,如用戶生成內容 (UGC)

與 CPU 相比功耗下降 10 倍

GPU 相比功耗下降 2 倍

采用高級定標器,提供完整的 ABR 階梯支持

靈活的多 ABR 階梯輸出,單個實例最多 32 個流

輸出質量保持一致,與編碼通道數量無關

用于解碼器、定標器和編碼器的 FFmpeg 插件

HEVC:主 10 配置文件,級別可達 5.1 HD/SD,U50:40 8 位,U30:42 10 位

H.264:主 10 配置文件,級別可達 5.1 HD/SD,U50:40 8 位,U30:40 10 位

恒定比特率 (CBR)、受限 VBR 和 ABR 模式

比特率:100Kb/s 到 40Mb/s 可配置

時延:30ms 到 20s 可配置

片類型:I、P 和 B,提供靈活的開放/閉合 GOP 模式和 GOP 長度

聲明:本文內容及配圖由入駐作者撰寫或者入駐合作網站授權轉載。文章觀點僅代表作者本人,不代表電子發燒友網立場。文章及其配圖僅供工程師學習之用,如有內容侵權或者其他違規問題,請聯系本站處理。 舉報投訴
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原文標題:Xilinx 視頻實時轉碼一體機解密系列三:Alveo 加速器卡上的自適應比特率轉碼

文章出處:【微信號:FPGA-EETrend,微信公眾號:FPGA開發圈】歡迎添加關注!文章轉載請注明出處。

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