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      電子發燒友網>電子資料下載>電子論文>模擬數字論文>消除高速串行鏈路的時鐘抖動

      消除高速串行鏈路的時鐘抖動

      2010-08-20 | rar | 621 | 次下載 | 5積分

      資料介紹

      隨著新一代串行數據標準成功地從快速過渡到超高速，設計人員需要花費大量時間考慮這些高速信號的模擬設計，只是簡單關注1、0數字域信號遠遠不能滿足實際要求。為了找到潛在的問題并加以解決，從而避免現場應用出現這些問題，設計人員必須檢查實際設計參數。信號完整性(SI)工程師必須降低或消除時鐘抖動對系統性能的影響。本文討論了針對典型速率為1Gbps或更高速率的高速串行數據鏈路的簡單、實用方法。
      抖動 時鐘
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