資料介紹
三維芯片( 3DSIC)通過硅通孔TSV技術實現電路的垂直互連,有效提高了系統集成度和整體性能。由于三維芯片測試中,用于測試的引腳數和TSV數目以及測試時功耗的限制都對測試時間有很大的影響,擬提出一種裝箱問題思想的測試方案,針對每層只有一個晶片的“單塔”結構和每層有多個晶片的“多塔”結構進行測試調度優化。該優化方案在控制測試引腳數、測試TSV數目與測試功耗的同時,能有效縮短測試時間。實驗結果表明,與同類方案相比,在多種限制條件和不同結構中,都有著顯著的優化結果。其中“單塔”最高優化45. 28%的測試時間,“多塔”最高優化了27. 78%的測試時間。

三維
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