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      電子發燒友網>電子資料下載>電子資料>CDCL1810 1.8V 10路輸出高性能時鐘分配器數據表

      CDCL1810 1.8V 10路輸出高性能時鐘分配器數據表

      2024-08-22 | pdf | 1.42MB | 次下載 | 免費

      資料介紹

      CDCL1810是一款高性能時鐘分配器。可編程分頻器PO和P1為輸出頻率與輸入頻率之比提供了高度的靈活性:Four = FiN/P，其中:P (P0，P1) = 1，2，4，5，8，10，16，20，32，40，80。cdcl 1810支持一個差分LVDS時鐘輸入和總共10個差分CML輸出。如果交流耦合，CML輸出與LVDS接收機兼容。所有器件設置均可通過ada/SCL串行雙線接口進行編程。串行接口只能承受1.8V電壓。一個輸出組相對于另一個輸出組的相位可以通過SDA/SCL接口進行調整。對于5的倍數的后分頻比(P0，P1)，相位調整步長總數(n)等于分頻比除以5。對于不是5的倍數的后分頻比(P0，P1)，總級數(n)與后分頻比相同。以時間單位表示的相位調整步長(Ao)為:Ap = 1/(n×4)，其中4為相應的輸出頻率。
      時鐘 分配器
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