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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的并行RICE解碼結(jié)構(gòu)設(shè)計(jì)方案

      基于FPGA的并行RICE解碼結(jié)構(gòu)設(shè)計(jì)方案

      2021-06-01 | pdf | 4.09 MB | 次下載 | 免費(fèi)

      資料介紹

      　　RICE算法在無損壓縮系統(tǒng)有著廣泛的應(yīng)用。由于RICE算法采用了變長的自適應(yīng)熵編碼，因此在解碼時(shí)需要對壓縮流進(jìn)行逐位判斷和解析，這給高速解壓縮的實(shí)現(xiàn)帶來了困難。現(xiàn)有的RICE解碼實(shí)現(xiàn)在解碼速度和通用性上都不理想。針對RICE算法中自適應(yīng)熵編碼的特點(diǎn)，設(shè)計(jì)了一種基于有限狀態(tài)機(jī)和查找表的并行RICE解碼結(jié)構(gòu)，可在FPGA上完成8比特寬度的并行解碼，解碼速度最高可達(dá)176MB/s;同時(shí)，該解碼結(jié)構(gòu)適用于編碼參數(shù)k變化的情況，具有很強(qiáng)的通用性。

      FPGA 算法 解碼
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