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      電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>一種在FPGA上實現的FIR濾波器的資源優化算法

      一種在FPGA上實現的FIR濾波器的資源優化算法

      2015-08-24 | pdf | 1036KB | 次下載 | 免費

      資料介紹

      本文提出了一種基于RAG算法的FIR濾波器，與傳統的基于DA算法的濾波器結構的濾波器相比，RAG算法簡化了FIR濾波器乘法模塊的結構，減少了邏輯資源的消耗和硬件實現面積，提高了計算速度。本文設計的16階FIR濾波器用VerilogHDL進行描述，并綜合到Altera公司的CycloneⅡ系列FPGA中。仿真實驗表明基于RAG算法的FIR濾波器達到了邏輯資源的節約和運算速度的提高的整體優化效果。
      數字信號處理 fir濾波器 RAG算法 DA算法
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