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原標題：Nonblocking Assignments in Verilog Synthesis, Coding Styles That Kill!
ATTN：所有括號內“外注”為理解方便或有疑問的地方，原文里并沒有。所有翻譯都是為遵循“共同進步”的理想但并沒有去努力得到原作者的任何書面和其它方式許可，所以僅供大家參考。本人英文和設計水平都極有限，所以不能保證與原文的精確一致和正確（只能以“駑馬十步”稍作安慰吧），慚愧之后還希望大家多指教！
在Verilog語言最難弄明白的結構中“非阻塞賦值”要算一個。甚至是一些很有經驗的工程師也不完全明白“非阻塞賦值”在仿真器（符合IEEE標準的）里是怎樣被設定執行的，以及什么時候該用“非阻塞賦值”。這篇文章將介紹怎樣設定“非阻塞賦值”和“阻塞賦值”，給出了重要的使得編碼可以被正確地綜合的編碼指導方針，和避免仿真競爭的編碼風格細節。
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