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的外部電阻值實現,以實現2 V /μs轉換SN65HVD230M的電路進入低電流待機模式,在此期間驅動器關閉,如果對R S 施加高邏輯電平,接收器保持有效(第8針)。當總線上出現顯性狀態(典型的總線差分電壓> 900 mV)時,DSP控制器會反轉這種低電流待機模式。
高達1兆比特/秒(Mbps)