ROHM BD9G341EFJ：高性能降壓轉(zhuǎn)換器的全面解析

在電子設(shè)備的電源管理領(lǐng)域，降壓轉(zhuǎn)換器是至關(guān)重要的組件，它能將較高的輸入電壓轉(zhuǎn)換為穩(wěn)定的較低輸出電壓，以滿足不同電子設(shè)備的需求。ROHM的BD9G341EFJ就是這樣一款性能出色的降壓轉(zhuǎn)換器，下面我們就來深入了解一下它。

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產(chǎn)品概述

BD9G341EFJ是一款集成了150mΩ功率MOSFET的降壓開關(guān)穩(wěn)壓器。它采用電流模式架構(gòu)，具有快速的瞬態(tài)響應(yīng)和簡單的相位補(bǔ)償設(shè)置。其工作頻率可在50kHz至750kHz之間進(jìn)行編程，并且具備過流保護(hù)（OCP）、熱關(guān)斷（TSD）和欠壓鎖定（UVLO）等多種保護(hù)功能。欠壓鎖定和遲滯可以通過外部電阻進(jìn)行設(shè)置。

關(guān)鍵規(guī)格

封裝形式

采用HTSOP - J8封裝，尺寸為4.90mm x 6.00mm x 1.00mm。

產(chǎn)品特點(diǎn)

• 寬輸入電壓范圍：支持12V至76V的輸入電壓，適用于多種電源環(huán)境。
• 集成NchFET：集成了80V/3.5A/150mΩ的NchFET，提高了效率和功率密度。
• 電流模式控制：提供快速的瞬態(tài)響應(yīng)和簡單的相位補(bǔ)償設(shè)置。
• 可變頻率：工作頻率可在50kHz至750kHz之間編程，靈活性高。
• 精確的參考電壓：參考電壓為1.0V ± 1.5%，保證了輸出電壓的穩(wěn)定性。
• 精密EN閾值：精度為±3%，可實(shí)現(xiàn)精確的開關(guān)控制。
• 軟啟動功能：防止啟動時(shí)的浪涌電流，保護(hù)電路元件。
• 零待機(jī)電流：在待機(jī)狀態(tài)下功耗極低。
• 多種保護(hù)功能：具備過流保護(hù)、欠壓鎖定、熱關(guān)斷和過壓保護(hù)等功能，提高了系統(tǒng)的可靠性。
• 散熱增強(qiáng)封裝：HTSOP - J8封裝有助于散熱，提高了產(chǎn)品的穩(wěn)定性。

應(yīng)用領(lǐng)域

• 工業(yè)分布式電源應(yīng)用：為工業(yè)設(shè)備提供穩(wěn)定的電源。
• 汽車應(yīng)用：滿足汽車電子系統(tǒng)的電源需求。
• 電池供電設(shè)備：延長電池使用壽命，提高設(shè)備的續(xù)航能力。

引腳配置與功能

引腳配置

引腳功能詳解

• LX引腳：作為開關(guān)節(jié)點(diǎn)，它的連接位置對于減少電磁干擾和提高效率至關(guān)重要。在實(shí)際設(shè)計(jì)中，要確保其與肖特基勢壘二極管和電感器的連接盡可能短，以降低寄生電感和電阻的影響。
• EN引腳：通過控制該引腳的電壓，可以方便地實(shí)現(xiàn)穩(wěn)壓器的開啟和關(guān)閉，以及待機(jī)模式的切換。在一些需要節(jié)能的應(yīng)用中，合理使用EN引腳可以有效降低功耗。
• RT引腳：通過調(diào)整連接在該引腳和GND之間的電阻值，可以靈活地設(shè)置內(nèi)部振蕩器的頻率。這對于優(yōu)化電路性能和滿足不同應(yīng)用的需求非常有用。

內(nèi)部模塊與工作原理

參考模塊

該模塊產(chǎn)生內(nèi)部參考電壓，為整個(gè)電路提供穩(wěn)定的基準(zhǔn)。

REG模塊

產(chǎn)生8V的自舉參考電壓，用于驅(qū)動MOSFET。

OSC模塊

產(chǎn)生內(nèi)部時(shí)鐘信號，內(nèi)部振蕩器通過連接在RT引腳和GND引腳之間的單個(gè)電阻進(jìn)行設(shè)置，推薦頻率范圍為50kHz至750kHz。當(dāng)RT引腳連接47kΩ電阻時(shí)，頻率設(shè)置為200kHz。

軟啟動模塊

在啟動過程中，軟啟動模塊可以防止浪涌電流的產(chǎn)生，保護(hù)電路元件。軟啟動時(shí)間典型值為20msec。

誤差放大器模塊

檢測輸出信號，并輸出PWM控制信號，內(nèi)部參考電壓設(shè)置為1.0V。

ICOMP模塊

作為比較器，根據(jù)電流反饋信號和誤差放大器的輸出產(chǎn)生PWM信號，實(shí)現(xiàn)電流模式控制。

Nch FET SW模塊

這是一個(gè)80V/150mΩ的功率Nch MOSFET開關(guān)，用于轉(zhuǎn)換DC/DC轉(zhuǎn)換器的電感電流。由于該FET的電流額定值為3.5A，因此在使用時(shí)應(yīng)確保包括線圈的直流電流和紋波電流在內(nèi)的總電流不超過3.5A。

UVLO模塊

這是一個(gè)低壓誤差預(yù)防電路，用于防止電源電壓上升和下降過程中內(nèi)部電路出現(xiàn)誤差。它監(jiān)測VCC引腳電壓和內(nèi)部REG電壓，當(dāng)VCC電壓降至11V及以下時(shí)，UVLO會關(guān)閉所有輸出FET，并關(guān)閉DC/DC比較器輸出，同時(shí)軟啟動電路復(fù)位。該閾值具有200mV的遲滯。

OCP模塊

當(dāng)功率MOSFET的電流超過6.0A（典型值）時(shí)，該功能會逐脈沖減小占空比，限制過電流。如果IC連續(xù)兩次檢測到OCP，設(shè)備將停止工作，并在20msec后重新啟動。

TSD模塊

當(dāng)檢測到結(jié)溫超過最大結(jié)溫（Tj = 150℃）時(shí)，該模塊會關(guān)閉所有輸出FET，并關(guān)閉DC/DC比較器輸出。當(dāng)溫度下降時(shí)，IC會自動恢復(fù)正常工作。

OVP模塊

通過FB端子監(jiān)測輸出電壓，當(dāng)輸出電壓達(dá)到設(shè)定電壓的120%時(shí)，關(guān)閉輸出FET，實(shí)現(xiàn)過壓保護(hù)。

電氣特性與性能曲線

電氣特性

性能曲線

通過一系列的性能曲線，我們可以直觀地了解BD9G341EFJ在不同條件下的性能表現(xiàn)，例如振蕩器頻率與溫度的關(guān)系、FB閾值電壓與輸入電壓和溫度的關(guān)系、強(qiáng)制關(guān)斷時(shí)間與溫度的關(guān)系等。這些曲線為工程師在實(shí)際設(shè)計(jì)中提供了重要的參考依據(jù)。

應(yīng)用電路設(shè)計(jì)

典型應(yīng)用電路

文檔中給出了Vout = 5V和Vout = 3.3V兩種典型應(yīng)用電路的示例，包括元件選型和電路參數(shù)。在設(shè)計(jì)應(yīng)用電路時(shí)，需要根據(jù)具體的需求選擇合適的元件。

元件選擇方法

電感器

推薦使用屏蔽型、滿足電流額定值且DCR較低的電感器。電感值會影響電感紋波電流和輸出紋波，通過增大電感值或提高開關(guān)頻率可以減小紋波電流。設(shè)計(jì)時(shí)，電感紋波電流的設(shè)計(jì)值可暫定為最大輸入電流的20% - 50%。在BD9G341EFJ中，推薦使用4.7μH - 33μH的電感，如SUMIDA CDRH127H系列。

輸出電容

為了降低輸出紋波，推薦使用ESR較低的陶瓷電容。同時(shí)，在選擇電容額定值時(shí)，要考慮DC偏置特性，并確保其最大額定值相對于輸出電壓有足夠的余量。輸出紋波電壓可以通過公式 (V{PP}=Delta IL × frac{1}{2 pi × f × C{OUT}}+Delta IL × R_{ESR}) 計(jì)算，設(shè)計(jì)時(shí)應(yīng)使其保持在電容紋波電壓范圍內(nèi)。在BD9G341EFJ中，推薦使用10μF以上的陶瓷電容。

輸出電壓設(shè)置

內(nèi)部誤差放大器的參考電壓為1.0V，輸出電壓可以通過公式 (V_{OUT} =frac{R_1+R_2}{R_2}) 確定。

自舉電容

在BST引腳和Lx引腳之間連接0.1uF的層壓陶瓷電容。

續(xù)流二極管

在Lx引腳和GND引腳之間連接外部續(xù)流二極管，二極管的反向電壓應(yīng)高于Lx引腳的最大電壓（VCCMAX + 0.5V），峰值電流應(yīng)高于IOUTMAX +⊿IL。

輸入電容

BD9G341EFJ需要一個(gè)輸入去耦電容，推薦使用ESR較低的4.7μF以上的陶瓷電容，并將其盡可能靠近VCC引腳放置。輸入紋波電壓可以通過公式 (Delta V{CC}=frac{ I{OUT} }{f × C{VCC}} × frac{ V{OUT} }{ V{CC} } timesleft[1-frac{ V{OUT} }{ V{CC} }right]) 計(jì)算，RMS紋波電流可以通過公式 (C{VCC} = I{OUT} × sqrt{frac{ V{OUT} }{ V{CC} } timesleft(1-frac{ V{OUT} }{ V_{CC} }right)}) 計(jì)算。

相位補(bǔ)償元件

通過VC引腳控制環(huán)路的穩(wěn)定性和響應(yīng)性，通過連接在VC引腳的電阻和電容的組合來調(diào)整決定穩(wěn)定性和響應(yīng)性的零點(diǎn)和極點(diǎn)。DC增益可以通過公式 (A_{dc}=Rl × G{CS} × A{VEA} × frac{V{FB}}{V_{OUT}}) 計(jì)算，控制環(huán)路中有兩個(gè)重要的極點(diǎn)和一個(gè)重要的零點(diǎn)，分別通過相應(yīng)的公式計(jì)算。相位補(bǔ)償設(shè)計(jì)的目標(biāo)是創(chuàng)建一個(gè)通信函數(shù)，以獲得必要的帶寬和相位裕度。交叉頻率應(yīng)設(shè)定為開關(guān)頻率的1/20或更低。

PCB布局與功耗考量

PCB布局

PCB布局對于電源設(shè)計(jì)至關(guān)重要，合理的布局可以減少噪聲和提高電源性能。在布局時(shí)，應(yīng)注意以下幾點(diǎn)：

• VCC引腳應(yīng)通過低ESR的陶瓷旁路電容接地，盡量減小旁路電容連接、VCC引腳和續(xù)流二極管陽極形成的環(huán)路面積。
• GND引腳應(yīng)直接連接到IC下方的散熱墊和散熱墊，高電流線路應(yīng)盡量短而粗，以減少寄生阻抗和電感的影響。
• 輸入去耦電容應(yīng)盡可能靠近VCC引腳放置。
• 續(xù)流二極管和電感應(yīng)盡可能靠近Lx引腳放置，以減小寄生電容和阻抗。
• 散熱墊應(yīng)通過多個(gè)過孔直接連接到PCB內(nèi)部的接地平面。
• GND反饋電阻、相位補(bǔ)償元件和RT電阻不應(yīng)與高電流線路共用阻抗電阻。

功耗估算

功率耗散是設(shè)計(jì)中需要考慮的重要因素，BD9G341EFJ的功耗包括傳導(dǎo)損耗、開關(guān)損耗、柵極電荷損耗和靜態(tài)電流損耗。在連續(xù)模式下，功耗可以通過以下公式估算：

• 傳導(dǎo)損耗：(P{con} =I{OUT}^{2} × R{onH} × frac{V{OUT}}{ V_{CCO}})
• 開關(guān)損耗：(P{sw} =16 n × V{CC} times)
• 柵極電荷損耗：(P{gc}=500 p × 7 × f{sw})
• 靜態(tài)電流損耗：(P{q}=1.5 m × V{CC})

總功耗為上述各項(xiàng)損耗之和：(Prp19iyqb=P{con}+P{sw}+P{gc}+P_{q})

同時(shí)，結(jié)溫與環(huán)境溫度和功耗之間的關(guān)系可以通過公式 (T{j}=T{a}+theta{ja} × Prp19iyqb) 計(jì)算，設(shè)計(jì)時(shí)應(yīng)確保結(jié)溫不超過150℃。

操作注意事項(xiàng)

電源反接

電源反接可能會損壞IC，因此在連接電源時(shí)應(yīng)采取預(yù)防措施，如在電源和IC的電源引腳之間安裝外部二極管。

電源線設(shè)計(jì)

設(shè)計(jì)PCB布局時(shí)，應(yīng)提供低阻抗的電源線，將數(shù)字和模擬模塊的地線和電源線分開，以防止數(shù)字模塊的噪聲影響模擬模塊。同時(shí)，在所有電源引腳處連接電容到地，并考慮電解電容的溫度和老化對電容值的影響。

接地電壓

確保在任何時(shí)候，即使在瞬態(tài)條件下，沒有引腳的電壓低于接地引腳的電壓。

接地布線模式

當(dāng)同時(shí)使用小信號和大電流接地走線時(shí)，應(yīng)將兩者分開布線，并在應(yīng)用板的參考點(diǎn)處連接到一個(gè)公共接地，以避免大電流引起的小信號接地波動。同時(shí)，確保外部元件的接地走線不會導(dǎo)致接地電壓的變化，接地線應(yīng)盡可能短而粗，以降低線路阻抗。

散熱考慮

如果功率耗散超過額定值，芯片溫度升高可能會導(dǎo)致芯片性能下降。本規(guī)格書中規(guī)定的Pd絕對最大額定值是在IC安裝在70mm x 70mm x 1.6mm玻璃環(huán)氧板上時(shí)的值。如果超過該絕對最大額定值，應(yīng)增大電路板尺寸和銅面積，以防止超過Pd額定值。

推薦工作條件

這些條件代表了可以近似獲得IC預(yù)期特性的范圍，各項(xiàng)參數(shù)的電氣特性在相應(yīng)條件下得到保證。

浪涌電流

當(dāng)首次向IC供電時(shí)，由于內(nèi)部上電順序和延遲，內(nèi)部邏輯可能不穩(wěn)定，可能會瞬間產(chǎn)生浪涌電流，特別是當(dāng)IC有多個(gè)電源時(shí)。因此，應(yīng)特別考慮電源耦合電容、電源布線、接地布線寬度和連接布線。

強(qiáng)電磁場下的操作

在強(qiáng)電磁場環(huán)境下操作IC可能會導(dǎo)致IC故障。

應(yīng)用板測試

在應(yīng)用板上測試IC時(shí)，直接將電容連接到低阻抗輸出引腳可能會對IC造成壓力。每次測試過程或步驟結(jié)束后