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概述

Serial RapidIO(SRIO) 特指 RapidIO 標(biāo)準(zhǔn)的串行物理層實(shí)現(xiàn)。

RapidIO 標(biāo)準(zhǔn)定義為三層：

邏輯層：定義總體協(xié)議和包格式，包含設(shè)備發(fā)起和完成事務(wù)的必要信息。

傳輸層：提供包傳輸?shù)穆酚尚畔ⅲ瑢?duì)頂層不可見。

物理層：描述設(shè)備級(jí)接口細(xì)節(jié)（包傳輸機(jī)制、流控、電氣特性、低級(jí)錯(cuò)誤管理）。

邏輯層（LOG）

邏輯層劃分為以下模塊控制并解析數(shù)據(jù)包，提供三類接口：

用戶接口（User Interface）

傳輸接口（Transport Interface）（相當(dāng)于緩存 Buffer，對(duì)頂層不可見）

配置接口（Configuration Fabric Interface）（用于讀寫本地配置空間及邏輯/傳輸層寄存器）

用戶接口（重點(diǎn)關(guān)注）

包含I/O 端口集和三個(gè)可選端口：

I/O 端口集：

支持事務(wù)：NWRITEs、NWRITE_Rs、SWRITEs、NREADs、RESPONSEs（不含維護(hù)事務(wù)響應(yīng)）、門鈴事務(wù)。

消息事務(wù)（取決于配置是否分離 I/O 與 Message 端口）。

消息端口：專用于消息事務(wù)。

維護(hù)端口：專用于維護(hù)事務(wù)。

用戶自定義端口：支持自定義類型（未使能時(shí)丟棄包）。

I/O 端口類型

頂層信號(hào)映射：

s_axis_ireq*→ireq

m_axis_iresp*→iresp

m_axis_treq*→treq

s_axis_tresp*→tresp

物理層（PHY）

功能：

處理鏈路訓(xùn)練（Link Training）、初始化、協(xié)議

插入 CRC 與應(yīng)答標(biāo)識(shí)符

連接高速串行收發(fā)器（外部例化模塊）

接口：

2 個(gè) AXI4-Stream 通道連接傳輸層

1 個(gè) AXI4-Lite 接口連接配置層

1 個(gè)串行接口連接收發(fā)器（FPGA 使用 GT 接口實(shí)現(xiàn)）

寄存器空間

HELLO 包格式

標(biāo)準(zhǔn)化包頭域，包頭與數(shù)據(jù)分離傳輸：

Size 域：值 = 傳輸字節(jié)總數(shù) - 1（有效范圍 0~255 → 實(shí)際傳輸 1~256 字節(jié)）

限制：必須與 RapidIO 包中的 size/address/wdptr 域匹配，IP 核不會(huì)修正非法值。

注意：AXI4-Stream 的tdata為 8 字節(jié)（雙字），需根據(jù)數(shù)據(jù)量是否小于 8 字節(jié)分別處理。

SRIO 事務(wù)類型及關(guān)系

1. 直接 I/O（DMA）事務(wù)

2. 消息傳遞事務(wù)

3. 維護(hù)事務(wù)

事務(wù)對(duì)比

事務(wù)類型表

詳見 PG007 手冊(cè) P73。

總結(jié)

Xilinx SRIO IP核的事務(wù)類型覆蓋了從高效硬件控制到靈活軟件交互的全場(chǎng)景需求，用戶需根據(jù)延遲、帶寬、可靠性等指標(biāo)選擇合適類型。例如，實(shí)時(shí)數(shù)據(jù)采集可采用SWRITE，而系統(tǒng)配置則依賴MAINTENANCE事務(wù)。

直接 I/O：用于低延遲硬件控制（如實(shí)時(shí)數(shù)據(jù)采集用 SWRITE）。

消息傳遞：用于靈活軟件交互（如系統(tǒng)通知）。

維護(hù)事務(wù)：用于設(shè)備配置管理。